본 논문에서는 결함허용(Fault Tolerant) 시스템에 의해 발생된 2진 신호를 고장안전(Fail-Safe) 신호로 변환하는 SFS(Strongly Fail-Safe) 인터페이스를 설계하였다. SFS 특성은 자체검사(Self-Checking) 기법을 근거로 만족할 수 있었으며, 이러한 인터페이스는 개별 부품에 의한 기존의 고장안전 인터페이스 설계와는 달리 집적화 가능성을 보여 주었다. 또한 고장안전 시스템 설계에 대한 정의를 함으로써 새로운 시스템 구현 방법을 제시하였다.
This paper modelled the fail-safe control logic through the frequency coding input and designed the 3-out of-6 self checker using the error detect coding method of information redundancy. In addition, this paper also peformed the reliability parallel numeric analysis regarding single module between fail-safe. control logic module and TMR(Triple Modular Redundancy), therefore, we achieved the result that the fail-safe control logic increases a functional reliability because of decreasing system waste cost and functional overhead rather than the existing hardware redundancy method.
This study provides analytical evaluation of the Dual-Ann Work Module. The current hydraulic system was modeled using the HyPneu and analyzed to find the cause of the instability. The cause of the instability was determined to be primarily an interacting involving the pilot operated check valves and the counterbalance valves for fail safe mode of operation. A new design concept was developed to eliminate the potential for unstable operation while adequately meeting the need for a fail-safe feature.
본 논문에서는 결함의 영향을 받지 않고, 결함이 발생하여도 안전측으로 동작할 수 있는 고장안전 보터(Fail-safe Voter)의 특성을 가지는 AVTMRWFSV(All Voting Triple Modular Redundancy With Fail-Safe Voter)시스템 구조를 설계하였으며, 마코브 모델링(Markov Modeling) 고장율에 따른 시스템의 RAMS(Reliability, Availability, Maintainability, Safety)를 평가하였다. 고장 안전 보터를 가지지 않은 AVTMR(All Voting Triple Modular Redundancy) 시스템과 AVTMRWFSV 시스템을 비교분석 하였고, 특히, 안전도(Safety)의 특성에 있어서 우수하다는 것을 보였으며, 설계된 AVTMRWFSV 시스템이 AVTMR보다 전반적인 시스템 평가에서 우수한 특성을 가진다는 것을 시뮬레이션을 통해 알 수 있었다. 이러한 AVTMRWFSV 시스템은 결함을 허용(Fault tolerant)하고, 고장 발생시 안전측으로 동작하는 특성을 가지기 때문에, 높은 신뢰성(Dependability)이나 안전성(safety)이 요구되는 통신 시스템이나 인간의 생명과 관련된 임베디드(Embedded) 철도통신 시스템, 선박 시스템이나 항공기 시스템에 적용될 수 있다.
해상에서 항법시스템의 고장이나 중단에도 불구하고 연속적인 항법 서비스의 제공이 가능하도록 하는 Fail-Safe Seaway 방안이 필요하다. 모든 위성 및 지상전파항법의 통합전파항법기술을 위해 본 논문에서는 소프트웨어 라디오 기술을 이용한 수신기 특히, GPS 수신기의신호처리 알고리즘 설계에 초점을 맞춘다. 현재 소프트웨어 GPS 수신기의 가장 큰 문제점은 실시간 구현의 어려움에 있다. GPS 신호와 같이 넓은 대역폭을 갖는 신호를 다중 상관기로 구현하는데 있어서, 상용 프로세서에서는 많은 연산량이 요구되어 실시간 구현이 어렵기 때문이다. 본 논문은 실시간 구현 시에 요구되는 많은 연산량을 해결하기 위해 소프트웨어 GPS 수신기 내부에서 생성하는 다중비트의 반송파 및 코드를 일정한 패턴으로 간소화시켜 연산량을 크게 감소시키는 방법을 제안한다.
본 본문은 NOMS 와 CMOS 집적회로에서 발생 가능한 물리적 결점에 의한 결함에 대해서 Fail-safe 시스템에서 사용할 목적이며, 첫 번째 VLSI 회로 상에서 다양한 물리적 결점을 반영할 수 있는 PLA에 대한 결함 모델을 제시한다. PLA에 근거한 설계 이유는 VLSI칩에서의 물리적 결점을 세부적으로 분식하는 것이 너무 복잡하기 때문이다. 두 번째 본문에서는 2단 AND-OR 또는 NOR-NOR 회로로 구현한 설계가 최적의 크기를 갖는다는 것을 보여준다. 또한 NOR-NOR PLA로 구현한 비교기가 제시한 단일 결함 모델에 대해서 자체시험성을 갖는다는 것을 증명한다. 최종적으로 Fail-safe 가산기에 대해 빌딩블럭으로 자체시험 비교기의 적용을 논한다.
해상에서 항법시스템의 고장이나 중단에도 불구하고 연속적인 항법 서비스의 제공이 가능하도록 하는 Fail-Safe Seaway 방안이 필요하다. 모든 위성 및 지상전파항법의 통합전파항법기술을 위해 본 논문에서는 소프트웨어 라디오 기술을 이용한 수신기 특히, GPS 수신기의 신호처리 알고리즘 설계에 초점을 맞춘다. 현재 소프트웨어 GPS 수신기의 가장 큰 문제점은 실시간 구현의 어려움에 있다. GPS 신호와 같이 넓은 대역폭을 갖는 신호를 다중 상관기로 구현하는데 있어서, 상용 프로세서에서는 많은 연산량이 요구되어 실시간 구현이 어렵기 때문이다 본 논문은 실시간 구현 시에 요구되는 많은 연산량을 해결하기 위해 소프트웨어 GPS 수신기 내부에서 생성하는 다중비트의 반송파 및 코드를 일정한 패턴으로 간소화시켜 연산량을 크게 감소시키는 방법을 제안한다.
This paper proposes the failsafe control logic. which has applied to the voting on the TMR system by using FPGA The self-detection circuit is also designed for detecting a characteristic of fault at TMR system. The fault producing in the self-detection system is largely classified among an intermittent fault, a transient fault and a permanent fault. If it is happened to the permanent fault, the system can be failed. Therefore, it is designed the logic circuit which is not transferred the permanent fault to the system after shut off output. The control logic of the Fail Safe proposed in the paper is required for a circuit integrate of device to minimize the failure happened. Therefore, it makes to design FPGA with modeling of VHDL. The circuit of the Fail Safe of TMR system is able to apply to nuclear system, rail-way system, aerospace and aircraft system which is required for high reliability.
Railway signalling system always is required high safety and reliability. The failure of the train control system can provoke a serious accident. In this paper, we show how to achieve the safety and reliability by dividing signalling system into vital and non functions, studying operational environment.
The ${\mu}$-processor based-controlled system is widely used in railway signaling system. The railway signaling systems are highly required safety and reliability. It is necessary to have a fault-tolerant and fail safe concept in ${\mu}$-processor based railway signaling system. In this paper, several architectures and circuits of fault-tolerant computer system is reviewed. The basic concept of the fault-tolerant computer system will be adapted total self checking, strong fail safe, fault display circuit, logic testing circuit and system switching concepts.
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[게시일 2004년 10월 1일]
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