본 논문에서는 주파수 비선택적 라이시안 페이딩 채널에서 DS/SS 초기 동기 시스템의 성능을 분석 하였다. 채널 파라메터로는 페이딩된 신호 성분대 원하는 신호 성분의 전력비 . 연속적으로 균일하게 페이딩된 칩수 k, 연속된 k 칩간의 상관관계를 이용하였다. 이에 따른 검출기에서의 오보확률과 검출확률을 유도하였고 이를 초기 동기 시스템의 상태 천이도에 적용하여 시스템의 평균 패킷 손실 확률을 구하였다. 분석 결과로부터 페이딩 체널에서 직렬 탐색 알고리즘을 사용한 DS/SS 초기 동기 시스템의 성능의 사기상관 사이드로브에 의하여 패킷 손실이 증가 하는 대역이 있었으며, 연속적으로 균일한 페이딩을 갖는 칩수 k가 증가 합에 따라 패킷 손실 확률이 감소 하였다.
This paper studied the method to improve the reliability with the simple structure and the decreased calculation of Micro-Controller(uC) in Power Line Modem. We have implementation the program which correct the 1-bit error of the $\mu$C within the control system and the DS/SS(Direct sequence/spread spectrum) by adding the simple circuit between a single chip powerline transceiver IC and a uC.
A mobile propagation characteristics for wideband DS-SS (Direct Sequence-Spectrum) signal is presented. Existing narrowband model is extended for the wideband pulse with an arbitrary shape. The received DS-SS signal in the frequency domain is the transfer function of the propagation channel weighted by the inverse Fourier transform. In this proposed method, received signal spectral density, instantaneous waveform, and Doppler spectrum of DS-SS signal via either Rayleigh of Rician channel can be obtained easily. Simulation results match well with both simulated theoretical fading statistics and classical theory. As expected, the extraction of chip timing in Rician fading shown to be more tractable than Rayleigh fading.
본 논문에서는 주파수대역 직접확산방식 (DS-SS)의 비행종단시스템을 제안하였고 FPGA를 이용하여 구현된 결과를 보여준다. DS-SS방식의 비행종단시스템은 간섭신호와jamming에 강한 특성이 있을 뿐만 아니라 확산코드를 사용함으로써 인증과 암호화의 효과를 얻을 수 있다. 또한 기존의 아날로그 FM방식의 종단시스템에 비하여 전력을 크게 줄일 수 있다. 오류정정을 위하여 리드-솔로몬(32, 28)코드를 적용하였고 데이터를 암호화하기 위하여 3중 Data Encryption Standard (3DES)암호화를 하였다. 그리고 counter알고리즘을 적용하여 외부 장치의 간섭으로부터 비행체를 보호할 수 있도록 하였다. I채널과 Q채널의 확산코드는 GOLD코드생성기를 이용하여 생성하였다. 시스템은 ALTERA EPXA1F484C3 디바이스로 지상시스템을 구현하였고, FLEX계열인 EPF10K100ARC240 디바이스를 사용하여 비행종단 탑재시스템을 구현하였다.
이 논문에서는 주파수 편차가 발생하는 채널에서 패킷 직접 대역확산(Direct-Sequence Spread Spectrum) 블록 수신기의 위상 반전 검출(Phase-jump detection) 오류 여부를 확인하는 PJED(Phase Jump Error Detector)의 성능을 고찰한다. 또한 정합 펄스 순간 추출기를 제시한다. 이동통신 채널상에서 발생하는 기존의 방식보다 간단한 구조를 갖는 정함펄스 순간 추출기를 제시한다. 이동통신 채널상에서 발생하는 주파수 편차는 패킷 DS/SS 블록 수신기를 사용함으로써 효율적으로 추정, 보상할 수 있는데 SNR(Signal to Noise Ratio)이 감소할수록 위상 반전 검출의 오류가 발생하며 이러한 위상 반전 검출의 오류를 방지하기 위한 대안으로서, 이 논문에서는 위상의 선형성을 이용하는 PJED를 제안하고 또한 신호 처리 시간을 단축시키고 수신기의 구조를 간단하게 만드는 정함펄스 순간 추출기를 제안한다. 실험 결과, PJED를 패킷 DS/SS 블록 수신기에 적용시킬 경우에는 PJED가 없는 수신기보다 동일한 BER에서 약 2dB정도의 성능개선을 보여준다. 또한 협대역 간섭신호가 존재할 경우도 약 2dB 정도의 성능향상을 나타낸다. 그리고 본 논문에서 제안한 단순한 구조의 정함펄스 순간 추출기를 사용하여도 정확한 정함 펄스 순간을 판단 할 수 있다.
전력선 통신은 전력선 채널의 특성이 전력선에 연결된 부하에 의해 변화하는 문제점을 가지고 있다. 이러한 문제점을 극복하기 위한 한 가지 방법으로 대역확산(Spread Spectrum) 방식이 사용되어 왔으며, 그 중 DS/SS (Direct Sequence/Spread Spectrum)은 별다른 Hardware의 추가 없이 구현할 수 있다는 장점을 가지고 있다. DS/SS 시스템에서는 의사잡음(PN code)의 Chip수가 길어질 수 록 에러율이 감소하게 되지만, 저속 전력선 모뎀의 경우 긴 Chip수를 사용할 경우 원하는 데이터 전송 속도를 얻어내기 힘들다. Dual-processing Gain을 가지는 Spread Spectrum 시스템은 전력선 잡음의 주기적 특성을 반영하고자 하였다. 그러나 제안되었던 시스템은 잡음의 형태가 전원전압의 1/4주기를 기준으로 대칭적이라는 가정 하에서 적용되어 실제 여러 형태의 전력선 잡음을 반영하지 못하였다. 따라서 본 논문에서는 여러 잡음의 형태에 따라 PN code의 Chip수가 주기적으로 변경되도록 알고리즘을 구현하여 시스템을 구성 후 시뮬레이션 하였다. 시뮬레이션 시 부하의 잡음을 측정 및 모델링하여 시뮬레이션 하였으며, 구성된 시스템은 여러 전력선 채널의 잡음상황 하에서 실제 데이터 전송 속도를 적게 감소시키면서 에러율은 효과적으로 감소시키는 것을 확인하였다.
본 논문에서는 DS-SS 방식의 ISO/IEC 24730-2 RTLS 모뎀을 위한 주파수 동기 알고리즘을 제시한다. 제시하는 주파수 동기 알고리즘은 주파수 동기 획득 모드와 주파수 동기 추적 모드로 구성되며, 주파수 동기 획득 모드는 각도 추정과 검증 과정의 두 단계 과정을 통해 이루어진다. 각도 추정에서는 타이밍 간격에 따라 세 가지 경우로 나누어 각도를 추정하고, 검증 과정에서는 추정된 세 각도간의 이론적인 연계성을 이용하여 각도의 모호성을 제거하여 효과적인 주파수 동기화가 이루어지도록 하였다. 이러한 방식으로 구성된 주파수 동기 알고리즘의 이론적 해석과 시뮬레이션을 통한 성능 분석을 토대로 제시한 주파수 동기 알고리즘의 타당성을 검증하였다.
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[게시일 2004년 10월 1일]
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