• 제목/요약/키워드: BMU 회로

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계층적 배터리 관리 시스템 시뮬레이션 기술 개발 (Development of Simulator for Hierarchical Battery Management System)

  • 강현우;안성호;김동균
    • 대한임베디드공학회논문지
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    • 제8권4호
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    • pp.213-218
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    • 2013
  • In this research, we report on the development of simulation system for performance verification of BMS(Battery Management System) which is utilized in electric vehicles. In the industrial circles, a manufacturer of BMS typically tests their system with real battery packs. However, it takes a long time to test all functions of BMS. Here, we develop BMU(Battery Managament Unit) as an embedded board, which will be installed in electric vehicle for controlling battery packs. All other environment factors for testing BMU are developed in softwares in order to reduce the term of test. Especially, the proposed system consists of cell simulator and CMU(Cell Management Unit) simulator which simulate real battery cells and control battery cells. These simulators enable the BMU to test more battery cells. In addition, proposed system provides diagnosis program in order to diagnose and monitor the condition of BMS which makes the test of BMS more easily. In order to verify the performance of the developed simulator, we have performed the experiment with real battery packs and our simulator. Through comparing two results of experiments, we verify that developed simulator shows better performance in terms of less amount of testing duration though having high reliability.

경로 메트릭 데이터의 효율적인 관리를 통한 고성능 비터비 디코더 회로 설계 (Design of High-performance Viterbi Decoder Circuit by Efficient Management of Path Metric Data)

  • 김수진;조경순
    • 대한전자공학회논문지SD
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    • 제47권7호
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    • pp.44-51
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    • 2010
  • 본 논문은 고성능 비터비 디코더 회로 구조를 제안한다. 제안하는 비터비 디코더는 가지 값의 특징을 이용하기 때문에 추가적인 메모리를 사용하지 않고 가지 메트릭을 계산할 수 있다. 또한 빠른 합-비교-선택 연산을 위해 경로 메트릭 데이터를 SRAM과 레지스터에 적절하게 재배열함으로써 디코더 전체의 속도를 75%까지 향상시킨다. 제안하는 비터비 디코더 회로를 Verilog HDL로 설계하였으며 130nm 표준 셀 라이브러리를 이용하여 게이트 수준 회로로 합성하였다. 제안하는 회로는 8,858개의 게이트로 구성되며 회로의 최대 동작 주파수는 130MHz이다.