• 전력전자학회:학술대회논문집
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• 전력전자학회 2011년도 전력전자학술대회
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• pp.557-558
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• 2011

전기자동차의 축전지 관리 시스템(BMS : Battery Management System)의 잔존용량(SOC : State Of Charge)산정에는 Ah 측정법, 비중측정법, 전압측정법 등이 있다. 기존 전압 측정법의 경우 측정 전압을 프로세서에서 직접 처리하기 때문에 축전지의 미세한 전압 변화를 측정하지 못하여 잔존 용량 산정시 세밀한 계산에 어려움이 따른다. 본 논문에서는 축전지의 전압 측정 시 프로세서 전단에 전압의 부분 증폭회로를 추가하여 축전지의 미세한 전압변화를 증폭하여 측정하는 방법을 제안 하였다. 니켈수소전지를 대상으로 실험한 결과 충전 중 기존 전압측정법은 1.431V, 1.436V, 1.441V가 측정 되었을 때의 잔존 용량은 84%로 일정하였다. 같은 전압변화에서 부분증폭회로를 적용한 충전전압은 1.4297V, 1.4303V ~ 1.4352V, 1.4358V로 측정 되었으며, 그에 따른 잔존용량은 84% ~ 85%로 기존 전압 측정법 보다 약 9 ~ 10배 정도 세밀하게 측정 되었다. 제안한 방법을 통한 실험으로 제안된 방법이 기존 전압 측정법보다 세밀한 전압 측정 및 SOC산정이 가능함을 확인 하였다.

• 전력전자학회논문지
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• 제24권4호
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• pp.279-285
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• 2019

This study proposes an enhanced switching pattern that can improve energy transfer efficiency in an active cell-balancing circuit using a multiwinding transformer. This balancing circuit performs cell balancing by transferring energy stored in a specific cell with high energy to another cell containing low energy through a multiwinding transformer. The circuit operates in flyback and buck-boost modes in accordance with the energy transfer path. In the conventional flyback mode, the leakage inductance of the transformer and the stray inductance component of winding can transfer energy to an undesired path during the balancing operation. This case results in cell imbalance during the cell-balancing process, which reduces the energy transfer efficiency. An enhanced switching pattern that can effectively perform cell balancing by minimizing the amount of energy transferred to the nontarget cells due to the leakage inductance components in the flyback mode is proposed. Energy transfer efficiency and balancing speed can be significantly improved using the proposed switching pattern compared with that using the conventional switching pattern. The performance improvements are verified by experiments using a 1 W prototype cell-balancing circuit.

• 한국전자통신학회논문지
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• 제11권5호
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• pp.479-484
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• 2016

본 논문은 Daisy Chain 구조의 CVM(:Cell Voltage Monitoring) 시스템에서, 다양한 DC Level을 갖는 Master IC와 Slave IC 사이에 명령 Data 신호의 전달을 가능하게 해주는 DC Level Shifter 설계를 소개한다. 설계한 회로는 래치 구조가 적용되어 고속 동작이 가능하고, 출력단의 Transmission Gate를 통하여 다양한 DC Level이 출력되도록 설계하였다. 시뮬레이션 및 측정 결과, 0V에서 30V까지의 DC Level 변화에 따른 제어 및 Data 신호의 전달을 확인하였다. Delay Time 오차는 약 170ns가 측정되었지만, 측정 Probe의 Capacitance 성분 및 측정 Board의 영향을 고려하면, 무시할 수 있을 정도의 오차로 간주된다.