• 제목/요약/키워드: Automatic impedance calibration

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13.56 MHz 임피던스 자동 정합 시스템을 위한 임피던스 에러율 향상 알고리즘 (Error Rate Enhancement Algorithm for 13.56 MHz Impedance Automatic Matching System)

  • 장광호;박수연;최진주;이동헌
    • 한국전자파학회논문지
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    • 제29권7호
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    • pp.484-490
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    • 2018
  • 본 논문은 13.56 MHz 임피던스 자동 정합 시스템 내의 VI 센서를 이용하여 전압 신호와 전류 신호를 측정하고, 부하임피던스를 계산하는 새로운 알고리즘에 대해서 기술하였다. 기존의 $50{\Omega}$ 교정 부하로 하던 방식에서 벗어나 임의의 복소수 교정 부하를 사용하여 에러율이 향상되는 알고리즘을 제안한다. 에러율은 $R_{IN}$ 평균 1 % 이하, $X_{IN}$은 평균 20 %이하 목표로 한다. 일차적으로 믹서를 사용하여 IF 주파수를 계산하여 에러율을 줄였고, 두 번째로 임의의 복소수 부하를 교정 부하로 사용하였을 때 에러율이 $R_{IN}$은 평균 2.7 %에서 평균 0.3 %로 감소하였고, $X_{IN}$은 평균 102 %에서 평균 18.3%까지 감소하였습니다.

Design of a Wide-Frequency-Range, Low-Power Transceiver with Automatic Impedance-Matching Calibration for TV-White-Space Application

  • Lee, DongSoo;Lee, Juri;Park, Hyung-Gu;Choi, JinWook;Park, SangHyeon;Kim, InSeong;Pu, YoungGun;Kim, JaeYoung;Hwang, Keum Cheol;Yang, Youngoo;Seo, Munkyo;Lee, Kang-Yoon
    • JSTS:Journal of Semiconductor Technology and Science
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    • 제16권1호
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    • pp.126-142
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    • 2016
  • This paper presents a wide-frequency-range, low-power transceiver with an automatic impedance-matching calibration for TV-white-space (TVWS) application. The wide-range automatic impedance matching calibration (AIMC) is proposed for the Drive Amplifier (DA) and LNA. The optimal $S_{22}$ and $S_{11}$ matching capacitances are selected in the DA and LNA, respectively. Also, the Single Pole Double Throw (SPDT) switch is integrated to share the antenna and matching network between the transmitter and receiver, thereby minimizing the systemic cost. An N-path filter is proposed to reject the large interferers in the TVWS frequency band. The current-driven mixer with a 25% duty LO generator is designed to achieve the high-gain and low-noise figures; also, the frequency synthesizer is designed to generate the wide-range LO signals, and it is used to implement the FSK modulation with a programmable loop bandwidth for multi-rate communication. The TVWS transceiver is implemented in $0.13{\mu}m$, 1-poly, 6-metal CMOS technology. The die area of the transceiver is $4mm{\times}3mm$. The power consumption levels of the transmitter and receiver are 64.35 mW and 39.8 mW, respectively, when the output-power level of the transmitter is +10 dBm at a supply voltage of 3.3 V. The phase noise of the PLL output at Band 2 is -128.3 dBc/Hz with a 1 MHz offset.

모바일용 저전력 터치 스크린 제어 회로 설계 및 구현 (Design and Implementation of Low Power Touch Screen Controller for Mobile Devices)

  • 박상봉
    • 한국인터넷방송통신학회논문지
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    • 제12권6호
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    • pp.279-283
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    • 2012
  • 본 논문에서는 모바일용 터치 스크린에서 손가락이 닿는 부분의 좌표를 계산하여 출력하는 저전력 고속 터치 제어 회로를 설계하고 구현하였다. 시스템 클럭은 10MHz이고, 채널 수는 21개, 대기 상태 전류는 $20{\mu}A$ 이고, 다이나믹 레인지는 140pF ~ 400pF 이며, 응답 시간은 0.1ms/frame이다. 저전력을 위한 전력 관리 회로와 보드, 습도, 온도에 따른 자동 임피이던스 보정 기능과 주변 키 및 패턴 간섭 억제 기능 및 직렬 인터페이스 I2C, SPI 기능을 구현하였다. 설계된 제어 회로의 성능은 FPGA와 $0.18{\mu}m$ CMOS 표준 공정을 이용하여 측정하였다. 구현된 제어회로는 모바일 폰이나 스마트 리모트 컨트롤로에 응용할 수 있도록, 다이아몬드 형태를 이용한 2 레이어 ITO용 모듈과 원가절감을 위한 단일 레이어 ITO 모듈에 사용 가능하도록 설계하였다.