• Proceedings of the Korean Operations and Management Science Society Conference
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• 1994.04a
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• pp.232-235
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• 1994

설계, 가공, 조립, 검사기술로 대표되는, 생산시스템의 근간이 되는 기술은 공작기계에 의한 부품가공 소위, 기계가공기술이다. 이러한 기술은 종래의 DNC(Direct Numerical Control)에서 가공 Cell의 효율을 높이기 위한 분산제 어 시스템 (DNC : Distributed Numerical Control)으로 발전하고 있다. 분산 제어시스템의 구성기술은 소프트웨어적인 운용기술과 하드웨어적인 실행기 술로 나눌수가 있다. 여기에서는 분산제어시스템의 구성을 위해 기계의 상태 정보를 빠르게 수집하여 감시하고 제어할수 있는 방법 및 이를 실험을 통해 정량분석을 수행한 결과를 소개한다.

• Proceedings of the KIEE Conference
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• 2015.07a
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• pp.135-136
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• 2015

일반적으로 머신비전을 이용한 위치 추정 정밀도는 카메라의 화소 수에 비례한다. 머신비전 카메라의 경우 화소가 많을수록 카메라 가격이 크게 증가하므로 화소 수만을 늘려서 정밀도를 높이는 하드웨어적 방법은 활용이 제한적이다. 이런 문제를 해결하기 위해서 적은 화소 수로 높은 위치 추정 정밀도를 얻을 수 있는 다양한 소프트웨어 알고리즘에 대한 연구가 진행되어 왔다. 본 논문에서는 위치 추정 정밀도를 높이기 위한 서브 픽셀 위치 추정 알고리즘을 구현하고 이를 반도체 칩 검사용 고정밀 스테이지에 적용하였다.

• Proceedings of the Korean Information Science Society Conference
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• 2001.10c
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• pp.22-24
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• 2001

내장형 시스템은 산업 전반에 다양한 방법으로 응용되고 있다. 하지만 항공 분야나 원자력 분야의 내장형 시스템은 안정성과 신뢰성이 절대적으로 보장되어야 하는 시스템으로 피 설계부터 구현에 이르기까지 다양한 방법으로 검사되고 검증되어야 한다. 본 논문에서는 내장형 시스템의 통합설계를 위한 기반으로 하드웨어 설계 언어인 Verilog를 입력 언어로 받아들여 이를 정형검증 도구인 VIS를 통하여 검증한 다음 이를 바로 구현하는 방법론 및 예를 보이고자 한다. 이러한 방법을 통해 내장형 시스템의 안정성과 신뢰성의 수준을 향상시키고자 한다.

• Proceedings of the Korean Reliability Society Conference
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• 2000.04a
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• pp.247-253
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• 2000

본 논문은 정보 여분(Information Redundancy)에서의 에러 검출 코딩(Error Detect Coding) 기법을 이용하여 3-out-of-6 자체 검사기를 설계하고, 주기적인 코드(Frequency Coding) 주입을 통해 고장-안전 제어 논리를 모델링 했다. 고장-안전 제어 논리 모듈과 TMR(Triple Modular Redundancy)의 단일 모듈간에 대해서 신뢰성 병렬 수치 해석을 수행하였고, 이때 고장-안전 제어 논리가 기존의 하드웨어 여분 기법보다 시스템 소모비용과 기능적 오버헤드가 감소되어 기능신뢰성이 증가되는 결과를 얻었다.

• Proceedings of the Korean Nuclear Society Conference
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• 1997.10a
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• pp.284-289
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• 1997

원자력발전소 금속파편감시계통(LPMS : Loose Parts Monitoring System)은 내각재계통 내부에 존재하는 금속파편물을 조기에 탐지하여 관련 구조물 파손을 방지하므로써 불필요한 검사 및 보수로 인한 작업자 방사선 피폭를 최소화하며 원전 안전성 및 경제성을 제고시킨다. 현재 국내 원전에서 가동중인 금속파편감시설비중 영광 1,2호기와 고리 3,4호기에서 운영중인 Westinghouse사의 금속파편감시설비(상품명: Digital Matal Impact Monitoring System)는 70년대에 개발되어 설치된 설비로 기능의 낙후와 장기간 운영에 따른 노후화로 인해 발생될 수 있는 문제점을 방지하고자 하드웨어 및 금속충격파 검출 및 판별 알고리즘을 개발하여 영광 1,2호기에서 기존 설비와 병렬운전중이다.

• Proceedings of the Korean Information Science Society Conference
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• 2003.10a
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• pp.517-519
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• 2003

하드웨어 검증과 모델 체킹 등의 분야에서, SAT(satisfiability problem)나 항진 명제 검사(tautology checking)는 매우 중요한 문제이다. 그러나 이들은 모두 NP-complete 문제이므로 그 복잡도가 매우 크다. 이를 해결하기 위한 여러 연구가 진행되고 있고, 그 결과 성능이 좋은 solver들이 개발되었다. 하지만 문제가 커질수록 solver의 처리 시간이 급격하게 증가한다. 이 논문에서는 solver가 복잡한 문제를 더 효율적으로 풀기 위해 논문“Local search for Boolean relations on the basis of unit propagation”［5］에서 제안된 preprocessor(전처리기), P_EQ의 개념을 설명하고, 실험을 통한 결과를 제시한다.

• Proceedings of the Korea Contents Association Conference
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• 2015.05a
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• pp.153-154
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• 2015

현재 의료장비는 진단의 향상을 위해 보다 나은 영상을 획득하기 위하여 개발, 발전되어지고 있다. MRI장비 또한 좋은 영상을 획득하기 위해 소프트웨어 및 하드웨어가 발전되고 있다. 그 중의 하나가 자자의 세기가 점차 강한 장비로 변화되는 것이다. 고자장의 장비는 좋은 영상을 획득할 수 있는 장점이 있는 반면 폐쇄적 공포감, 소음 등의 단점 또한 존재한다. 이에 본 연구에서는 MRI 장비 단점 중 하나인 소음이 환자에게 심리적, 정신적으로 어떠한 영향을 미치는지를 설문조사한다. 그리고 이 장비를 사용하는 방사선사의 소음에 대한 인지정도를 설문조사하여 알아보고자한다. 따라서 이 연구는 MRI 검사 시 환자와 방사선사에게 소음에 대한 인식 향상 및 보호 제도 마련의 기초를 제공하고자 한다.

• ETRI Journal
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• v.11 no.1
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• pp.97-108
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• 1989

본 논문은 VHDL(Very High Speed IC Hardware Description Language)로 기술(description)한 입력을 받아 구문의 정확성을 검사하기 위한 구문 분석기 개발에 관한 것이다. 본 연구에서 채택한 VHDL 버젼은 1987년 12월 미국의 IEEE에서 표준 하드웨어 기술 언어로 공표한 VHDL 1076버젼을 대상으로 하고 있다. 현재는 입력이 구문과 일치하는가를 검사하여 맞지 않는 경우 에러 메시지(error message)를 내보내며, 맞는 경우 구문이 정확히 기술되었음을 사용자에게 통보한다. VHDL 구문 분석기는 향후 본 연구실에서 개발한 VHDL 시뮬레이터 및 합성기에서 front-end 툴로써 이용할 계획이며, VHDL 구문에 의한 기술을 통해 언어의 이해에도 이용할 수 있다. 프로그램은 SUN-3/160C 컴퓨터의 UNIX 4.2 BSD하에서 lex, yacc를 이용하여, C언어로 구현되었다.

• Proceedings of the KIEE Conference
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• 2007.07a
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• pp.310-311
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• 2007

다중패턴 홀로그램을 위한 자동 검사 시스템을 제안한다. 시스템 하드웨어는 조명계, 카메라 그리고 영상처리부로 구성된다. UV LED를 사용하는 다양한 조명은 다른 위치에 놓여 각 위치에서의 이미지 패턴을 획득한다. 시스템 소프트웨어는 전처리, 패턴 생성, 패턴매칭으로 구성된다. 획득한 입력 홀로그램 영상은 패턴매칭 알고리즘에 의해 표준 패턴과 비교한다. 입력 홀로그램의 위치 오차 보정을 위해, 다른 위치에서의 홀로그램 표준 패턴은 온라인상에서 생성되어야만 한다. 본 논문은 표준 패턴의 생성을 위해 CGH(Computer Generated Hologram)방법에 근거한 주파수 변환을 적용한다. 한국지폐의 홀로그램을 위한 실험 결과는 제안한 시스템의 유용성을 증명한다.

• Proceedings of the Korean Information Science Society Conference
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• 2004.10a
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• pp.592-594
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• 2004

프로토타입핑은 제품 개발을 위한 필요한 과정이지만 실제로 제품의 모형을 만든 후에 외형 및 기능을 검사하기 때문에 제품 개발 시간과 비용이 많이 들게 된다 컴퓨터 기술을 이용한 가상 프로토타이핑 시스템은 이러한 단점을 보안하기 때문에 않은 연구가 되고 있다 본 논문에서는 내장형 시스템 개발용 가상 프로토타입 플렛폼 제작을 위해 PDA와 휴대형 단말장치에서 가장 많이 사용되는 ARM코어를 기반으로 하는 ARMulator상에 하드웨어 IP를 구현하고 실시간 운영교제인 UC/OS-11를 이식하여 내장형 소프트웨어 개발용 가상 프로토타이핑의 환경을 구축하였다. 세 개의 타스크로 구성된 검사 프로그램를 운영하여 구축된 시스템의 동작을 확인하였다. 구축된 시스템은 내장형 시스템의 소프트웨어 개발을 위한 가상 환경을 제공한다.