본 논문은 상위 7비트와 하위3비트의 binary-thermal decoding 방식과 segmented 전류원 구조로서 전력소모, 선형성 및 글리치 에너지등 주요 사양을 고려하여, 3.3V 10비트 CMOS D/A 변환기를 제안한다. 동적 성능을 향상 시키기위해 출력단에 return-to-zero 회로를 사용하였고, segmented 전류원 구조와 최적화 된 binary-thermal decoding 방식으로 D/A변환기가 가질 수 있는 장점은 디코딩 논리회로의 복잡성을 단순화 함으로 칩면적을 줄일 수 있다. 제안된 변환기는 $0.35{\mu}m$ CMOS n-well 표준공정을 이용한다. 설계된 회로의 상승/하강시간, 정착시간, 및 INL/DNL은 각각 1.90/2.0ns, 12.79ns, ${\pm}2.5/{\pm}0.7$ LSB로 나타난다. 또한 설계된 D/A 변환기는 3.3V의 공급전원에서는 250mW의 전력소모가 측정 된다.
오늘날 통신 기술이 나날이 발전하고 있지만 디지털 영상신호가 방대한 데이터를 가지고 있기 때문에 데이터의 저장, 처리 및 전송을 위해서는 보다 많은 데이터 압축이 필요하게 되었다. 이에 따라 ITU-T에서는 디지털 영상신호의 압축 표준을 위해서 H.26x 등을 제정하였다. 일반적으로 영상처리에서는 픽쳐간 상관 관계를 이용하여, 픽쳐간의 움직임 예측을 통한 시간적 중복성을 제거하여 데이터를 크게 압축하는 것이 많이 사용되고 있다. 대부분의 비디오 코팅 시스템에서 움직임 예측/보상(Motion Estimation/Compensation)방법으로 블록 정합 알고리즘을 사용하는데 이는 특정한 비용 함수의 최소 값을 기반으로 사용되고 있다. 그러나 이 방법은 많은 수의 계산을 필요로 하여 탐색 시간이 오래 걸리는 단점이 있다. 따라서 H.26x에서와 같은 실시간 저비트율 부호화를 위해서는 전역 탐색법 보다는 효율적인 고속 탐색 알고리즘이 효과적이다. 본 논문에서는 움직임 예측에 소요되는 탐색 시간을 줄이기 위해서 고속 탐색 알고리즘 중에서 Nearest-Neighbors 탐색 알고리즘을 이용하여 움직임 예측기를 FPGA로 설계하였으며, VHDL로 코딩(Coding)하고, Xilinx Foundation을 이용하여 설계 및 검증하였다.
본 논문에서는 고성능 HEVC 복호기를 위한 효율적인 $32{\times}32$ 역변환기 하드웨어 구조를 제안한다. HEVC는 4k, 8k 이미지와 같이 기존의 이미지코덱에 비해 훨씬 더 큰 크기의 이미지를 처리할 수 있는 새로운 영상 압축 표준이다. 큰 이미지의 데이터를 효과적으로 처리하기 위해 다양한 새 블록 구조를 채택하였으며, 이 블록들은 $4{\times}4$, $8{\times}8$, $16{\times}16$, $32{\times}32$으로 구성되었다. 이 논문에서는 $32{\times}32$ 역변환기의 효과적인 구조를 제안하며, 역변환기의 구조는 $32{\times}32$ 행렬을 $16{\times}16$ 행렬로 재구성하고 쉬프트와 덧셈기로 구성된 곱셈기를 사용하여 연산을 단순화 하였으며 멀티 사이클 패스를 구현하여 낮은 주파수에서도 동작이 가능하도록 설계하였다. 또한 HEVC 코덱의 다양한 크기의 변환이나 순방향 변환 블록에 쉽게 적용할 수 있다.
HEVC 차세대 비디오 압축 표준은 ITU-TSG16 WP와 ISO/IEC JTC1/SC29, WG 11 두 단체 공동으로 2013년 표준화가 완료되었으며 기존 H.264 하이프로파일과 비교하여 압축효율은 두배 정도이다. HEVC에서 화면내 예측 (intra prediction) 모드는 planar와 DC 모드를 포함한 35개의 방향성 모드가 있으나 모든 모드를 적용한 부호화기를 구현하기 위해서는 하드웨어 복잡도가 증가하며 각 코딩유닛(coding unit) 사이즈에 따라 정확한 모드예측을 위한 RDO (rate distortion optimization) 계산에 필요한 DCT 사이즈도 증가하였기 때문에 본 논문에서는 하드웨어 사이즈를 줄이기 위하여 양자화를 위한 DCT와 SSE 계산을 위한 RDO 블럭내 DCT를 공유하는 화면내 예측부호기를 제안한다. 성능은 HEVC 참조소프트웨어인 HM-13.0과 비교하여 BD-rate는 평균 20% 증가하며 부호화시간은 4배 이상 단축되어 300MHz에서 FHD ($1920{\times}1080p$) 영상의 초당 60 프레임 실시간 부호화가 가능하다.
최근의 이동통신 시스템에서 오류 정정 부호화 방식으로 사용되는 터보 코드의 성능은 부호기에 내재되어 부호의 자유 거리 결정에 큰 영향을 미치는 인터리버와 복호기에서 수행되는 반복 복호에 의한 것이다. 하지만 우수한 성능을 얻기 위해 수신과정에서 많은 지연시간이 요구되는데 이는 주로 인터리버의 크기에 의존하게 된다. 또한 터보 코드는 페이딩 채널 상에서도 신뢰성 있는 강력한 코딩 기법으로 알려져, 최근 ITU 등에서 IMT-2700과 같은 차세대 이동 통신에서 채널 코드의 표준으로 채택되었다. 따라서 본 논문에서는 복잡도는 2배로 증가하나 성능을 개선시킨 병렬 구조의 4-New 터보 복호기를 제안하고, 차세대 무선 멀티미디어 통신에서 실시간 음성 및 비디오 서비스를 제공 시 복호 지연시간을 단축시키기 위해 가변 복호 방법을 이용하여 AWGN과 페이딩 채널 환경에서의 컴퓨터 모의 실험을 통해 성능 분석을 하였다.
근래 디지털방송은 백 수십 개의 방송프로그램을 제공하는 다(多)채널 양상을 보이고 있는데 이런 환경 하에서 시청자의 방송프로그램 탐색 작업이 복잡해지고 있다. 특히, 가장 일반적인 방송프로그램 탐색 방식인 영상을 직접 보면서 방송프로그램을 선택하는 방법은 수많은 채널들 사이를 0.7초가량 소요되는 채널 변경 작업을 반복해야하는 시간 소비적 작업이 되었다. 본 논문은 방송프로그램들의 멀티 뷰 영상을 활용하여 채널 변경 작업 없이 시청자가 프로그램 영상을 보며 채널을 선택하는 국제 데이터서비스 표준인 MHP기반의 프로그램가이드를 제안하였다. 본 데이터서비스의 구현을 위해서 방송프로그램 영상들로 구성된 멀티 뷰 영상과 관련 부가정보의 구성 및 송출 방법을 고안하고 방송수신기에 장착된 비디오 디코딩 칩셋의 고속편집 기능을 활용하는 자바 API를 정의하였다.
본 연구는 일 지역 3년제 간호대학생의 대학생활 적응 정도와 경험을 분석하기 위해 시도된 방법론적 트라이앵귤레이션 연구이다. 일 지역 3년제 간호대학생 139명을 연구대상으로, 2012년 9월 15일부터 11월 17일까지 자료수집 하였다. 양적자료는 빈도와 백분율, 평균과 표준편차, t-test, One-way ANOVA로 분석하였고, 질적자료는 면담 녹취록을 Strauss & Corbin(1990)의 개방코딩과 범주화 방법으로 분석하였다. 일 지역 3년제 간호대학생의 대학생활 적응 점수는 5점 만점에 평균 2.96점이었고, 전공 선택이유(F=6.23, p=.003), 학업 부담감(F=4.47, p=.013) 및 지각된 학업성취도(F=6.87, p=.001)에서 유의한 차이를 보였다. 대학생활 적응 경험으로는 '학업 부담감 극복', '취업 부담감 극복', '다양한 지지자원 확보', '다양한 교과 외 활동 참여' 및 '질 높은 실습교육'의 5개 범주가 도출되었다. 일 지역 3년제 간호대학생의 대학생활 적응 향상을 위하여 학업과 취업 부담감 경감, 지지자원과의 연계, 다양한 교과 외 활동의 계획 및 질 높은 실습교육의 제공 등의 방안 마련이 필요하겠다.
본 연구에서는 MODIS 인공위성으로 분석된 에어러솔 광학두께 자료와 지상에서 관측된 시정거리 자료를 이용하여 에어러솔 연직분포 모델링을 수행하였다. 위성과 지상관측자료로부터 에어러솔의 척도 고도를 구할 수 있었으며, 그 결과는 복사전달 모델에서 사용되고 있는 표준대기 모델과 비교에서 만족할 만한 수준의 근사치를 보였다. 그리고 실제 사례로서 대기가 청명한 경우(${\tau}_{MODIS}=0.12{\pm}0.07$, 시정거리=$21.13{\pm}3.31km$)와 혼탁한 경우(${\tau}_{MODIS}=1.71{\pm}0.85$, 시정거리 =$13.33{\pm}5.66km$)에 대해서 적용하여 척도 고도를 산정한 결과는 각각 전국 평균값으로서 $0.63{\pm}0.33km$와 $1.71{\pm}0.84km$로 나타났다. 그리고 이 결과를 바탕으로 대기 에어러솔 소산계수의 연직분포를 구할 수 있었으며, 최종적으로 KML 형식으로 코딩되어 관심 영역의 대기 환경 특성 변화를 감시하는데 도움이 될 것으로 기대된다.
본 논문에서는 감염된 IP로부터 악성 공격을 감지하고 예방하기 위한 안전하고 효율적인 온칩버스를 기술한다. 대부분의 상호-연결 시스템(온칩버스)은 모든 데이터와 제어 신호가 밀접하게 연결되어있기 때문에 하드웨어 말웨어 공격에 취약하다. 본 논문에서 제안하는 보안 버스는 개선된 아비터, 어드레스 디코딩, 마스터와 슬레이브 인터페이스로 구성되며, AHB (Advanced High-performance Bus)와 APB(Advance Peripheral Bus)를 이용하여 설계되었다. 또한, 보안 버스는 매 전송마다 아비터가 마스터의 점유율을 확인하고 감염된 마스터와 슬레이브를 관리하는 알고리즘으로 구현하였다. 제안하는 하드웨어는 Xilinx ISE 14.7을 사용하여 설계하였으며, Virtex4 XC4VLX80 FPGA 디바이스가 장착된 HBE-SoC-IPD 테스트 보드를 사용하여 검증하였다. TSMC $0.13{\mu}m$ CMOS 표준 셀 라이브러리로 합성한 결과 약 39K개의 게이트로 구현되었으며 최대 동작주파수는 313MHz이다.
본 논문에서는 감염된 IP로부터 악성 공격을 감지하고 예방하기 위한 안전하고 효율적인 온칩버스를 기술한다. 대부분의 상호-연결 시스템(온칩버스)은 모든 데이터와 제어 신호가 밀접하게 연결되어있기 때문에 하드웨어 말웨어 공격에 취약하다. 본 논문에서 제안하는 보안 버스는 개선된 아비터, 어드레스 디코딩, 마스터와 슬레이브 인터페이스로 구성되며, AHB(Advanced High-performance Bus)와 APB(Advance Peripheral Bus)를 이용하여 설계되었다. 또한, 보안 버스는 매 전송마다 아비터가 마스터의 점유율을 확인하고 감염된 마스터와 슬레이브를 관리하는 알고리즘으로 구현하였다. 제안하는 하드웨어는 Xilinx ISE 14.7을 사용하여 설계하였으며, Virtex4 XC4VLX80 FPGA 디바이스가 장착된 HBE-SoC-IPD 테스트 보드를 사용하여 검증하였다. TSMC 0.13um CMOS 표준 셀 라이브러리로 합성한 결과 약 26.2K개의 게이트로 구현되었으며 최대 동작주파수는 250MHz이다.
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[게시일 2004년 10월 1일]
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