• 제목/요약/키워드: 최대시간지연

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도선의 전송지연을 최소화하기 위한 데이터 초기화에 기반한 단일선 4-위상 프로토콜 (Four-Phase Single-Rail Protocol with Return-to-Zero Data to Reduce Delay in Long Wire)

  • 정은구;이동익;노명찬
    • 한국정보과학회:학술대회논문집
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    • 한국정보과학회 2001년도 가을 학술발표논문집 Vol.28 No.2 (3)
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    • pp.1-3
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    • 2001
  • VLSI칩 내부애서 길이가 긴 도선을 통해서 데이터를 보낼 메, 누화(crosstalk)의 영향으로 데이터 값에 따라 지연시간이 변한다. 그리고 지연시간의 변화폭도 CMOS공정이 초미세화됨에 따라서 더욱 커진다. 본 논문에서는 지연시간을 줄이기 위해서, 데이터 코딩을 이용하여 가장 긴 지연시간을 피하는 데이터 초기화에 기반한 단일선 4-위상 프로토롤을 제안한다. 제안된 프로토콜을 긴 도선에 적용함으로써 도선에서의 최대 지연시간을 최대 49% 감소시킨다.

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지연시간과 회로 구조 변화를 고려한 증가적 타이밍 분석 (Incremental Techniques for Timing Analysis Considering Timing and Circuit Structure Changes)

  • 오장욱;한창호
    • 한국정보처리학회논문지
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    • 제6권8호
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    • pp.2204-2212
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    • 1999
  • 본 논문에서는 허위 경로 문제를 해결하고 지연 시간 정보를 추출해내는 지연 시간 부울법을 이용하여 조합 회로에서 증가적 지연 시간 검사를 수행할 수 있는 방법을 제시한다. 내부 출력단에서 대치되는 내부 입력단의 히스토리를 작성하고 외부 출력단의 활성화 경로를 검사하여 최대 지연 시간을 구한다. 이때 외부 출력단의 히스토리를 참조하여 변형된 지연 시간을 적용시켜 다시 외부 출력단의 최대 지연 시간을 구할 수 있다. 이 방법으로 일단 외부 출력단의 근지연항의 합을 구하면 내부 회로의 지연 시간이 변하더라도 이미 구해 놓은 외부 출력단의 근지연항의 합으로써 빠르고 효율적으로 최대 지연 시간과 입력값을 추출해 낼 수 있다. 회로의 구조가 변경되었을 때 전체 회로를 다시 계산해야 할 필요는 없다. 전체 회로를 검사하여 변경된 구조의 영향을 받아서 다시 계산해야 할 필요가 있는 게이트를 선택하고 이 선택된 게이트만을 계산하여 부분적인 지연 시간 분석을 행할 수 있다. 이러한 증가적 지연 시간 분석은 회로의 지연 시간의 변화 뿐만 아니라 회로 구조의 변화를 고려하였고, 기존의 지연 시간 분석에 비해 회로 설계시 성능 시험 단계에서 생기는 시행 착오의 비용을 줄일 수 있다.

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무선 ATM망에서 최대 지연 시간을 이용한 VBR 서비스 방안 (VBR Services Scheme Using Maximum Cell Transfer Delay in the Wireless ATM Networks)

  • 양성룡;임인택;허정석
    • 한국정보통신학회:학술대회논문집
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    • 한국해양정보통신학회 2001년도 추계종합학술대회
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    • pp.74-78
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    • 2001
  • 무선 ATM망에서 VBR 서비스는 매 순간마다 대역폭 요구 사항이 가변적이기 때문에 채널의 효율적 분배가 어려운 실정이다. 본 논문에서는 무선 ATM망에서 VBR 트래픽을 서비스하기 위하여 지연 시간이 부족한 패킷들에게 우선순위를 부여하는 슬롯 할당 알고리즘을 제안한다. 제안한 방법에서 단말기는 VBR 트래픽의 변화정보를 미니 셀에 피기백하고, 이를 예약방식으로 기지국에 전송한다. 한편 기지국에서는 각 단말기가 전송한 트래픽의 변화정보를 기반으로 슬롯을 할당한다. 슬롯 할당에 있어서 기지국은 전송을 요구한 패킷들의 최대 전송지연 허용 시간과 요청한 슬롯 수를 확인한 후, 요구한 슬롯을 다음 프레임에 즉시 할당하지 않고, 최대 전송지연 허용 시간 범위 내에서 전송지연 시간이 적은 패킷에 우선적으로 슬롯을 할당한다.

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WAVE 시스템에서 타이밍 동기 추적 알고리듬 (Timing synchronization tracking algorithm in WAVE system)

  • 김용성;서창우;홍대기
    • 한국정보통신학회:학술대회논문집
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    • 한국해양정보통신학회 2008년도 추계종합학술대회 B
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    • pp.689-692
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    • 2008
  • 차량간 무선 통신을 목적으로 만들어진 OFDM(OFDM : Orthogonal Frequency Division Multiplexing)기반의 WAVE(Wireless Access for the Vehicular Environment) 시스템은 초기 동기 이후 다중경로 페이딩(Multipath Fading) 채널의 영향으로 인하여 연속적인 시간지연이 발생함에 따라 시스템 성능이 감소하게 된다. 본 논문은 추가적인 심볼 시간지연을 보상해 주기 위한 심볼 시간동기 추적(Tracking)알고리듬을 제안하고 있다. 제안된 알고리듬을 최대 지연 시간(Maximum timing delay)이 적용된 최악의 통신환경에 적용하여 모의실험을 수행하였다. 실험 결과, 제안된 알고리듬이 AWGN 채널 및 페이딩(fading)채널 환경에서 시스템의 성능을 향상시킬 수 있음을 확인하였다.

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원격제어실험을 위한 실선 데이터 수집결과분석

  • 예병덕;정우리
    • 한국항해항만학회:학술대회논문집
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    • 한국항해항만학회 2022년도 추계학술대회
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    • pp.78-79
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    • 2022
  • 육상제어센터의 원격제어시스템은 원격모니터링시스템, 원격제어시스템, 메시지 교환장치 및 선박모사장치로 구성되었다. 본 연구에서는 육상제어센터의 원격제어시스템 실험을 위해 실습선 한나라호와 육상제어센터 간 통신망(VSAT, LTE)를 활용하여 1) 장비테스트, 2) 시나리오 기반 테스트를 실시하였다. 먼저, 장비테스트는 정박 및 항해중 필수장비(Rudder, Engine, Thruster)에 대해 이루어졌으며, 시나리오 기반 테스트는 항해중 안전수역내에서 제어실험이 이루어졌다. 장비테스트 결과는 선박-육상 간 지연시간은 0.1초이내이며, 시나리오 기반 테스트 결과는 선박에서 육상제어센터까지 평균지연시간은 0.87초이며 최대 9.88분, 육상제어센터에서 선박까지 평균지연시간은 1.14초이며, 최대 8.9분이다. 이와 같이, 선박과 육상간 송수신된 데이터 분석을 통해 선박과 육상 간의 원격제어 및 통신네트워크의 문제점 식별하고, 이에 대한 대안방안 등을 제시하고자 한다.

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최대 지연지터의 허용이 서비스 품질에 미치는 영향에 대한 분석 (An Analysis of Service Quality affected by Allowing Maximum Delay Jitter)

  • 이근왕
    • 한국정보과학회논문지:정보통신
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    • 제27권2호
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    • pp.123-130
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    • 2000
  • 멀티미디어 동기화의 주요 관심은 미디어내 동기화에서의 지터와 미디어간 동기화에서의 스큐를 어떻게 해결하는 것인가이다. 멀티미디어 응용 소프트웨어를 효과적으로 개발하기 위해서 시간적 미디어와 공간적 미디어를 혼합하여 표현할 수 있는 멀티미디어 동기화 모델을 제안한다. 제안한 논문은 미디어간 동기화에 대한 QoS 처리를 위하여 네가지 파라미터를 이용하였고, 상대적인 지속시간 알고리즘과 지터 보상시간 알고리즘을 제시하였다. 그리고 키 매체가 손상이 되었을 때 키 매체의 최대 지연 지터 값만큼 기다림으로써 키 매체 이외의 매체에 최대 지연 지터 값만큼 추가적으로 재생할 수 있도록 하였다. 최대 지연 지터 값의 적용은 서비스 품질을 향상시키는 결과를 가져왔다.

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시간 지연이 있는 시스템에서의 PID 제어기 설계를 위한 루프 형성 기법 (A Loop Shaping Method of PID Controller for Time delay Systems)

  • 윤성오;서병설
    • 한국통신학회논문지
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    • 제29권10C호
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    • pp.1370-1377
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    • 2004
  • 시간 지연이 있는 시스템에서의 최적 제어 이득은 시간 지연이 없는 시스템에서 설계된 최적 제어 이득과 지연 시간에 대하여 계산된 상태천이 함수의 곱의 형태로 나타난다. 따라서 시간 지연이 없는 시스템에 대하여 PID제어기의 영점들을 플랜트의 최대 극점에 근접하도록 가중치 요소 Q와 R을 선택하여 최적 제어 이득을 구하고, 시간 지연이 있는 2차 시스템에서의 상태천이 함수를 계산하여 시간 지연이 있는 시스템에서의 강인한 최적 PID 제어기 설계가 가능하도록 하였다.

HAS-160 해쉬 프로세서의 VLSI 설계 (VLSI Design of HAS-160 Algorithm)

  • 현주대;최병윤
    • 한국멀티미디어학회:학술대회논문집
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    • 한국멀티미디어학회 2002년도 춘계학술발표논문집(상)
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    • pp.44-48
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    • 2002
  • 본 논문에서는 한국형 디지털 서명 표준인 KCDSA에서 사용할 목적으로 개발된 국내 해쉬 함수 표준인 HAS-160 알고리즘을 VLSI 설계하였다. 하나의 단계연산을 하나의 클럭에 동작하고 단계연산의 핵심이 되는 4개의 직렬 2/sup 3/ 모듈러 가산기를 CSA(Carry Save Adder)로 구현하여 캐리 전파시간을 최소로 하고 HAS-160 해쉬 알고리즘의 특징인 메시지 추가생성을 사전에 계산하여 지연시간을 줄이는 설계를 하였다. 설계된 해쉬 프로세서를 0.25 urn CMOS 스탠다드 셀 라이브러리에서 합성한 결과 총 게이트 수는 약 21,000개이고 최대 지연 시간은 5.71 ns로 최대 동작주파수 약 175 MHz서 약 1,093 Mbps의 성능을 얻을 수 있었다.

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순차회로를 위한 효율적인 FPGA 매핑 (Performance Driven FPGA Mapping of Sequential Circuits)

  • 이준용
    • 한국정보과학회:학술대회논문집
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    • 한국정보과학회 1998년도 가을 학술발표논문집 Vol.25 No.2 (2)
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    • pp.668-670
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    • 1998
  • 테크놀로지 매핑의 효율성은 매핑된 회로의 지연시간과 회로의 면적에 의해서 평가되어진다. 특히 순차회로에서는 레지스터 사이의 조합회로의 최대지연시간에 의해서 전체회로의 지연시간이 결정된다. 본 논문에서는 순차회로에 대한, 건설적인(Constructive) 단계와 반복적인(Iterative) 단계의 리타이밍 기술과 퍼지 논리에 의해 향상된 FPGA 매핑 알고리즘을 소개한다. 주어진 초기회로는 건설적인 방법에 의하여 FPGA회로로 초기매핑되어진후 반복적인 리타이밍에 의하여 매핑회로의 효율을 높이게된다. 초기회로에 주어진 여러 가지 기준들은 결정 함수(Decision Making)에 대한 퍼지 이론 법칙의 계층적인 구조에 의해 연결되어져 있다. 제안된 매퍼는 MCNC 밴치마커의 실험을 통해 지연시각과 면적에서 기존 매핑시스템의 성능을 능가함을 보여준다.

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예측제어기를 이용한 Pop-Up 시스템의 설계 (Design of Pop-Up System Using Predictive Controller)

  • 허화라
    • 한국산학기술학회:학술대회논문집
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    • 한국산학기술학회 2001년도 춘계학술대회 발표논문집
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    • pp.119-123
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    • 2001
  • 본 논문에서는 자동화 사격장 Pop-Up시스템의 안정성 및 성능 향상을 위해 예측제어기를 설계하여 시간지연에 따른 문제를 보상하였다. 확률 모델에 기반한 예측제어기는 지연된 이전의 값들로부터 선형예측 기법과 확률함수를 이용하여 실제의 값을 추정하며, 이를 제어기에 적용하여 시간지연에 따른 문제점을 최소화하였다. 제안된 알고리즘의 타당성을 검정하기 위해 사격용 Pop-Up시스템에 본 알고리즘을 실현하였으며, 상이한 시간지연과 이득 변화에 따른 제어기의 성능을 관측하였다. 실험결과 제안된 예측제어기는 시간지연에 대해 PID 제어기보다 빠른 수렴 특성을 보이며, 제어기의 안정범위 내에서 허용할 수 있는 최대 시간지연 값도 증가시킬 수 있었다. 따라서 사격용 타겟의 Pop & Up동작이 제어시간 이내에 원활하게 작동되어 연속 사격의 실시간 제어를 효율적으로 수행하였다.