• 제목/요약/키워드: 정상위상

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채널 간 위상차 파라미터 생략 기법을 이용한 오디오 부호화 (An Audio Coding Technique Employing the Inter-channel Phase Difference Skip)

  • 김현휘;김인철
    • 한국방송∙미디어공학회:학술대회논문집
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    • 한국방송공학회 2015년도 하계학술대회
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    • pp.3-4
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    • 2015
  • 본 논문에서는 공간 오디오 부호화 기법인 MPEG 서라운드에서 공간 파라미터 전송 시 위상 파라미터를 생략하는 기법에 대해 다룬다. 기존 방법에서는 한 프레임이 모두 적은 위상차를 가지는 경우에도 정상적으로 처리하여 전송한다. 이러한 경우 위상차 파라미터를 생략하여 비트 효율을 향상시킬 수 있다. 스테레오 복원 과정에서 발생하는 채널 간 시간차에 기반해 설계된 양자화기를 생략 기법에 적용하면 기존에 비해 평균적으로 40 ~ 50% 정도의 위상 파라미터 절감 효과를 얻을 수 있다.

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고순도 스펙트럼과 초고속 스위칭 속도의 PLL 주파수 합성기 설계 (Design of PLL Frequency Synthesizer with High Spectral Purity and Ultra-Fast Switching Speed)

  • 이현석;손종원;안병록;유흥균
    • 한국통신학회논문지
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    • 제26권10B호
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    • pp.1464-1469
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    • 2001
  • 본 논문에서는 디지털 하이브리드 위상고정루프(Digital Hybrid Phase-Locked Loop, DHPLL) 주파수 합성기 구조에서 고 순도 스펙트럼과 초고속 스위칭 속도를 위한 설계기술을 제안한다. D/A 변환기 출력으로 전압제어발진기(Voltage Controlled Oscillator, VCO)를 구동하는 개 루프(open-loop) 구성 방식과 기존 위상고정루프(Phase Locked Loop, PLL)의 폐 루프(closed-loop) 구성 방식을 혼합한 하이브리드 구조의 주파수 합성기를 고려하여, 시스템 변수(개 루프 대역과 위상 여유)와 성능 파라미터(정착시간, 위상 잡음, 그리고 최대 오버슈트(Max. overshoot)의 관계를 연구하였다. 그리고 이 관계를 통해 스펙트럼 순도와 스위칭 속도를 향상시키기 위한 최적의 3가지 설계방안을 제시한다. 컴퓨터 시뮬레이션 결과, 주파수 스위칭 과정에서 발생하는 최대 오버슈트가 0.0991%이고 완전 정상상태 도달시간은 0.288msec이다. offset 주파수 10KHz에서 위상 잡음은 -128.15dBc이다.

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위상동기회로(PLL)를 이용한 하이브리드 방식의 계통적용 한류기에 관한 연구 (A study of Hybrid Fault Current Limiter Connected to Power Grid by Using Phase Locked Loop)

  • 성병철;박정욱
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 2008년도 제39회 하계학술대회
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    • pp.476-477
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    • 2008
  • 초전도 소자만을 이용한 한류기는 여러 가지 해결해야할 비용적, 기술적 문제를 안고 있다. 이런 문제들에 대한 해결과 동시에 초전도 한류기의 실용화를 위해 하이브리드 방식의 한류기가 고안되었으며 이는 초전도 소자만을 이용한 한류기가 갖고 있는 많은 문제점들을 해결할 수 있다고 판단되는 한류 방식이다. 본 논문은 기존의 하이브리드 방식의 한류기를 바탕으로 하여 Phase Locked Loop(PLL, 위상동기회로)를 이용한 하이브리드 방식의 초전도 한류기를 제시하였다. 일정한 선로 임피던스를 갖는 계통에서 사고가 발생할 경우 고장전류와 정상 상태의 전류 사이에 위상차가 발생하게 되는데, 이 위상차를 PLL의 위상 검출 능력을 통해 검출함으로써 한류기로서 동작할 수 있도록 하였다. 제시된 하이브리드 한류기의 성능은 PSCAD/EMTDC를 이용한 시뮬레이션을 통해 일기무한모선 시스템에 대한 적용을 통해 평가하였다.

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동기식 선형망에서의 망동기 클럭특성 분석에 관한 연구 (A study on the analysis of the characteristics of synchronization clock in the SDH based linear network)

  • 이창기;홍재근
    • 한국통신학회논문지
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    • 제22권9호
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    • pp.2062-2073
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    • 1997
  • 동기식 전송망과 장치를 설계할 때 고려해야 할 중요사항은 최대 노드수와 노드의 클럭특성이다. 이를 위해서는 클럭상태가 정상상태일 때 뿐 아니라 단기위상순서변위, 그리고 장기위상변위 등에 관한 클럭특성 연구가 필요하다. 따라서 본 논문에서는 국내 동기클럭 분배망의 구성을 바탕으로 최근 확정된 ITU-T 및 ANSI의 클럭규격을 적용하여 동기식 선형망에서 정상상태와 위상변위상태일 때의 망구성에 따른 MTIE 및 TDEV 특성을 살펴보았고, ITU-T와 ANSI규격을 동시에 만족하는 최대 노드수를 제시하였다. 또한 본 논문에서 얻은 결과를 AT&T의 것과 비교 분석하였다.

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불평형 전원조건하의 재귀형 최소자승법을 이용한 향상된 SRF-PLL (Improved SRF-PLL using Recursive Least square Method under Unbalanced Grid Condition)

  • 문석환;김지원;박병건;김종무;이기창;하현욱;이정욱;박병우
    • 전력전자학회:학술대회논문집
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    • 전력전자학회 2014년도 전력전자학술대회 논문집
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    • pp.219-220
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    • 2014
  • 기존의 SRF-PLL방법은 구현이 간단하고 정상전원에서 위상각 추정 성능이 우수하지만 불평형 전원하에서 위상각 추정 성능이 저하된다. 본논문에서는 상간전압의 위상변화, 상전압의 크기변동 및 오프셋이 발생된 불평형 전원하에서 변동된 값들을 실시간으로 보상하여 위상각을 검출하는 재귀형 최소 자승법을 이용한 SRF-PLL방법을 제안한다.

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단상 계통연계형 전력변환 시스템에서 시스템 모델링을 이용한 PLL 성능개선 (Improvement of PLL-Performance for a Single-Phase Grid-Connected Power Conversion System using a System Modeling)

  • 김선민;고영종;이교범
    • 전력전자학회:학술대회논문집
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    • 전력전자학회 2010년도 추계학술대회
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    • pp.286-287
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    • 2010
  • 계통연계 인버터 제어 시 계통 전압과 동상인 전류를 공급해 주기 위해 반드시 계통 전압의 위상 정보가 필요하다. 기존의 PLL 방법은 계통 전압에 고조파가 존재하지 않을 시에 검출된 위상 값은 정확하지만, 고조파 존재 시 정확한 위상 값을 얻을수 없다. 본 논문에서는 전차원 상태 관측기를 이용하여 기본파 성분과 고조파 성분을 분리하여 검출된 위상의 정상상태 오차를 감소시킬 수 있고, 저역통과필터를 고려한 PLL 시스템의 모델링을 이용하여 동특성을 개선하는 방법을 제안하였다. 이를 모의실험을 통하여 검증하였다.

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비정상인 모드에서 발생되는 포인터조정지터의 컴퓨터 시뮬레이션에 의한 분석 (Analysis of Pointer Adjustment Jitter Generated in Degraded Mode with Computer Simulation)

  • 최승국
    • 한국정보처리학회논문지
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    • 제2권4호
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    • pp.561-566
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    • 1995
  • 동기식통신망에 장애가 발생하여 각 노드내의 클럭들이 서로 다른 주파수로 동작 되는 비정상적인 모드에서는 클럭간의 위상차가 급격하게 변화한다.야 그러므로 데이 터가 노드를 통하여 전송될 때 노드클럭간의 이러한 위상시간차를 보정하여 주기 위하 여 각 노드에서 포인터조정이 빈번하게 행하여지며 이 과정에서 비교적 높은 주파수의 지터가 발생한다. 포인터조정이 여러번 연속적으로 행하여지면 발생되는 지터는 축적 되어 그 크기가 점점 더 증가한다. 연속적으로 연결된 포인터조정시스템에서 발생되는 지터를 컴퓨터 시뮬레이션을 이용하여 분석하였으며 하드웨어 시뮬레이터에서 측정된 결과와 비교하였다.

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계통전압 불평형 및 왜곡 상태시 개선된 하이브리드 PLL (Improved Hybrid PLL under Unbalanced and Distorted Grid Conditions)

  • 김인호;김흥근;차헌녕;전태원;노의철
    • 전력전자학회:학술대회논문집
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    • 전력전자학회 2013년도 전력전자학술대회 논문집
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    • pp.226-227
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    • 2013
  • 본 논문에서는 기존의 하이브리드 PLL(Phase Locked Loop) 방법에서 개선된 PLL 방법을 제시한다. 기존의 하이브리드 PLL 방법은 정상분을 동기 좌표계에서 추출하여 다시 정지 좌표계로 변환 후 제어루프를 거쳐 위상을 검출 하는 방법이다. 이를 개선하여 정지 좌표계에서 정상분을 추출하여 제어루프를 거쳐 위상을 검출 하여 기존의 하이브리드 PLL 방법에서 보다 연산 및 제어가 간소해지는 장점이 있다. 제안된 방법을 시물레이션(MATLAB Simulink)을 통해 검증하였다.

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다상 BLDC 모터 드라이브 시스템의 개방 고장 시 토크 리플 저감 방법 (Torque Ripple Reduction Method of Multi-phase BLDC Motor Drive Systems under Open Fault Conditions)

  • 박현철;서용석
    • 전력전자학회:학술대회논문집
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    • 전력전자학회 2020년도 전력전자학술대회
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    • pp.52-54
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    • 2020
  • 다상 BLDC 모니터는 높은 효율, 단위 전류당 높은 토크 밀도 및 비교적 쉬운 제어 특성으로 인해 동일 크기, 동일 무게에서 더 높은 출력을 요구하는 대형 트랙션 또는 선박 추진 응용 분야에서 점점 더 많이 사용되고 있다. 선박 등의 대용량 추진 시스템은 안정적인 운전 성능을 위해 모터의 일부 상 고장의 경우에도 시스템의 안정적인 동작이 중요한 이슈가 되고 있다. 본 논문에서는 모터의 한 상에서 고장이 발생한 경우 BLDC 모터의 정상인 상 전류의 위상각을 제어하여 토크 리플을 저감하는 제어 방법을 제안한다. 제안된 방법은 토크 리플에 큰 영향을 미치는 출력 토크의 2차 고조파 성분의 합이 영이 되도록 정상인 상 전류의 위상각을 제어하여 가능한 범위 내에서 최대 출력 토크를 얻음과 동시에 토크 리플 성분을 최소화한다. 본 논문에서 제안한 방법은 12상 BLDC 모터의 HILs 시뮬레이션을 통해 검증하였다.

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고정 위상 동작 인버터를 포함하는 위상천이 풀 브리지 DC/DC 컨버터 (Phase-Shift Full-Bridge DC/DC Converter with Fixed-Phase Operation Inverter)

  • 김진호;박재성;김홍권;박준우;신용생;지상근;조상호;노정욱;홍성수
    • 전력전자학회:학술대회논문집
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    • 전력전자학회 2012년도 전력전자학술대회 논문집
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    • pp.335-336
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    • 2012
  • 본 논문에서는 출력 인덕터 전류의 리플을 저감할 수 있는 새로운 방식의 위상천이 풀 브리지 컨버터를 제안한다. 제안된 회로는 2개의 풀 브리지 인버터가 연결된 구조로 되어 있으며 하나의 풀 브리지 인버터가 고정 위상($0^{\circ}$)으로 동작할 때, 다른 풀 브리지 인버터의 위상을 조절하여 출력 전압을 제어하는 방식이다. 정상 동작 시, 제안회로는 기존 위상천이 풀 브리지 컨버터에 비해 출력 인덕터 전류 리플이 매우 작고, 2차 측 정류기의 공진 전압도 작아져 출력 LC 필터의 소형화 및 고효율화가 가능하여 대전류 사양에 매우 적합한 장점을 갖는다. 본 논문에서는 제안된 회로의 이론적인 특성을 분석하고, 450W 전원장치를 시작품으로 제작하여 그 우수성을 확인하였다.

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