TOA(Time of Arrival) 및 TDOA(Time Difference of Arrival)경우 무선국의 시간동기화를 위해서 고도의 기술을 요구하고 있으며, 시간동기오차에 따른 위치검지의 정밀도가 낮아지는 문제가 있어 이를 극복하기 위하여 위상차를 이용한 새로운 열차검지기법의 제안에 따른 구현을 위하여 무선장치 설계에 대하여 기술하고자 한다. 본 시스템은 전파의 전달 속도($\lambda$)를 응용하여 기준 주파수인 1.5MHz를 송신 시스템과 수신 시스템의 기준 주파수와 비교하여 그 위상의 차이를 비교하여 지연된 시간을 구한 후 이를 거리로 환산하는 시스템으로서 무선장치와 S/W로 구분하여 구현 설계하였다.
고속철도차량의 국내기술확보를 위해 최고운행속도 350km/h의 한국형 고속전철시스템을 개발하여 단품시험, 완성차시험, 공장시험 등을 통해 기본적인 성능을 확인한 후 현재는 본선시운전 시험이 진행중이다. 본 논문에서는 국내기술로 개발된 한국형 고속열차의 슬립검지를 위한 계측시스템 구성과 검지 내용에 대해 서술하고 있다.
Smart열차진로제어시스템은 실시간 열차속도와 열차위치정보를 토대로 진로제어구간을 진입 또는 진출하는 해당 열차의 진로를 제어한다. 현재 운용중인 열차진로제어알고리즘은 궤도회로를 이용해서 검지한 열차점유정보를 사용하고 있으므로, 새로운 개념의 알고리즘개발이 필요하다. 이를 위해서 다양한 형식의 열차가 감속성능을 구현할 수 있는 전동기와 구동장치를 사용하는 모의장치의 개발을 완료하였다. 모의장치는 무선통신기반의 간선철도용 열차진로제어시스템개발을 목적으로 하고 있으나, 알고리즘개발의 효율성과 편리성을 갖추기 위해서 ATS(Automatic Train Supervision), ATC(Automatic Train Control) 및 ATO(Automatic Train Operation) 등의 기능을 구현할 수 있도록 모의장치를 개발하였다. 본 논문에서는 모의장치 구성, 모의장치의 하부장치별 기능 및 각 하부장치에 설치되어 있는 프로그램구성을 다루고 있다.
TOA(Time of Arrival) 및 TDOA(Time Difference of Arrival)경우 무선국의 시간동기화를 위해서 고도의 기술을 요구하고 있으며, 시간동기오차에 따른 위치검지의 정밀도가 낮아지는 문제가 있어 이를 극복하기 위하여 위상차(PDOA)를 이용한 새로운 열차검지기법의 제안에 따른 구현을 위하여 H/W의 설계에 대하여 기술하고자 한다 본 시스템은 전과의 전달 속도($\lambda$)를 응용하여 기준 주파수인 1.5MHz를 송신 시스템과 수신 시스템의 기준 주파수와 비교하여 그 위상의 차이를 비교하여 지연된 시간을 구한 후 이를 거리로 환산하는 시스템으로서 H/W와 S/W로 구분하여 구현 $\cdot$ 설계되는데 본 논문에서는 H/W설계에 대하여 기숙하였다.
역사에 스크린도어의 설치가 보편화 되면서 도시철도에서 열차가 정차지점에 정확히정차하도록 하는 기술의 중요성이 더욱 커지게 되었다. 이를 위한 기술로써 이론적으로는 여러 가지 제어 방안이 제안되었으나 실제 구현 상의 어려움으로 인하여 국내 열차에서는 대부분 PID 제어와 같은 고전 제어기법을 사용한다. PID 제어는 비교적 간단하게 정확한 제어를 수행할 수 있다는 장점이 있다. 그러나 열차 시스템에서는 제어 주기가 비교적 길고 제동기의 지연 시간이 있으며 위치 및 속도 검지 과정에서의 오차 등으로 인하여 PID 제어로는 만족할 만한 결과를 얻지못하는 경우가 있으며 또한 적절한 계수를 찾는데 많은 시간이 필요하다. 본 논문에서는 상태나 신호 추정에 사용되는 칼만 필터를 활용하여 제어를 수행하는 방안을 제안한다. 칼만 필터를 통해 제동기가 동작할 시점의 상태를 예측하고 이에 맞는 제동 입력을 구하여 제어를 수행한다. 제동기 특성 및 제어 주기를 반영하여 열차 모델링과 정위치 정차제어 시뮬레이션을 수행하였으며 정차 오차 분석을 통해 제안하는 방안의 우수성을 보인다.
경부고속선에서 사용하는 열차제어시스템은 ATC, IXL, CTC로 분류되며, 열차 속도 제어 및 간격 제어에 관련된 ATC 정보는 UM71 AF 궤도회로와 BSP Loop를 통해 지상에서 차상으로 전송된다. 궤도회로를 통해 전송되는 정보는 주로 열차 운행에 직접적인 영향을 주는 운영 정보로 구성된다. 특히 BSP Loop를 통해 전송되는 정보는 터널, 차축온도 검지장치, 또는 절연구간과 같이 특수한 선로변 환경에 대해 추가적인 정보 전송을 필요로 하는 구간에서 사용된다. 본 논문에서는 경부고속선 개통 이후부터 현재까지 기존선과 고속선 연결 구간에서 주로 사용되는 UM71 AF 궤도회로의 BA형 동조 유니트 특성을 기준값과 측정값을 비교하여 분석하였다. 이러한 분석을 통해 BA형 동조 유니트가 설치된 구간의 궤도회로 장애와 같은 문제 발생시 원인규명 및 유지보수를 보다 쉽게 이룰 수 있을 것이다.
Traffic accidents at highway-rail crossing result in larger social and economic damages than the accidents at the typical highway intersections. The traditional control and warning systems of the highway-rail crossing have limitations in that 1) they do not recognize the differences of the trains' arrival times because they rely on the distance-based control system, rather than the time-based one, and 2) thereby they usually cause longer delays of vehicles and pedestrians at the highway-rail crossings. The objective of this study is to develop a time-based railroad crossing control system which takes into account the speed and expected arrival time of trains. using the spot speeds and acceleration rates of trains measured at three points, the developed system was found to be able to accurately estimate the arrival time of train. VISSIM simulation package was utilized to compare system effect of the developed time-based railroad crossing control system with that of the conventional distance-based one. It was found that the developed time-based railroad crossing control system reduced the average travel time, maximum delay length, average delay time, and average number of stop-experienced vehicles as much as 7.0$\%$, 75.6$\%$, 12.7$\%$, and 60.0$\%$, respectively, compared with those from the conventional distance-based one.
고속으로 주행하는 열차의 정확한 위치를 차상에서 검지하기 위해서는 지상에 설치된 트랜스폰더 태그로부터 위치정보를 정확하고 신속하게 수신하는 것이 필수적이다. 본 논문에서는 고속용으로 개발중인 트랜스폰더시스템의 텔레그램 적용을 위해 텔레그램 복호화(decoding) 속도를 개선하기 위한 병렬 디스크램블링 기법을 제안하였다. 텔레그램은 유저 데이터를 스크램블링(scrambling)하는 부호화(encoding) 과정을 거쳐 트랜스폰더 태그에 저장되므로, 트랜스폰더 리더가 유저 데이터를 복호화(decoding)하는 과정에서 디스크램블링(descrambling)이 필수적이다. 본 논문에서는 디스크램블링 시프트 레지스터 회로 구조 분석을 통해 텔레그램의 병렬 디스크램블링 기법을 제안하고, 제안된 기법을 사용할 경우 기존 방식에 비해 필요 클락 수를 현저히 낮출 수 있음을 보였다.
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[게시일 2004년 10월 1일]
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