Kim, Sang-Kyung;Hyun, Min-Soo;Lee, Byung-Rok;Jung, Doo-Hwan;Peck, Dong-Hyun;Lim, Seong-Yop
Korean Chemical Engineering Research
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v.49
no.6
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pp.775-780
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2011
5-cell DMFC stack was fabricated and operated with the load of 4 A for 4000 hrs. After 4000 hrs operation peak power density of the stack reduced by 27.3%. Two of the five cells did now show performance degradation, the performance of other two was reduced by 40% and the performance of the other decreased by 60%. The amount of performance degradation of each cell by long-term operation did not correlate with the position in the stack. Platinum particle size in the anode catalyst layer of the MEA with the strongest degradation increased and the increase was severer on the position of methanol inlet than on the position of methanol outlet. However, platinum particle size in the cathode catalyst layers did not changed for all the MEA'. Ruthenium crossover from the anode catalyst layer to the cathode catalyst layer through the membrane was observed after 4,000 hrs operation by SEM-EDX and it occurred for all MEA' regardless of the degree of performance degradation. Atomic ratio of ruthenium to platinum in the cathode catalyst layer was the highest in the MEA with the strongest performance degradation.
Ray-object intersection is an important element in ray tracing that takes up a substantial amount of computing time. In general, such spatial data structure as kd-tree has been frequently used for static scenes to accelerate the intersection computation. Recently, a few variants of kd-tree traversal have been proposed suitable for the GPU that has a relatively restricted computing architecture compared to the CPU. In this article, we propose yet another two implementation techniques that can improve those previous ones. First, we present a cached stack method that is aimed to reduce the costly global memory access time needed when the stack is allocated to global memory. Secondly, we present a rope-with-short-stack method that eases the substantial memory requirement, often necessary for the previous rope method. In order to show the effectiveness of our techniques, we compare their performances with those of the previous GPU traversal methods. The experimental results will provide prospective GPU ray tracer developers with valuable information, helping them choose a proper kd-tree traversal method.
정부는 그린홈 100만호 보급 사업에서 연료전지의 보급 목표를 2010년 200대 2011년 300대, 2012년 500대로 결정하였고 이에 따라 2012년까지 누적 보급대수가 1000대에 달할 전망이다. 본 연구에서는 현재 상업화 되어있는 국내업체의 1kW급 가정용 연료전지 시스템을 2009년에 도입되는 것으로 가정하여 경제성평가를 수행하였다. 분석의 편의상 2009년 서울 지역 난방면적 $100m^2$을 기준으로 전제하였고, 대표가정의 전기와 열수요는 CES 소형 열병합 사업 타당성 분석 프로그램(GS파워, 2006)을 활용하여 구했다. 비용의 경우 기존 보일러의 설비가격은 60만원이며 연료전지시스템의 설비가격은 1200만원이다. 다만 연료전지의 고가 소모품인 스택은 2007년 발간된 한국에너지 기술연구원의 신재생에너지 경제성평가 보고서를 인용하여 스택의 수명은 5년, 교체비용은 1000만 원이나 5년마다 30%의 비용 하락을 전제하였다. 또한, 연료전지시스템의 수명을 20년으로 가정하였으며 할인율은 5.5%를 가정하였다. 한편, 가정용 연료전지의 최적 운전방안을 찾기 위해서 기존 설비를 이용한 비용과 전기추종운전, 열추종운전의 시뮬레이션을 수행한 뒤 세가지 결과를 시간대별로 비교함으로써 최적의 시간대별 운전방식을 선택하는 복합추종운전의 비용을 분석하였다. 시뮬레이션결과, 기존 설비 이용 시 에너지 비용은 1,934,864원으로 분석된 반면 연료전지를 이용한 전기추종은 1,123,691원, 열추종은 1,180,425원, 복합추종은 1,121,174원으로 계산되었다. 한편 편익면에서는 복합추종운전시 813,690원의 편익이 발생하는 것으로 분석되었으며 B/C ratio의 결과는 0.405로 현재로서는 연료전지 시스템이 경제성이 없는 것으로 분석되었다. 따라서 정부는 연료전지의 보급목표와 민간 주도의 자생적인 시장형성을 촉진하기 위해서 단순 설치 보조금 이외에 연료전지시스템과 스택의 비용을 획기적으로 저감 시킬 수 있는 기술개발을 촉진하는 정책 병행이 필요해 보인다.
Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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v.9
no.1
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pp.835-838
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2005
It is widely known that most operations performed in JVM belongs to data transfers at all times as JVM is based on abstract stack machine. Hence it is necessary to analyze the fashion of internal data transfers in JVM to develop a more efficient machine. We have analyzed in this paper the data transfer operations between operand stack, local variable array, heap, and constant pool in bytecode level.
해제 후 재사용 (Use-After-Free, UAF)는 오랜 시간 동안 소프트웨어 보안에서 중요한 문제로 인식되어 왔다. 이 문제를 해결하기 위해 다양한 완화 방법과 방어 연구가 활발히 진행되고 있다. 이러한 연구들은 대부분 기존 벤치마크 성능과 비교했을 때 낮은 성능을 보인다. 이는 메타 데이터와 코드 계측 정보가 증가하여 포인터를 많이 사용하는 벤치마크의 메모리 사용량이 증가하기 때문이다. 이 연구는 SVF를 활용하여 스택에서만 메모리 할당자 호출 지점을 분석한다. 추후 이 분석 정보를 여러 UAF 연구에 적용하여 런타임 오버헤드를 줄이는 것을 목표로 한다.
Internet of Things (IoT) is considered to be the next wave of Information Technology transformation after the Internet has changed the process of doing business. Since the domain of IoT ranging from the sensor technology to service to the users is wide, the structure of the research domain is not delineated clearly. To do that we suggest to use the Technology Stack Model proposed by Porter et al.(2014) to measure the maturity level of IoT in organizations. Based on the Stack Model, for the general understandings of IoT, we do keyword analyses on the academic papers whose major research issue is IoT. It is found that the current status of IoT application from the perspectives of cloud and big data analytics is not active, meaning that the real value of IoT has not been realized. We also examine the cases which deal with the part of cloud process which is crucial for value accrual. Based on these findings, we suggest the future direction of IoT research. We also propose that IT is to value chain what IoT is to the Stack Model to derive value in organizations.
Several researchers have pointed out that the energy consumption in memory takes a dominant fraction on the energy budget of a whole embedded system. This applies to the embedded Java virtual machine tn, and to develop a more energy-efficient JVM it is absolutely necessary to optimize the energy usage in Jana memory. In this paper we have analyzed the logical memory access pattern in JVM as it executes numerous number of bytecode instructions while running a Java program. The access pattern gives us an insight how to design and select a suitable memory technology for Java memory. We present the memory access pattern for the three logical data spaces of JVM: heap, operand stack, and local variable array. The result saws that operand stack is accessed most frequently and uniformly, whereas heap used least frequently and non-uniformly among the three. Both heap and local variable array are accessed mostly in read-only fashion, but no remarkable difference is found between read and write operations for operand stack usage.
Jang Hankook;Oh Soo-Cheol;Chung Sang-Hwa;Kim Dong Kyue
Journal of KIISE:Computer Systems and Theory
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v.32
no.6
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pp.296-305
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2005
TCP/IP, the most popular communication protocol, is processed on a host CPU in traditional computer systems and this imposes enormous loads on the host CPU. Recently TCP/IP Offload Engine (TOE) technology, which processes TCP/IP on a network adapter instead of the host CPU, becomes an important way to solve the problem. In this paper we analysed the structure of a TCP/IP protocol stack in the Linux operating system and important factors, which cause a lot of loads on the host CPU, by measuring the time spent on processing each function in the protocol stack. Based on these analyses, we propose a Hybrid TOE architecture, in which functions imposing much loads on the host CPU are implemented using hardware and other functions are implemented using software.
In Jana 2, to enforce a suity policy of a program, programmer writes permission sets required by the code at the policy file, sets Security Manager on system and executes the program. Then Security Manager checks by stack inspection whether an access request to resource should be granted or denied whenever code tries to access critical resource. In this paper, we develop a visualization tool which helps programmers enforce security policy effectively into programs. This system is based on the static permission check analysis which analyzes permission checks which must succeed or fail at each method. Based on this analysis information, programmer can examine visually how permission checks and their stack inspection are performed. By modifying program or policy file if necessary and examining analysis information repeatedly, programmer can enforce security policy correctly.
본 연구에서는 소형 카트용 스택제작에 사용하기 위한 분리판에 관한 연구를 진행하였다. 분리판의 두께가 감소해야 스택의 부피를 줄이고 출력밀도를 높일 수 있기 때문에 분리판 두께 감소를 위한 채널의 깊이 최적화 실험을 진행하였다. 이를 위해 캐소드 채널 깊이에 따른 DMFC 성능의 변화를 관찰하기 위해 캐소드 채널의 깊이를 0.3mm에서부터 1.0mm로 변화시켰다. 채널깊이가 0.5mm일 때 가장 좋은 성능을 보였는데, 원인으로는 단면적 감소에 의한 선속도의 증가와 내부 압력증가를 들 수 있다. 채널깊이 변화에 따른 영향을 분석하기 위해 마노미터를 이용하여 차압을 측정하였고, 임피던스 분석법을 통해 전극의 저항을 측정하였다.
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[게시일 2004년 10월 1일]
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