• Title/Summary/Keyword: 블록 플랜

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A Floorplan Technique Based on CBL using Contour map (CBL에 기반한 Contour map을 이용한 플로플랜 기법)

  • Oh, Eun-Kyung;Hur, Sung-Woo
    • Proceedings of the Korea Information Processing Society Conference
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    • 2009.04a
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    • pp.234-237
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    • 2009
  • CBL[1](Corner Block List)에 기반한 Non-Slicing 플로 플랜 알고리즘은 빈 공간이 없는 Non-Slicing 플로플랜만 나타낼 수 있다. 본 논문에서는 CBL 단점을 보완하고 실제 블록의 크기를 이용하여 최적의 위치에 블록을 배치 하기 위해 contour map을 이용할 것을 제시한다. 본 알고리즘은 배치시 면적을 최소화 하는 방법을 제시하므로 CBL의 단점을 해결하고 더불어 최적해를 찾기 위한 실행 시간을 단축 시키는 효과를 기대할 수 있다.

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  • Gwon, Gyeong-Hui
    • Digital Contents
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    • no.9 s.136
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    • pp.38-39
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    • 2004
  • 캐릭터플랜이 3년동안 준비해 내놓은 한국형 애니메이션‘망치’가 할리우드 블록버스터를 깼다. 할리우드 블록버스터의 틈바구니 속에서 당당히 주요 개봉관을 꿰차는 성과를 거둬 주위를 놀라게 했다.‘ 망치’는 8월 개봉과 함께 가족 중심의 관람 문화를 조성하면서 상당한 성과를 거둬 국내 애니메이션의 미래를 밝게 했다. 개봉 전부터 높은 관심과 해외 수출 등 큰 호응을 얻어왔던‘망치’의 제작사 캐릭터플랜 식구들을 만나 그들의 성공비결을 취재했다.

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Improved Floorplan Algorithm using O-tree Representation (O-tree 표현법을 이용한 개선된 플로어플랜 알고리즘)

  • Park, Jae-Min;Hur, Sung-Woo
    • Proceedings of the Korean Information Science Society Conference
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    • 2007.06b
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    • pp.482-486
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    • 2007
  • 본 논문은 기존의 O-tree 표현법을 이용한 플로어플랜 알고리즘의 결점을 보완한 새로운 알고리즘을 제안한다. 기존의 방법에선 플로어플랜의 변형을 처리하는 과정에서 몇 가지 변형을 간과하기 때문에 좋은 해를 놓치는 경우가 발생한다. 본 논문에서는 기존의 방법을 수정하여 변형을 처리하는 과정에서 블록이 들어갈 수 있는 모든 위치를 고려하였다. 그 결과 MCNC 밴치마크 회로를 이용한 실험에서 총면적이 이전의 방법에 비해 평균 3% 개선되었다.

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A Study on the Design Trends of Hospital Architecture by Analyzing Block Plans of Korean Hospitals (블록플랜 분석에 의한 한국 병원건축의 설계 경향에 관한 연구)

  • Choi, Kwang-Seok
    • Journal of The Korea Institute of Healthcare Architecture
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    • v.13 no.2
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    • pp.45-52
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    • 2007
  • Hospital Architectures in Korea are continuously erected to old-fashioned design, such as a large self-sufficient, but cost-inefficient hospital, in spite of rapidly changing social and healthcare environment. However, changes are slowly coming from inside of itself. This paper analyzed block plans of 7 best Korean hospitals which constructed in recent 20 years in aspects of the purpose of erection, departmental composition, areal composition, mass design and functional zoning of block plans and then, presented the directions of new design trends of hospital architecture in Korea. It is anticipated that hospital architecture will change immensely in the enlarging process of these minor changes.

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Simulated-Annealing Improvement Technique Using Compaction and Reverse Algorithm for Floorplanning with Sequence-Pair Model (Sequence-Pair 모델 기반의 블록 배치에서 압축과 배치 역변환을 이용한 Simulated-Annealing 개선 기법)

  • Seong, Young-Tae;Hur, Sung-Woo
    • Proceedings of the Korean Information Science Society Conference
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    • 2008.06b
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    • pp.598-603
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    • 2008
  • Sequence-Pair(SP)는 플로어플랜을 표현하는 모델 중 하나로써, 일반적으로 SP 모델을 사용하는 플로 어프래너 (floorplanner)는 Simulated-Annealing (SA) 알고리즙을 통해 해 탐색 과정을 수행한다. SP 모델을 이용한 다양한 논문에서 플로어플랜 성능 향상을 위해 평가함수의 개선과 스케줄링 기법 향상을 모색하였으며, 평가함수의 경우 O(nlogn) 시간 알고리즘이 존재한다. 본 논문에서는 SP 모델을 이용한 SA 기법에서 SA의 해 탐색 과정 중 초기 해 탐색 시점에서 좋은 해를 빠르게 찾을 수 있는 방법을 제안한다. 제안 기법은 기존의 SA 프레임펙을 수정한 2단계 SA 알고리즘으로써 SP에 대응하는 배치를 압축하고 압축한 배치를 역변환하는 과정으로 구성된다. 실험과 결과를 통해 제안기법의 효과를 보이며, 평균적으로 동일한 SA 환경 하에서 제안기법이 최종결과 면에서 우수함을 보인다.

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JPEG2000 영상 압축을 위한 EBCOT 설계

  • 조태준;이재흥
    • Proceedings of the Korea Society of Information Technology Applications Conference
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    • 2002.11a
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    • pp.468-478
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    • 2002
  • 고품질의 영상 압축기인 JPEG2000의 기본 압축 코덱인 EBCOT(Embedded Block Coding With Optimized Truncation)를 설계하였다. 영상 압축기에서 Context 추출 구현을 위하여 코드블록(Code block)으로 분할하고, 비트플랜(Bit-Plane)코딩을 했으며, 3가지 패스 그룹으로 분리한 후 ZC, RLC, MR, SC를 하였다. 산술부호화는 덧셈 연산과 쉬프트 연산만을 사용하는 MQ-coder를 사용하였으며, Context들의 누적 확률을 추정하여 테이블을 작성하였고, 압축데이터를 산출하였다. 영상 압축을 위한 엔트로피 코더의 하드웨어 구현은 VHDL를 이용하여 설계를 하고, Synopsys사의 논리 회로 합성 도구를 사용하여 합성을 하였으며, Altera사의 FLEX 10K250 Device를 이용하여 FPGA로 구현하였다.

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JPEG2000 영상 압축을 위한 EBCOT 설계

  • 조태준;이재흥
    • Proceedings of the Korea Society for Industrial Systems Conference
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    • 2002.11a
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    • pp.468-478
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    • 2002
  • 고품질의 영상 압축기인 JPEG2000의 기본 압축 코덱인 EBCOT(Embedded Block Coding With Optimized Truncation)를 설계하였다. 영상 압축기에서 Context 추출 구현을 위하여 코드블록(Code block)으로 분할하고, 비트플랜(Bit-Plane)코딩을 했으며, 3가지 패스 그룹으로 분리한 후 ZC, RLC, MR, SC를 하였다. 산술부호화는 덧셈 연산과 쉬프트 연산만을 사용하는 MQ-coder를 사용하였으며, Context들의 누적 확률을 추정하여 테이블을 작성하였고, 압축데이터를 산출하였다. 영상 압축을 위한 엔트로피 코더의 하드웨어 구현은 VHDL를 이용하여 설계를 하고, Synopsys사의 논리 회로 합성 도구를 사용하여 합성을 하였으며, Altera사의 FLEX 10K250 Device를 이용하여 FPGA로 구현하였다.

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A Study on the Planning Standard of Seoul Public Elementary School around 1940 (일제강점기 말 경성부의 공립 초등교육시설 계획규준에 관한 연구)

  • Lee, Jeong-Woo
    • Proceedings of the KAIS Fall Conference
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    • 2008.05a
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    • pp.329-332
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    • 2008
  • 본 연구는 일제강점기말 경성부의 초등교육시설 계획규준의 특성과 그 의미를 살펴보는 것을 목적으로 하고 있다. 이를 위해 1939년과 1942년 "조선과건축(朝鮮と建築)"에 소개된 자료를 중심으로 경성부의 계획규준을 운영양상, 학교규모 및 구조, 단위공간 규격 및 소요제실, 교사동 배치 및 블록플랜으로 나누어 고찰하였다.

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A Study on the Standard Drawings of Seoul Elementary School Architecture in 1960~70s (1960~70년대 서울시 국민학교 건축 표준설계도에 관한 연구)

  • Lee, Jung-Woo
    • Journal of the Korea Academia-Industrial cooperation Society
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    • v.9 no.6
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    • pp.1718-1725
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    • 2008
  • Until 1980s, Korean elementary school architecture has been stereotyped by standard drawings. But there have been very few researches focused on this subject, especially regional one. As an attempt to improve these conditions, this study reviewed standard drawings of elementary school architecture by Education Board of Seoul in 1964 and 1975. Both standard drawings were reviewed through items such as components making a set of standard drawings, floor plan, elevation design and subsidiary facilities. They have rectangular unit classrooms, single-corridor block plan and plain exterior having no symbolic images, which are the characteristics of typical Korean school architecture until 1980s. On the other hand, they reveal the unknown characteristics such as double-corridor block plan, classrooms in basement, toilets of conventional type placed on every floor and changes in details of openings and exterior wall.

Power/Clock Network-Aware Routing Congestion Estimation Methodology at Early Design Stage (설계 초기 단계에서 전력/클록 네트워크를 고려한 라우팅 밀집도 예측 방법론)

  • Ahn, Byung-Gyu;Chong, Jong-Wha
    • Journal of IKEEE
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    • v.16 no.1
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    • pp.45-50
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    • 2012
  • This paper proposes the methodology to estimate the routing congestion of modern IC quickly and accurately at the early stage of the design flow. The occurrence of over-congestion in the routing process causes routing failure which then takes unnecessary time to re-design the physical design from the beginning. The precise estimation of routing congestion at the early design stage leads to a successful physical design that minimizes over-congestion which in turn reduces the total design time cost. The proposed estimation method at the block-level floorplan stage measures accurate routing congestion by using the analyzed virtual interconnections of inter/intra blocks, synthesized virtual power/ground and clock networks.