• 한국산업정보학회논문지
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• 제8권2호
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• pp.38-44
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• 2003

본 논문에서는 화상회의 시스템의 구조 및 입출력 모델의 분석을 통하여 시스템 버스의 병목현상을 개선하기 위해서 멀티미디어 데이터가 네트워크 접속장치로부터 주 기억 장치 및 멀티미디어 처리장치에 동시에 전송될 수 있는 방법을 제안한다. 제안한 방법은 화상회의 시스템에서 시스템 버스의 사용횟수, 버스 사이클, 데이터의 전송시간 및 비디오 데이터의 압축비를 줄일 수 있다. 본 논문에서 제안한 방법을 다자간 화상회의 시스템에 적용하여 기존의 방법과 성능을 비교하였다. 시뮬레이션 결과, 제안한 방법이 기존의 방법보다 멀티미디어 데이터의 전송 시간을 감소시킬 수 있음을 확인하였다.

• 한국산학기술학회:학술대회논문집
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• 한국산학기술학회 2011년도 추계학술논문집 2부
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• pp.668-670
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• 2011

본 논문에서는 고속 무선 데이터 전송을 위하여 멀티버스 구조 및 유연적인 데이터 버퍼시스템을 갖는 향상된 바이너리 CDMA에 시스템 설계에 관한 것이다. 개선된 바이너리 CDMA 시스템 구조는 제한된 리소스에서 시스템 버스의 Latency를 최대한 줄이고 고속 무선 데이터 전송을 위하여 버퍼접근구조를 변경하여 데이터 throughput을 향상하였다.

• 한국정보과학회:학술대회논문집
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• 한국정보과학회 1998년도 가을 학술발표논문집 Vol.25 No.2 (3)
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• pp.261-263
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• 1998

IEEE-1394 버스(이하 13394 버스)는 가정용 가전기기와 컴퓨터를 서로연결 할 수 있는 버스로 100Mbps, 200Mbps, 400Mbps의 광대역폭을 제공하고 데이터를 전달하는 방법으로 비동기 (asynchromous)전송뿐만 아니라 등시성(isochronous)전송도 제공한다. 비동기 전송은 시간의 제약이 없고 정확한 전달이 필요한 데이터에 적합한 반면 등시성 전송은 실시간을 요구하고정확한 전잘이 필요없는 데이터에 적합한 특성을 가진다. 1394 버스는 멀티미디어 데이터를 생성하고 편집하는 장치들을 서로 연결시키고 기존의 LAN이 갖는 대역폭의 부족과 프로토콜살의 실시간 전송 방법의 부재 때문에 진정한 의미의 실시간 구현이 어려웠던 화상 전화기, 화상회의 시스템, 비디오편집 시스템을 가능하게 한다. 이러한 멀티미디어 응용 시스템은1)대용향의 멀티미디어 파일 전송을 필요로 하고 화상전화기 혹은 화상회의 시스템은 2) 고속의 파일 전송을 요구하게 된다. 또 두사람이 화상 전화기를 통해 통신을 하면서 여러 가지 문서를 교환하는 경우 최대한 빠르게 파일 전송이 완료될 필요가 있다. 현재 1394버스에서 IP가 올리는 일이 진행중이므로 기존의 FTP는 사용할 수 없다. 게다가 1394 버스에 IP가 올라가더라도 1394 버스 내에서 대용량의 파일을 더 빠르고 정확하게 전달하기 위해서는 IP오버헤드가 없고 1394 버스의 특성을 직접 이용한 새로운 파일 전송 기법이 필요하다. 1394 버스내에서 대용량의 파일을 빠르고 정확하게 전송하는 기법을 찾기 위해서는 비동기 전송과 등기성 전송의 특성을 잘 이해해야하고 각 전송 방법으로 파일을 전송 할 때 생기는 장단점들을 파악해야한다. 본 논문에서는 비동기 전송과 등기성 전송을 이용한 팔일 전송 기법을 각각 제시하고 실험을 통해 이들의 특성을 비교분석하였다.미에서 uronic acid 함량이 두 배 이상으로 나타났다. 흑미의 uronic acid 함량이 가장 많이 용출된 분획은 sodium hydroxide 부분으로서 hemicellulose구조가 polyuronic acid의 형태인 것으로 사료된다. 추출획분의 구성단당은 여러 곡물연구의 보고와 유사하게 glucose, arabinose, xylose 함량이 대체로 높게 나타났다. 점미가 수가용성분에서 goucose대비 용출함량이 고르게 나타나는 경향을 보였고 흑미는 알칼리가용분에서 glucose가 상당량(0.68%) 포함되고 있음을 보여주었고 arabinose(0.68%), xylose(0.05%)도 다른 종류에 비해서 다량 함유한 것으로 나타났다. 흑미는 총식이섬유 함량이 높고 pectic substances, hemicellulose, uronic acid 함량이 높아서 콜레스테롤 저하 등의 효과가 기대되며 고섬유식품으로서 조리 특성 연구가 필요한 것으로 사료된다.리하였다. 얻어진 소견(所見)은 다음과 같았다. 1. 모년령(母年齡), 임신회수(姙娠回數), 임신기간(姙娠其間), 출산시체중등(出産時體重等)의 제요인(諸要因)은 주산기사망(周産基死亡)에 대(對)하여 통계적(統計的)으로 유의(有意)한 영향을 미치고 있어 $25{\sim}29$세(歲)의 연령군에서, 2번째 임신과 2번째의 출산에서 그리고 만삭의 임신 기간에, 출산시체중(出産時體重) $3.50{\sim}3.99kg$사이의 아이에서 그 주산기사망률(周産基死亡率)이 각각 가장 낮았다. 2. 사산(死産)과 초생아사망(初生兒死亡)을 구분(區分)하여 고려해 볼때 사산(死産)은 모성(母性)의 임신력(姙娠歷)과 매우 밀접한 관련이 있는 것으로 사료(思料)되었고 초생아사망(初生兒死亡)은 미숙아(未熟兒)와 이에 관련된 병발이 거의 결정

• 한국경영과학회:학술대회논문집
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• 한국경영과학회 1997년도 추계학술대회발표논문집; 홍익대학교, 서울; 1 Nov. 1997
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• pp.212-215
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• 1997

이동통신 시스템에서 고속 데이터, 그래픽, 동화상 등과 같은 이동 멀티미디어 서비스를 추가로 제공하기 위해서는 기존의 음성 및 데이터 뿐만 아니라 화상, 영상 데이터를 고속으로 교환할수 있도록 시스템 내부 프로세서간 메시지 교환을 위한 CDMA 상호연결 통신망에 대한 성능 향상이 요구된다. 본 논문에서는 CDMA 상호연결망의 성능 향상을 위한 가상 토큰 이중버스(VTDB:Virtual Token Dual Bus)의 구조 및 매체접근제어 프로토콜을 제안하고 성능을 평가하였다. 제안하는 VTDB 프로토콜에서는 공유버스에 대한 매체접근 제어시 가상 토큰에 의한 예약 기능을 사용하여 전송할 메시지를 가진 노드간 가상토큰 전달시간(스위치오버 시간)을 줄여 버스의 성능을 향상시키며, 또한 각 노드를 독립된 두 개의 버스에 동시에 연결하여 메시지 전송시 두 버스를 함께 사용하게 함으로써 통신망의 성능 및 신뢰성을 개선한다. 해석적 방법을 이용한 성능 분석을 통하여 본 논문에서 제안한 VTDB 프로토콜의 성능이, 기존의 단일버스 구조를 갖는 가상토큰 전달방식의 매체접근 제어 프로토콜과 비교하여 우수함을 확인할수 있었다.

• 한국정보과학회논문지:시스템및이론
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• 제28권1_2호
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• pp.11-19
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• 2001

근래에 들어, 백플레인 버스를 기반으로 하는 멀티프로세서 시스템의 프로세서간 통신에도 TCP/IP와 같은 표준 네트워크 프로토콜을 이용하여 표준 MAC 계층을 구현하는 것이 일반적이다. 본 논문은 이러한 MAC 에뮬레이션 기반 버스 네트워크상에서 내장형 실시간 은용을 지원하기 위한 최악 응답 시간 분석법을 제시한다. 본 논문의 분석법은 구체적으로 MAC 에뮬레이션 방법의 하나인 ANSI BusNet 프로토콜을 대상으로 진행된다. 각 실시간 태스크를 주기, CPU 시간, 종료시한, 메시지 패킷 개수로 모델링하고 스케쥴 가능성, 즉 주어진 종료 시한 내에 작업을 완료할 수 있는지의 여부를 검사하는 수식을 유도한다. 이를 위해 물리적인 버스 특성을 고려한 버스 전송 모델을 제시하고, 버스 중재 방식과 버스 하드웨어의 캐슁 지원 여부에 따른 스케쥴 가능성을 분석한다. 또한 본 논문에서는 실험을 통해 블록 전송이 실시간 통신 성능에 미치는 영향을 살펴본다. 비록 본 논문의 분석법이 BusNet에 기반하여 개발되었지만, BusNet이 대부분의 백플레인 하드웨어가 지원하는 기본적인 기능만을 가정하고 있으므로, 본 논문의 분석법은 다른 종류의 백플레인 네트워크 프로토콜에도 쉽게 적용될 수 있다.

• 한국산학기술학회:학술대회논문집
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• 한국산학기술학회 2009년도 춘계학술발표논문집
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• pp.255-258
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• 2009

최근 EDA 툴의 기술적인 향상과 반도체 공정의 발달로 IC 설계자들은 RISC 프로세서, DSP 프로세서, 메모리 등 많은 IP가 하나로 집적되는 SoC구조가 가능해졌다. 하지만 기존에 사용되는 대부분의 SoC는 공유버스 구조를 가지고 있어, 병목현상이 발생하는 문제점을 가진다. 이러한 문제점은 SoC 내부의 IP들이 많을수록 SoC 플랫폼의 전체 성능이 저하되어, CPU 자체의 속도보다는 효율적인 통신에 의해 성능이 좌우된다. 본 논문에서는 공유버스의 단점인 병목현상을 줄이고 성능을 향상시키기 위하여 크로스바 스위치버스 구조를 제안한다. OpenRISC 프로세서, VGA/LCD 제어기, AC97 제어기, 디버그 인터페이스, 메모리 인터페이스로 구성되는 SoC 플랫폼의 WISHBONE 온칩 공유버스 구조와 크로스바 스위치 버스 구조의 성능을 비교한 결과, 기존의 공유버스보다 26.58%의 성능이 향상됨을 확인하였다.

• 한국정보과학회논문지:정보통신
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• 제30권4호
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• pp.494-503
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• 2003

IEEE 1394 고속 직렬 버스(이하 IEEE 1394 혹은 버스)는 실시간 데이타 및 일반 패킷 데이타 전송을 위해 가전제품군과 PC 간의 고속 멀티미디어 통신을 저가로 제공한다. IEEE 1394의 전송 모드는 크게 비동기와 등시성 모드가 있어, 비동기 모드는 최선형 서비스를 제공하고, 등시성 전송 모드는 대역폭을 예약해 QoS를 보장한다. 본 논문은 링크 계층 및 응용 계층 수준에서 IEEE 1394의 성능을 분석하고 각 전송 모드를 비교한다. 응용 계층 수준의 성능 분석을 위해 1394 계층과 상위 계층 사이에 필요한 대표적인 인터페이스인 고정 방식과 적응적 방식을 시스템에 적용하고, 이를 각기 폴링 시스템으로 분석한다. 그리고 분석 모델의 타당성을 시뮬레이션을 통해 확인한다. 그 결과, IEEE 1394의 데이타 전송모드를 적응적으로 선택하여 버스 접근 지연시간을 줄이고 대역폭 낭비를 막아 버스 이용률을 높일 수 있음을 보였다.

• 한국콘텐츠학회지
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• 제19권1호
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• pp.13-17
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• 2021

현재, COVID-19로 인해 비대면 상태가 지속되면서 사람 간의 만남이 줄어들고 있는 상황에서 급부상하는 것이 메타버스이다. 본 기고에서는 현실의 모습을 옮겨 놓은 가상현실 세계인 메타버스 세계를 알아보고 우리가 미래에 어떻게 살아가야 할지를 조망해 본다. 이를 위해 메타버스 서비스 플랫폼 중 가장 많이 알려진 국내의 네이버Z의 제페토(zepeto)와 국외의 초등학생 70%가 하고 있는 로블록스(roblox) 서비스의 기술현황을 분석해 메타버스가 우리의 미래에 미치는 영향과 모습을 확인하고자 한다.

• 한국정보통신학회논문지
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• 제16권2호
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• pp.273-278
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• 2012

본 연구에서는 임베디드 시스템에서 많이 사용되는 대용량 플래쉬 메모리 모듈 중 멀티미디어카드 (MMC; Multi-Media Card)와 마이크로프로세서간 데이터를 송수신 할 수 있는 SPI (serial peripheral interface) 버스 인터페이스를 설계하였다. 제안하는 구조는 AMBA 버스구조의 APB 저전력 버스에 호환되도록 설계하였다. 임베디드 시스템에 OS를 탑재하게 되면 여러 가지 주변기기들을 제어하기는 쉬워지지만 하드웨어와 소프트웨어의 덩치가 커져 결국 시스템 성능에 부담스런 영향을 미치게 된다. 본 논문에서는 OS를 사용하지 않는 임베디드 시스템에 멀티미디어카드를 인터페이스하기 위하여 SPI 통신 개념을 도입하였고, FPGA로 구현하였다. 설계한 SPI 모듈은 Altera QuartusII 툴을 사용하여 자동 합성하여 P&R을 수행하였다. 결과물은 Altera CycloneII FPGA로 구현하였으며 타겟으로 정한 25MHz에서 충분히 동작 가능하다.

• 대한전자공학회논문지SD
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• 제45권5호
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• pp.71-81
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• 2008

본 논문에서는 새로운 On-Chip 버스로 다중처리 기반의 GALDS 버스 구조를 제안하였고 성능을 검증하였다. 제안된 GALDS 버스 구조는 멀티 마스터 멀티 슬레이브의 다중 처리를 지원하는 세그먼트(segment) 기반의 고성능의 양방향 다중처리 버스 구조(bi-direction multitasking bus architecture)이다. 또한, 시스템의 태스크(task) 분석에 의해서, 버스는 버스 동작 주파수의 배수 값을 갖는 주파수 사이에서 각각의 IP에 최적화된 동작 주파수를 선택하기 때문에 전체 전력 소모를 줄일 수 있다. 서로 다른 동작 주파수를 입력받은 IP들 간의 효율적인 데이터 통신을 위하여, 본 구조에서는 비동기 양방향 FIFO를 기반으로 하는 비동기 Wrapper 설계하였다. 또한, 버스 세그먼트의 추가만으로 시스템의 쉬운 확장이 가능하기 때문에, 제안된 구조는 IP 재사용 및 구조적 변경이 용이한 장점을 갖는다. 제안된 버스의 검증을 위해 4-마스터/4-슬레이브를 가지는 4-세그먼트의 버스와 비동기 Wrapper를 Verilog HDL을 이용하여 구현하였다. 버스의 다중처리동작 검증은 버스와 IP의 동작 주파수 비가 1:1, 1:2, 1:4, 1:8인 경우를 기준으로 시뮬레이션을 통해 마스터 IP에서 슬레이브 IP 사이의 데이터 읽기 및 쓰기 전송 동작을 확인하였다. 데이터 전송은 Advanced Microcontroller Bus Architecture(AMBA)과 호환 가능한 16 Burst Increment 모드로 하였다. 제한된 GALDS 버스의 최대 동작 지연시간은 쓰기 동작 시 22 클럭, 읽기 동작 시 44 클럭으로 확인되었다.