• The Transactions of the Korean Institute of Power Electronics
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• v.3 no.4
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• pp.365-374
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• 1998

The SHE(Selected Harmonic Elimination) PWM scheme which eliminates specific lower order harmonics can generate h high quality output waveforms in 3-level PWM inverters. However. its application has limited since SHE switching a angles cannot be calculated on-line by a microprocessor-implemented control system. Based on off-line optimization. in which multiple SHE solutions were found and analysed for 2 to 5 switching angles per quarter in the 3-level SHE PWM pattern. this paper presents an algebraic algorithm for an ordinary microprocessor to calculate approximate SHE S switching angles on-line with such high resolution that it makes no practical difference between the accurate and the a approximate SHE switching angles. By employing the variable of the dc-link voltage Vdc' the proposed SHE PWM p pattern can ideally compensate the dc input fluctuation together with selected harmonics eliminated.

• The Transactions of the Korean Institute of Power Electronics
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• v.6 no.4
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• pp.317-324
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• 2001

This paper proposes a SSSC based on 3-level half-bridge inverters. The dynamic characteristic of the proposed SSSC was analyzed by EMTP simulation and a scaled hardware model, assuming that the SSSC is inserted in the transmission line of the one-machine-infinite-but power system. The proposed SSC has six 3-level half-bridge inverters per phase, which operates in PWM mode. The proposed SSSC generates a quasi-sinusoidal output voltage by 90 degree phase shift to the line current. The proposed SSSC does not require the coupling transformer for voltage injection, and has a flexibility in operation voltage by increasing the number of series connection.

• The Transactions of the Korean Institute of Power Electronics
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• v.13 no.1
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• pp.9-14
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• 2008

Since they use the low switching frequency in multilevel inverter systems, they generate the high low frequency harmonic components. Generally, LC filter is used at the output terminal of inverter systems to solve this problem. But it causes a voltage drop at the output terminal by use of damping resistors, and causes the problem in which system efficiency decreases due to power loss of the damping resistor. In this paper, we proposed an output filter design method for NPC three-level inverter systems with low switching frequency. And we analyzed the efficiency of the proposed filter system, and the effectiveness of the proposed system is verified by simulation and experimental results.

• Proceedings of the KIPE Conference
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• 2014.11a
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• pp.48-49
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• 2014

본 논문에서는 4권선 변압기를 이용하여 멀티레벨 운전을 하는 새로운 결선 방식을 제안하였다. 일종의 개방형 권선 구조의 확장으로서, 동일한 하드웨어에서 결선만 바꿈으로써 2차단 권선에 인가되는 전압의 레벨 수를 늘릴 수 있다. 본 논문에서는 제안된 결선 방식에 대한 등가회로를 중첩원리를 이용하여 유도하였다. 제안된 결선 방식을 3개의 델타 결선된 권선에 적용하면, 2레벨 인버터를 사용하더라도 1개 권선의 전압을 합성하는 데 6개의 스위칭 상태가 관여하게 되어 권선 전압의 레벨수를 9개까지 늘일 수 있다. 제안된 회로의 등가회로를 도출하고 모의실험을 통해 등가회로의 타당성을 검증하였다.

• Proceedings of the Korea Information Processing Society Conference
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• 2001.10a
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• pp.711-714
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• 2001

본 논문에서는 파이프라인 구조를 이용하여 고성능 1 차원 이산 웨이블렛 변환 필터를 설계하였다. 각 레벨에서 입력이 다운샘플링(downsampling, decimation)되므로 각 레벨의 하드웨어를 폴딩(folding) 기법을 이용하여 곱셈기와 덧셈기를 공유함으로써 복잡도를 개선하였다. 즉, 제안한 구조에서는 레벨 2 와 레벨 3 에서 폴딩된 구조의 C.S.R(Circular Shift Register)곱셈기와 덧셈기를 사용함으로써 하드웨어 효율(hardware utilization)을 각 레벨에서 100%로 높일 수 있다. 또한, 홀수와 짝수의 샘플을 병렬로 입력함으로써 단일 입력의 시스템과 비교할 때, 동일 시간에 병렬화 만큼의 이득을 얻을 수 있었고, 필터 계수는 미러 필터(mirror filter)의 특성을 이용하여 쳐대한 고역 필터(high pass filter)와 저역 필터(low pass filter)의 계수들을 공유함으로써 곱셈기와 덧셈기의 수를 반으로 줄였다. 그리고 임계 경로(critical path)를 줄이기 위한 파이프라인 레지스터를 삽입하여 고성능 시스템을 구현하였다.

• The Transactions of the Korean Institute of Power Electronics
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• v.16 no.1
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• pp.30-37
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• 2011

This paper presents a circuit configuration of multilevel inverter to synthesize a large number of output voltage levels by connecting a full-bridge inverter to a 5-level inverter in series. We analyze the characteristics by computer-aided simulations and experiments when it has input voltage sources which have the same and the power of three in the amplitude. In addition, it is compared with the conventional transformer based multilevel inverter.

• Proceedings of the KIPE Conference
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• 2012.07a
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• pp.516-517
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• 2012

최근 신재생 에너지 발전과 더불어 고효율, 고품질의 대용량 계통 연계형 발전에 대한 수요는 증가하고 있는 추세이다. 또한 스위치 소자값이 저렴해짐에 따라 새로운 멀티레벨 인버터에 대한 토폴로지 연구가 활발히 진행되고 있다. 멀티레벨 인버터는 레벨을 증가시킴으로서 THD 감소와 고효율을 이룰 수 있는 반면, 다수의 DC 전원이 필요한 단점을 갖고 있다. 따라서 본 논문에서는 하나의 DC 전원을 입력하면 독립적인 3개의 DC 전원을 출력하는 멀티레벨용 DC/DC 컨버터를 제안한다.

• The Journal of Korean Institute of Communications and Information Sciences
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• v.28 no.6A
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• pp.397-404
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• 2003

In this paper, we have analyzed the level of cross-modulation noise required for CDMA mobile station and proposed a guideline for optimum design. From the analysis, the level of cross-modulation noise is determined by the system's noise figure(NF) and VCO's phase noise and there is a trade-off relationships between them. In addition, we have determined the value of LNA's IIP3 and duplexer's isolation to satisfy the above level in designing the system. Therefore, this paper will give a guideline for a selection of components in designing cdma2000 mobile station.

• Proceedings of the KIPE Conference
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• 2010.07a
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• pp.434-435
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• 2010

본 논문에서는 배전급 고전압(1kV~7.2kV) 계통 연계가 가능한 새로운 3 병렬 3 레벨 NPC(Neutral-Point-Clamped) 컨버터/인버터 회로방식을 제안한다. 이 회로방식은 정격 용량의 1/3 크기를 가지는 NPC 컨버터/인버터 모듈을 3 병렬로 구성하면서 직류단 캐패시터를 병렬 연결하여 중성점 전위 변동을 저감할 수 있는 특징을 가진다. 제안된 3 병렬 3 레벨 NPC 컨버터/인버터는 기존의 NPC 컨버터의 장점을 가지면서 동시에 용량 확장이 가능하고, 하나의 모듈이 고장 상태가 되더라도 부분 운전이 가능하여 시스템의 신뢰성을 증대시킬 수 있다. 본 논문에서는 제안된 중성점 전압 제어 전략을 실험을 통하여 검증한다. 정밀한 중성점 전압 제어를 위한 중성점 전류 제어 방법이 3병렬 구조에서 안정적으로 동작함을 컴퓨터 모의 실험을 통해 검증한다.

• The Transactions of the Korean Institute of Power Electronics
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• v.14 no.6
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• pp.472-480
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• 2009

This paper describes the overmodulative SVPWM technique and harmonics analyses of three phase NPC type three-level inverter to the modulation index. Three phase NPC type three-level inverter adopted SVPWM to extend the linear region to 0.907, moreover, the following voltage compensation using Fourier series was adopted in the region of overmodulation to make it work to six-step level. PD type of multi carrier method is used with the double Fourier series for the analysis of output power harmonics characteristic. Simulation was performed by PSIM, and the harmonics characteristics of 3-level inverter in each region are analyzed. The side band harmonics of carrier frequency are dominant in the linear region, but these harmonic components are decreased as the inveter goes to overmodulation region, and the harmonics due to the fundamental frequency is increased gradually at the same time. The harmonic analyses are verified through the simulation and experimental results under the same condition.