• The Optical Journal
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• s.114
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• pp.48-52
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• 2008

사진영상분야에서 아시아 최고의 전시회로 손꼽히는 '2008 서울국제사진영상기자재전/디지털영상전'이 4월 10일부터 13일까지 나흘간의 일정으로 코엑스 본관 1층 태평양홀에서 성대하게 개최된다. 올해로 17회 째를 맞이하며 국내에서 개최되는 국제 규모의 사진 관련 행사 중 최대 규모를 자랑한다. 올해 전시회에는 삼성테크윈을 비롯한 메이저 카메라 업체 및 글로벌 기업들이 대거 참가해 다양한 시연행사와 함께 참관객들에게 잊지 못할 즐거운 체험의 장을 선사할 예정이다. 특히 디지털카메라에 대한 소비자들의 니즈가 다양화되고 고급화되면서 카메라 업체에서도 다양한 신기술이 적용된 최고급 기종을 속속 선보이는 가운데 이번 P&I 전시회에서는 그 어느 때보다 톡톡 튀는 아이디어와 기술의 융합이 만들어낸 카메라 신기술의 경연장이 될 전망이다.

• The Proceedings of the Korean Institute of Illuminating and Electrical Installation Engineers
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• v.8 no.2
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• pp.41-45
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• 1994

In this paper, it is implemented that Sub- MRA PWM techinque which is applied to MRA PWM technique using the Digital Signal Processor. Unstable element of analog is reduced for Sub - MRA PWM technique by digital signal pressing. And harmonic is analized by simulation to verify that. It is afford the process induction motor control with real time by minimizing the delay time of digital system. Time delay which is a defect of digital control can by minimized using fast caculation. Therefore, real time control is implemented in the induction motor

• Proceedings of the Korean Institute of Intelligent Systems Conference
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• 2003.05a
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• pp.103-106
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• 2003

선박의 초기 설계 단계에서는 작업의 용이성과 설계자의 관습 둥으로 인해 선박모델은 통상 2차원 모델로서 표현된다. 하지만 제품의 상세 설계 단계로 넘어가면 부품의 가공정보 도출, 부품간의 간섭확인, 제품의 성능해석의 용이성 등의 이유로 인해 제품 정보는 3차원 디지털 모델로서 표현되어야 한다. 그러나 현재까지 이러한 과정은 설계자에 의해 수작업으로 진행되고 있고 이 과정에서 공기의 지연, 설계자에 의한 해석 및 입력 오류 둥 많은 문제점이 야기되고 있다. 본 연구에서는 이러한 문제의 해결을 위해, Fuzzy 추론 기법을 이용한 2차원 선박 모델의 3차원 디지털 모델로의 자동 변환 기술을 검토한다.

• Proceedings of the Korean Printing Society Conference
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• 2002.05a
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• pp.32-32
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• 2002

디지탈 윤전 등사기 또는 디지털복사 인쇄기(digital duplicator)라고 불리우는 사무용 소형 단색 윤전 인쇄기는 컴퓨터 스캐닝 기술과 스텐실 열천공 기술의 발달로 손쉽게 인쇄기상에서 자동복사 제판이 가능해 짐에 따라 우리나라에 1990년대부터 학교, 관공서, 군 및 교회등의 시험지와 홍보전단지 인쇄용으로 널리 보급되었다. 여기에 사용되는 잉크는 카트리지에 장착식으로 공급되는데, 에멀젼 잉크로서 천공으로 이루어진 스텐실 화상 뒷면으로부터 가압 통과되어 인쇄용지에 윤전식으로 인쇄된다. W/O형 에멀젼 잉크가 그 기본 전형이 된 것은 스텐실의 미세구멍을 통과하도록 큰 로라압력을 받아야 하는 잉크는 우선적으로 높은 점도이어야 하나 수십 마이크론의 미세구멍을 쉽게 빠져 나가도록 침투성이 빨라야 하는 이중적 레올로지 특성이 요구되기 때문이다. 그러나 에멀젼의 원천적인 불안정성과 물과 기름의 상호 대립적인 물리 \ulcorner화학적 특성을 주목하고 번짐, 얼룩, 배면침투, 광택문제, 건조성 지연 등의 인쇄품질을 향상시키고져 그동안 많은 연구개발이 노력이 있어 왔다. 이에 대하여 세계 시장을 크게 장악하고 있는 일본의 특허를 주로 검토하여 디지털 인쇄기용 W/O 에멀젼 잉크 기술 및 현황에 대해서 연구 조사하였다.

• The Optical Journal
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• s.98
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• pp.18-22
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• 2005

2005년 국내 복사기 시장은 최근 3년간 부동의 8만대 규모가 예측되는 가운데 디지털복합기는 전체 복사기 판매량의 85%에 달할 전망이다. 예전에는 디지털화와 네트워크화가 복사기 시장의 이슈였다면 지금은 컬러화와 사무환경의 솔루션화 쪽으로 시장의 큰 축이 이동해 가고 있다. 특히 디지털 컨버전스 시대의 도래에 따라 사무기기 기업 고유의 경계영역이 무너지면서 기업들이 IT와 결합된 고부가가치 솔루션 부문에 집중하는 현상이 두드러졌다. OA 3사가 올해 들어 기존 사무기기 업체로서의 이미지를 과감히 버리고 새롭게 ‘솔루션 제공 및 컨설팅’업체로 변신을 선언한 자체가 시사하는 바가 크다. 이제 복사기를 포함한 사무기기 시장은 단순 하드웨어를 판매하고 유지관리해서 이윤을 발생시키는 형태에서 벗어나 고객중심의 솔루션 제공을 통한 마케팅 능력이 관건으로 작용할 것으로 보인다.

• The Journal of the Acoustical Society of Korea
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• v.12 no.1E
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• pp.39-47
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• 1993

2-Dimension IIR 디지털 필터를 시스토릭 어레이 구조로 실현하는 방법을 보였다. 시스토릭 어레이는 1-D IIR 디지털 필터로 부분 실현한 후 종속연결하여 구현하였다. 부분 실현한 시스토릭 어레이의 종속 연결은 신호 지연에 사용되는 요소를 감소 시킨다. 여기서 1-D 시스토릭 어레이는 local communication 접근에 의해 DG를 설계한후 SFG로의 사상을 통해 유도하였다. 유도된 구조는 매우 간단하며, 입력 샘플이 공급되어지면 매 샘플링 기간마다 새로운 출력을 얻는 매우 높은 데이터 처리율을 갖는다. 2-Dimension IIR 디지털 필터를 시스토릭 어레이로 실현함으로써 규칙적이고, modularity, local interconnection, 높은 농기형 다중처리의 특징을 갖기 때문에 VLSI 실현에 매우 적합하다. 또한 PE셀의 승산기 설계에서는 modified Booth's 알고리즘과 Ling's 알고리즘에 기초를 두고 고도의 병렬처리를 행할수 있도록 설계하였다.

• The KIPS Transactions:PartB
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• v.8B no.4
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• pp.395-402
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• 2001

본 논문에서는, 1차원 및 2차원 웨이브렛 함수를 전역통과필터(APF)와 지연기의 병렬접속에 위한 재귀형(IIR) 디지털 필터로 구성하는 방법을 제안한다. Mallat에 의하여 웨이브렛 변환과 필터뱅크가 밀접한 관계에 있다는 것이 알려졌고, 완전 재구성 필터뱅크로부터 웨이브렛 함수를 도출하는 다양한 방법이 알려져 있다. 그러나, 이러한 방법의 대부분은 비재귀형(FIR) 디지털 필터에 근거를 두는 것으로, 재귀형 디지털 필터에 의한 방법은 거의 제안되어 있지 않다. 재귀형 필터를 이용하는 장점은 비재귀형에 비하여 낮은 차수로 표현되는 점이다. 또 직교 웨이브렛 함수를 끌어내기 위한 직교조건을 용이하게 만족시킬 수 있다. 본 논문에서는 웨이브렛 함수에 요구되는 레귤레리티(Regularity)조건을 만족시키기 위하여, 최대 평탄성(Maximally Flat)을 부가한 새로운 1차원 및 2차원 재귀형 웨이브렛 함수의 도출법을 보인다.

• The Journal of Korean Institute of Communications and Information Sciences
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• v.34 no.2C
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• pp.209-216
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• 2009

The repeater for wireless broadband internet (Wibro) system using OFDM demands the short processing delay to eliminate inter-symbol interference resulted from the time delay greater than the guard time. Towards this, the total system delay of repeater is expected to be minimized as possible as it can without distorting signal quality. In general, the FIR-type of filter is commonly deployed as a channelization filter, but due to its large amount of coefficients for producing prerequisite filter response the excessive large time delay occurs. To withstand this problem, the paper proposes the method for designing IIR filter whose response almost identical to that of the original filter. Moreover, in order to linearize the phase response of the designed IIR filter, this paper also introduce the way of designing the all-pass filter to be cascaded works for linearizing phase response of the channelization as well as the de-channelization filter. To achieve the further improvement in linearization of the phase response and reduction of the overall complexity, this paper tries to transform the integrated IIR filter group into the structure in polyphase style. The computer simulation verifies that the integrated IIR filter group designed in this paper reveals the relatively short processing delay without harming the acceptible signal quality.

• Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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• v.9 no.2
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• pp.820-822
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• 2005

We have designed a 32-bit microprocessor with fixed point digital signal processing functionality. This processor, combines both general-purpose microprocessor and digital signal processor functionality using the reduced instruction set computer design principles. It has functional units for arithmetic operation, digital signal processing and memory access. They operate in parallel in order to remove stall cycles after DSP or load/store instructions, which usually need one or more issue latency cycles in addition to the first issue cycle. High performance was achieved with these parallel functional units while adopting a sophisticated five-stage pipeline stucture.

• Journal of Digital Contents Society
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• v.15 no.2
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• pp.137-145
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• 2014

In this paper, we focus on end-to-end transfer delay improvement by using erasure coding when delivering expediting message consisting of M packets in networks with high coefficient of variation of transfer time. In the scheme, M packets are divided into b groups with each having g packets. Each group is erasure coded with additional r packets and transmitted. Since the first arrived g packets among g+r packets completes the delivery of the group, the delivery time of the expediting message is reduced. For the scheme, we investigate the optimum group size and number of redundancy packets considering delivery delay reduction and additional transmission cost caused by using erasure coding. From the results of the investigation, we see that the proposed scheme is effective in networks having high variability of transfer time and would be very useful and practical especially for the case that expedited deliveries of messages are needed.