본 논문에서는 스트림 암호 구현 시 하드웨어 설계가 용이한 고속 자기 상관기와 이를 이용한 개선된 키 수열 동기 방식을 제안하였다. 제안 방식은 키 수열 동기시 잡음이 무선 채널에서도 동기를 유지할 수 있는 고속, 고신뢰도 초기 키 수열 동기 방식이며, 기존 방식보다 복잡도를 크게 줄 여서 하드웨어 구현이 용이하도록 하였다.
논문에서는 프레임릴레이 프로토콜을 사용하는 암호 통신 시스템에 적합한 키 스트림 동기 방식을 제안하였다. 제안된 주소영역의 확장 비트를 이용한 키 스트림 동기 방식은 단위 측정 시간 동안 측정된 프레임릴레이 프로토콜의 주소영역의 확장 비트 정보와 플래그 패턴의 수신률을 이용하여 문턱값보다 적은 경우에 동기 신호와 세션 키를 전송하므로써 종래의 주기적인 동기 방식에서 전송 효율성 저하와 주기적인 상이한 세션 키 발생, 다음 주김까지 동기 이탈 상태로 인한 오류 확산 등의 단점을 해결하였다. 제안된 알고리즘을 데이터 링크 계층의 처리기능을 최소화하여 패킷 망의 고속화가 가능하도록 설계된 프레임릴레이 프로토콜에서 서비스되는 동기식 스트림 암호 통신 시스템에 적용하여 slip rate $10^{-7}$의 환경에서 주기가 Isec인 주기적인 동기 방식에서 요구되는 9.6*10/ sup 6/비트에 비해 6.4*$10^{5}$비트가 소요됨으로써 전송율 측면에서의 성능 향상과 오복호율과 오복호율과 오복호 데이터 비트 측면에서 성능 향상을 얻었다.다.
IEEE 802.15.4a에 제안된 IR-UWB (Impulse Radio Ultra Wideband) 시스템의 경우 패킷 방식으로 동작하며 하나의 패킷은 SYNC 심볼 (symbol)과 SFD (Start of Frame Delimiter) 심볼로 이루어진 프리앰블, 헤더 및 데이터부로 구성된다. 성공적인 패킷 수신을 위해서는 프리앰블을 이용한 초기 동기 획득과 SFD 검출이 필수적이다. IEEE 802.15.4a IR-UWB 시스템의 경우 SFD 패턴은 8개의 심볼로 구성되어 있으며 SYNC 패턴의 길이에 비하여 매우 짧아 정상적으로 초기 동기를 획득한 경우에도 SFD 패턴 검출에 실패하여 해당 패킷에 대한 복조를 수행하지 못하는 경우가 발생한다. 본 논문에서는 초기 동기 획득 이후 잉여 SYNC 심볼들 중 일부를 활용하여 IEEE 802.15.4a에 제안된 IR-UWB 시스템의 SFD 검출 성능을 개선하는 방안을 제안한다.
주기적인 워터마크 패턴에 적용할 수 있는 새로운 워터마크의 동기 복원 방법이 제안되었다. 주기적인 워터마크 패턴을 이용해서 워터마크의 동기를 찾는 방법은 널리 알려져 있지만, 직접적으로 동기 복원을 위한 파라미터를 추정하지 않고 대부분이 피크를 검출하는 과정에 의지하고 있어 그 성능에 있어 한계가 있었다. 제안된 동기 복원을 위한 파라미터 추정 방법은 Radon 변환을 이용하여 손실 압축이나 의도적으로 동기 복원을 방해하려는 공격 하에서도 동기를 복원하는 능력이 탁월한 성능을 보였다.
본 논문에서는 주파수 도약 대역 확산시스템에서 빠른 주파수 도약 패턴을 발생시키며 이에 따른 수신기 동기회로에 관한 연구이다. 고속의 PN 초기동기를 달성하기 위한 정합필터 방식에서 기존의 동기회로 구조로부터 상관기의 개수를 2개로 줄이고 초기동기를 위한 짧은 도약패턴(hoping prefix)을 몇 개의 부 패턴(sub prefix)으로 나눈다. 각기 상이한 주파수 도약패턴에 의하여 PN코드 시작시각에 대한 정보를 보내 이 정보를 이용하여 빠른 동기 획득을 이루게 하며 검출의 신뢰도를 높일 수 있는 고속의 초기동기 회로를 제안하였다. 또한 디지털 주파수 합성기를 사용하여 빠른 주파수 도약을 위한 PLL 구현이 가능함을 분석하였다. 즉, 주파수 스텝(${\Delta}f$)이 1.5MHz이상이면 settling 시간이 $30{\mu}s$정도가 되므로 빠른 주파수 도약을 위한 PLL의 구현이 가능함을 보였다. 결국 동기시간 단축에 있어서 가장 큰 영향을 미치는 것은 주파수 합성기의 빠른 주파수 획득시간과 동기회로의 초기동기 획득시간임을 알 수 있었다.
본 논문에서는 W-CDMA(Wide band Code Division Multiple Access) 시스템에서 채널 측정 및 프레임 동기 확인에 사용되는 파일럿 비트 패턴의 프레임 동기 단어(frame synchronization words) 성능을 분석한다. 또한 W-CDMA 시스템에서는 두 개의 수신 단말기를 갖지 않고도, 다른 주파수의 측정을 하기 위해 압축 모드(compressed mode)를 사용한다. 제안된 프레임 동기용 이원 부호의 우선 쌍 간의 보완 매핑(complementary mapping) 관계를 이용하면, 압축 모드에서도 프레임 동기 특성을 유지함을 컴퓨터 시뮬레이션을 통하여 확인한다. 검출 확률과 오 경보 확률을 갖는 수신기 동작 특성(ROC: Reciever Operating Characteristic) 곡선은 LLRT(Log Likely-hood Ratio Test), GLRT(Generalied Likeiyhood Ratio Test), 연판정(soft correlation test), 경 판정(hard correlarion test)과 같은 다양한 검출법(detection metrics)을 이용하여 레일레이 페이딩 채널에서 제안된 프레임 동기 단어의 성능 분석에 사용된다. 이 논문의 파일럿 비트 패턴의 성능에 대한 연구 결과는 3세대 W-CDMA 시스템에서 프레임 동기의 설계 및 구현에 유용한 참고 자료가 될 수 있을 것이다.
디지털 비디오의 발전이 가속됨에 따라, 비디오 샷 경계 검출은 비디오 분석 및 카타로깅 등 여러 분야에 있어 필수적인 요소가 되었다. 기존 샷 경계 검출 방법들은 잠음이나 카메라 혹은 물체의 이동, 그리고 색상의 급격한 변화 등에 민감한 성능을 보인다. 본 논문에서는 개선된 지역 방향 패턴 기반(eLDP) 검출 방법을 제안한다. 제안하는 방법은 RGB 색상의 일부와 eLDP의 특징을 결합해 더욱 강인한 샷 경계 검출 성능을 보였다. 또한, 셋톱박스 품질검사 시 필요한 채널 간 동기화의 신뢰성을 높였고, 실시간으로 검사하면서도 안정적인 샷 경계 검출이 가능함을 입증하였다.
버스트 방식 OFDM 시스템에서의 프레임 동기는 수신된 프레임의 시작 위치를 판단하고, 정확한 FPT-window 위치 추정을 위해 가장 우선적으로 수행되어야 한다. 유효 OFDM 심볼 내의 규정된 반복 패턴 또는 보호 구간의 상관을 이용하는 기존의 일반적인 프레임 동기 방식은 연속적으로 증가하다 감소하는 상관 출력 특성에 의해 정확한 프레임 시작 지점 검출이 어려우며, 수신 신호와 기준 신호 간의 상관 특성을 이용하는 방식은 주파수 옵셋으로 인한 성능 열화를 초래한다. 따라서, 본 논문에서는 프레임 동기 방식으로서 주파수 옵셋에 강인하고 정확한 프레임 시점 검출이 가능한 차동 상관(Differential Correlation) 방식을 기반으로 한 새로운 알고리즘을 제안하였다. 그러나, 일반적인 차동 신호의 상관 결과는 프리앰블의 반복 구조에 의해 다수의 Peak를 가지게 되며 이로 인하여 정확한 프레임 동기의 검출 성능이 열화된다. 본 논문에서는 이러한 차동 검출 방식의 단점을 보완하기 위하여 차동 신호 생성 시 반복되는 동일 패턴 구간의 샘플을 이용하여 단일 상관 Peak를 갖는 알고리즘을 제안한다. 또한 다중경로 페이딩 채널 환경에서 페이딩에 의한 프레임 시작 위치 검출 에러를 줄이기 위하여 신호 전력으로 상관 출력 값을 정규화하는 블록을 도입함으로써 고속 이동 채널 환경에서의 프레임 시작 지점 검출 확률을 높였다.
본 논문은 ITU-T 권고안 J-38 부록 B에 명시된 전송방식의 분석 및 시뮬레이션을 토대로 성능을 분석 하였으며 FPGA 구현시 야기되는 문제점을 나타내고, 해결방안을 제시하였다. 구현상의 문제점으로는 크게 두 가지로 분류되는데, 첫째로 다양한 부호화 방식과 변조방식 그리고 심볼 단위 및 비트 단위의 처리로 인해 많은 클럭수를 요구하는데 본 논문에서는 읽기/쓰기 메모리를 이용하여 필요한 클럭수를 줄였다. 둘째로는 펑쳐링 부호화된 TCM 복호기에 펑처링 패턴에 정확한 동기를 얻지 못하면 프레임 동기 심볼인 UW(Unique sync-Word)를 획득하지 못하여 모든 데이터가 에러 처리되기 때문에 본 논문에서는 펑처링 패턴과 UW 심볼의 동기를 맞추는 알고리즘을 제시하였다. 이러한 알고리즘 분석 및 구현상의 문제점 해결을 토대로 본 논문에서는 ITU-T J38 annex B의 하향 스트림 채널 부호화 시스템을 VHDL 언어를 사용하여 FPGA 칩에 직접 구현하였다.
본 논문에서는 Quadrature Detector를 이용하여 4FSK 신호 변복조 시스템에 대한 전반적인 분석 및 시뮬레이터를 구현하였다. 구현 기준은 무선 호출시스템 표준인 FLEX 규격을 따랐으며 이에 따라 Pre-modulation 필터 및 데이터 프레임을 구성하였다. 심볼동기 알고리즘은 128bit 구간동안의 프리앰블 패턴을 이용하여 심볼동기를 획득할 수 있는 효율적인 개루프 방식을 제안하였으며, 다양한 UW 검출 방식 중 최적 UW 검출방식인 비주기자기상관 우수코드에 의한 32bit의 최적 UW 패턴을 제안하였다. 아울러 Quadrature Detector의 BER 특성을 AWGN 환경에서 뿐만 아니라 페이딩환경에서 BCH Coding과 Interleaving을 적용해 부호이득을 분석하였다
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[게시일 2004년 10월 1일]
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