• 한국통신학회논문지
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• 제36권8B호
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• pp.1012-1020
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• 2011

분 논문에서는 해상 이동업무에 할당되어 있는 VHF 대역에서 선박과 육상간 및 선박과 선박간에 ${\pi}$/4-DQPSK 변조방법을 이용하여 디지털 데이터 및 e-mail을 교환하기 위한 기저대역 수신부 설계에 대하여 논한다 해상 통신 장치는 상대적으로 큰 주파수 불안정성을 허용하기 때문에, 상대적으로 큰 주파수 편이를 갖을 수 있는 수신 및 주파수 편이 등의 동기파라미터를 추정하고 이를 보상할 수 있는 기능을 갖도록 기저대역 수신기를 설계하였다. BER의 모의실험을 통하여 설계한 기저대역 수신기는 20% 이상의 정규화 주파수 편이가 존재하더라도 AWGN 채널환경하에서 0.5dB 이내의 성능열화가 있음을 확언 하였다.

• 한국통신학회논문지
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• 제30권10A호
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• pp.922-929
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• 2005

본 논문에서는 직접대역 확산 통신 기법을 사용하는 이동통신 시스템에서 하향링크상의 무선신호를 이용하여 오버헤드 채널상의 정보를 취득하고 이 정보를 이용하여 파일롯 채널을 생성함으로써 기지국 간 하드핸드오프를 가능하게 하는 적응형 파일롯 비콘 장치를 제안한다. 본 적응형 파일롯 비콘 장치는 무선 신호 중에서 파일롯 채널 만을 선별하여 생성 및 전송하므로 상대적으로 낮은 전력으로 서비스가 가능하며, CDMA 수신부에서 하향링크상의 파일롯 채널로부터 기지국의 시간동기 및 주파수 동기를 획득하여 장치의 오프셋을 보정하므로 GPS에 의한 시간동기가 필요하지 않으며 기지국 순방향 신호의 수신이 가능한 임의의 장소에 설치가 가능한 장점이 있다. CDMA수신기에서 하향링크 파일롯 신호를 탐색하는 파일롯 서처는 FPGA와 DSP를 이용하며, FPGA에서 구현된 파일롯 서처는 초기동기 획득용으로 사용되곤 DSP에서 구현되는 파일롯 서처는 비콘장치의 클럭과 기지국 장치의 클럭사이에 발생하는 오프셋 오차를 보정하는 역할을 수행한다. 적응형 파일롯 비콘 장치의 CDMA 송신부는 CDMA 수신부에서 취득한 파일롯 채널의 시간정보인 타임오프???V을 이용하여, 기지국에 동기된 하향링크 파일롯 신호를 생성한다. FIR필터를 통하여 출력된 1차 중간주파신호는 RF모듈웨서 상향변환된 후 고출력증폭기와 안테나를 통하여 방사하게 된다.

• 전자공학회논문지
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• 제49권12호
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• pp.64-72
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• 2012

주파수 옵셋 보상, 프레임 동기화, Timing Recovery를 포함하는 동기화는 모든 유/무선 통신 시스템에서 가장 중요한 신호 처리 블록이다. 대부분의 통신 시스템에서는 Training sequences 또는 프리앰블을 기반으로하는 동기화 방법이 사용된다. IEEE에서 제정한 802.11a/g/n의 무선랜 표준은 OFDM 시스템을 기반으로 한다. OFDM 시스템은 주파수와 타이밍 동기화 에러에 대해서 싱클캐리어 시스템보다 더 민감한 것으로 알려져 있다. 프레임의 시작점과 OFDM 심볼 및 훈련심볼의 시작점은 상관관계를 이용하여 추정될 수 있다. 상관관계를 처리 기능을 하는 블록은 일반적으로 많은 수의 곱셈기로 인하여 큰 복잡도를 갖게 된다. 본 논문에서는 IEEE 802.11a/g/n 시스템을 위한 훈련심볼 내의 심볼값이 반복되는 특성을 활용한 복잡도가 현저히 낮은 동기화 기법을 제안한다. 시뮬레이션과 구현결과 제안된 기법이 기존의 방법보다 성능저하는 없는 반면 훨씬 적은 복잡도를 갖는 결과를 보여준다.

• 한국정보통신학회논문지
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• 제5권7호
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• pp.1219-1225
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• 2001

본 논문에서는 BWLL 상향링크에 적용할 수 있는 버스트 QPSK 수신기의 동기알고리즘을 설계하였다. 본 논문에서 설계한 버스트 수신기는 디지털 다운컨버터와 정합필터 그리고 동기회로로 구성되어 있다. 동기회로의 경우 심벌 타이밍 복구를 위하여 가드너 알고리즘을 사용하였고 반송파 주파수 복구를 위하여 4승법을 사용하였으며 반송파 위상 복구는 DD알고리즘을 사용하였다. 성능 분석을 위하여 제안된 알고리즘에 대한 시뮬레이션 결과와 VHDL로 코딩되어 FPGA에 구현된 실제회로의 결과를 비교, 분석하였다. 성능분석 결과 주파수 옵셋이 심벌율의 4.7% 까지 동기기가 잘 동작하였다.

• Journal of Positioning, Navigation, and Timing
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• 제5권3호
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• pp.157-163
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• 2016

Clocks for time synchronization using radio signals such as global navigation satellite system (GNSS) may lose reference signals by intentional or unintentional jamming. This is called as holdover. When holdover occurs, a clock goes into free run in which synchronization performance is degraded considerably. In order to maintain the required precise time synchronization during holdover, accurate estimation on main parameters such as frequency offset and frequency drift is needed. It is necessary to implement an optimum filter through various simulation tests by creating clock noise in accordance with given specifications in order to estimate the main parameters accurately. In this paper, a method that creates clock noise in accordance with given specifications is described.

• Journal of Positioning, Navigation, and Timing
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• 제9권4호
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• pp.293-304
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• 2020

In this paper, various modulation techniques, including the legacy Global Navigation Satellite System (GNSS) signal modulation techniques, are introduced and the spectral characteristics and correlation characteristics of signals with various modulation techniques are analyzed based on numerical simulation. With the development of various GNSS services, the limited frequency band has become increasingly saturated, and issues of interoperability and compatibility have emerged in the new GNSS design. Since the efficient allocation of frequency resources is closely related to spectrum design, modulation techniques are one of the important signal design parameters of new signal design. Signal modulation techniques are closely related to various figure of merits (FoMs) as well as spectrum characteristic, and in some cases there is a complicated trade-off between FoMs. Thus, the FoMs associated with modulation technology should be analyzed and the best signal candidates should be chosen carefully via the trade-off analysis for FoMs. In this paper, we define the modulation technique based on Phase Shift Keying (PSK), Binary Offset Carrier (BOC) and Continuous Phase Modulation (CPM) for the design of KPS signals, and the FoMs of signals in terms of spectrum and correlation function are evaluated. Signals with various modulation techniques are implemented through a numerical simulation, and the relevant FoMs are analyzed.

• 한국통신학회논문지
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• 제33권9A호
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• pp.874-881
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• 2008

본 논문에서는 DS-SS 방식의 ISO/IEC 24730-2 RTLS 모뎀을 위한 주파수 동기 알고리즘을 제시한다. 제시하는 주파수 동기 알고리즘은 주파수 동기 획득 모드와 주파수 동기 추적 모드로 구성되며, 주파수 동기 획득 모드는 각도 추정과 검증 과정의 두 단계 과정을 통해 이루어진다. 각도 추정에서는 타이밍 간격에 따라 세 가지 경우로 나누어 각도를 추정하고, 검증 과정에서는 추정된 세 각도간의 이론적인 연계성을 이용하여 각도의 모호성을 제거하여 효과적인 주파수 동기화가 이루어지도록 하였다. 이러한 방식으로 구성된 주파수 동기 알고리즘의 이론적 해석과 시뮬레이션을 통한 성능 분석을 토대로 제시한 주파수 동기 알고리즘의 타당성을 검증하였다.

• 한국통신학회논문지
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• 제36권5A호
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• pp.432-440
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• 2011

4세대 이동통신에서 LTE-Advanced 시스템은 최대 1Gbps의 전송 속도를 구현하기 위해 최대 l00MHz의 넓은 주파수 대역을 필요로 한다. 그러나 현재의 상태에서는 이러한 넓은 대역의 주파수를 얻기가 힘들어 대안으로 여러개의 조각난 대역을 합쳐서 사용하는 Carrier Aggregation기법이 제안되었다. 기본적으로 Carrier Aggregation과 같이 다중 대역을 통해 수신되는 신호는 대역별 여러 개의 수신기를 이용해 각각의 대역별로 병렬 수신 처리하는 Multi-Chain방식이 사용되는데 이는 효과적인 방법이 아니다. 그러므로 본 논문에서는, Time division Multiplexing(TDM)방법을 이용하여 단일 수신기로 수신할 수 있는 방법을 연구한다. TDM 방식은 수신된 여러 대역의 신호를 시간적으로 나누어 수신하고 하나의 DSP를 통해 처리할 수 있는 방식이다. 그런데, 이러한 TDM 방식 기반에서는 Sampling Timing Offset (STO)에 의하여 심각하게 성능 왜곡이 발생하게 된다. 그러므로 본 연구에서는 TDM 방식 기반에서 발생하는 샘플링 타이밍 오프셋의 영향을 분석한다. 그리고 그 분석을 통해 구한 STO 추정 값을 이용하여 보상하는 방법을 제안한다. 마지막으로 시뮬레이션을 통해 BER 성능을 확인하고 제안된 시스템이 OFDM 기반의 시스템에서 다중 대역을 단일 수신기로 수신하는 방법에 적합함을 보인다.

• 한국정보통신학회논문지
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• 제7권1호
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• pp.69-74
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• 2003

본 논문에서는 OFDM 신호방식을 사용하는 무선채널 환경에서 무선 멀티미디어에 적합한 클럭 동기복원 알고리즘을 제안한다. 제안된 클럭 동기복원 알고리즘의 기본적인 접근은 수신기의 채널 추정기로부터 추정된 채널의 주파수 응답을 획득하여 IFFT를 통해 채널의 충격 응답 또는 다중 경로 강도 프로 파일을 구하고 시간 영역에서 채널의 에너지가 집중된 일정 범위의 위치를 추적하는 것이다. 또한, 샘플링 클럭 오프셋이 ${\pm}$1∼3 샘플 있는 경우 64-QAM, 16-QAM의 성좌점을 분석하고, BER 성능을 확인한 결과 최적 샘플 지점에서의 성좌점과 BER 성능에 비하여 2 샘플 이상의 오프셋이 발생했을 경우에는 심한 성능 열화가 나타나는 것을 확인하였고, 시뮬레이션 결과로부터, 제안된 알고리즘이 주파수 선택적 페이딩 채널 하에서도 우수한 동기특성을 제공함을 알 수 있다.

• 전자공학회논문지C
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• 제36C권6호
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• pp.18-26
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• 1999

본 논문에서는 무선 LAN 표준안 IEEE 802.11의 직접대역확산(Direct Sequence Spread Spectrum) 물리계층을 지원하는 기저대역 모뎀 ASIC 칩의 아키텍쳐와 설계에 대해 기술한다. 구현된 모뎀 칩은 크게 송신부와 수신부로 구성되어 있으며, CRC 부호화/복호화기, 차동 부호화/복호화기, 주파수 옵셋 보상기(frequency offset compensator) 및 타이밍 복구 회로를 포함한다. 구현된 모뎀 칩은 4, 2 및 1Mbps의 다양한 데이타 전송률을 지원하고, DBPSK와 DQPSK의 변조방식을 사용한다. 구현한 모뎀 아키텍쳐는 $SAMSUNG^{TM}$ $0.6{\mu}m$ 게이트 어레이 라이브러리(gate array library)를 사용하여 논리합성을 수행하였으며, 칩의 전체 게이트 수는 53,355개이다. 칩의 동작 주파수는 44MHz이며, 칩의 패키지는 100-pin QFP이고, 전력소모는 44MHz에서 1.2watt이다. 구현된 모뎀 아키텍쳐는 상용화된 HSP3824 칩 보다 우수한 BER성능을 나타낸다.