본 논문에서는 소형 카메라 모듈의 화질을 분석하는 시스템을 제안하고 이를 이용하여 렌즈의 성능을 평가하며, 플레어 및 헐레이션 방지 디스크를 삽입하여 렌즈의 성능이 개선되는 효과를 검증한다. 카메라 모듈의 화질을 평가하는 카메라 모듈 화질검증 시스템과 이미지 신호 처리기(Image Signal Processor, ISP) 내부의 레지스터를 제어하는 카메라 모듈 제어 프로그램 및 화질분석 소프트웨어를 개발한다. 제안된 헐레이션 방지 디스크를 삽입된 카메라 모듈의 화질을 기존 카메라 모듈의 화질과 비교평가에서 획득된 영상의 해상도, 밝기, 색재현 등의 성능을 검증한다.
본 논문에서는 이차원 이산 웨이블릿 변환을 이용한 실시간 영상 압축 및 복원 프로세서의 구조를 제안하고 ASIC(Application specific integrated circuit) 라이브러리를 이용하여 최소의 하드웨어로 구현하였다. 구현된 하드웨어에서 데이터 패스부는 웨이블릿 변환과 역변환을 수행하는 DWT 커널(Kernel)부, 양자화기 및 역양자화기, 허프만 엔코더 및 디코더, 웨이블릿 역변환 시 계수의 덧셈을 수행하는 덧셈기 및 버퍼, 그리고 입출력을 위한 인터페이스와 버퍼로 구성하였다. 제어부는 프로그래밍 레지스터와 명령어를 디코딩하여 제어 신호를 생성하는 주 제어부, 그리고 상태를 외부로 알리는 상태 레지스터로 구성된다. 프로그래밍 조건에 따라서 영상을 압축할 때의 출력은 웨이블릿 계수, 양자화 계수 혹은 양자화 인덱스, 그리고 허프만 코드 중에서 선택하여 발생할 수 있고 영상을 복원할 때의 출력은 허프만 디코딩 결과, 복원된 양자화 계수 그리고 복원된 웨이블릿 계수 중에서 선택하여 발생할 수 있다. 프로그래밍 레지스터는 총 16개로 구성되어 있는데 각각이 한번의 수직 혹은 수평 방향의 웨이블릿 변환을 수행할 수 있고 각각의 레지스터들이 차례대로 동작하기 때문에 4 레벨의 웨이브릿 변환을 한번의 프로그래밍으로 수행가능하다. 구현된 하드웨어는 Hynix 0.35m CMOS 공정의 합성 라이브러리를 가지고 Synopsys 합성툴을 이용하여 게이트 레벨의 네트리스트(Netlist)를 추출하였고 이 네트리스트로부터 Vela 툴을 이용하여 타이밍정보를 추출하였다. 추출된 네트리스트와 타이밍정보(sdf 파일)를 입력으로 하여 NC-Verilog를 이용하여 타이밍 시뮬레이션을 수행하여 구현된 회로를 검증하였다. 또한 Apollo 툴을 이용하여 PNR(Place and route) 및 레이아웃을 수행하였다. 구현된 회로는 약 5만 게이트의 적은 하드웨어 자원을 가지고 최대 80MHz에서 동작 가능하였다.
This paper describes the design and FPGA implementation of a system control unit within a multiprocessor chip which can be used as a node processor ina massively parallel processing (MPP) caches, memory management units, a bus unit and a system control unit. Major functions of the system control unit are locking/unlocking of the shared variables of protected access, synchronization of instruction execution among four integer untis, control of interrupts, generation control of processor's status, etc. The system control unit was modeled in very high level using verilog HDL. Then, it was simulated and verified in an environment where trap handler and external interrupt controller were added. Functional blocks of the system control unit were changed into RTL(register transfer level) model and synthesized using xilinx FPGA cell library in synopsys tool. The synthesized system control unit was implemented by Xilinx FPGA chip (XC4025EPG299) after timing verification.
본 논문은 컴파일러에 의해 생성된 목적 코드상의 프로시저의 수행 속도를 향상시키기 위한 방안으로, 프롤로그 테일러링 알고리즘을 제안한다. 레지스터의 수가 많은 기계에서 반복 수행되는 프로시저의 경우, 프롤로그와 에필로그에서 실행되는 레지스터 저장 및 복원 명령어를 줄이는 것은 프로시저 실행 속도 향상의 주요 작업이 된다. IBM XL C 컴파일러에서 제공되는 에필로그 테일러링은 실행 경로상의 레지스터 복원 명령어를 줄임으로써, 프로시저 성능 향상에 기여해왔으나, 프롤로그 테일러링에 대한 구체적 알고리즘은 현재 제안되어 있지 않다. 본 논문이 제안하는 알고리즘에 의해 생성된 프롤로그는 각각의 실행 경로에 대해 현저히 감소된 수의 레지스터 저장 명령을 실행하도록 함으로써, 프로시저의 실행 속도를 개선시킨다. 테일러된 프롤로그를 갖는 프로시저가 바르게 실행되기 위해서는, 다이아몬드 구조나 반복 구조 내분에 레지스터 저장 명령을 생성해서는 안된다. 그러므로, 본 논문은 다이아몬드 구조나 반복 구조 내부가 아닌 최적의 위치에 레지스터 저장 명령을 생성하는 알고리즘을 제안한다.
This study analyzes inspection results of ships by Port State Control. Particularly, this research focuses on a detention trend of vessels that registered to Korean Register of Shipping. In order to conduct this research, we have searched 170 ships that got a detention with a Code-30 within recent 46 months period. The deficiencies of the detentions are inspected by ship types, ship years, flags, ports inspected, and criteria. Moreover, we categorized the deficiencies for the detentions into 17 types for internal and external inspections. As the results of the comparison study, bulk and general cargo carriers dominate the portion of detentions by almost 66 percent. Self-induced detention due to a lack of preparation by crews and company support are the main reasons of repeated detentions from the same type ships. Ships between six and ten years old show the lowest detention rate by 4 percent whereas ships less than five years old generate the highest detention rate by 22 percent. The main categories of the detentions from ships less than 5 years old are a lack of documentation and certification, and the clues support our opinion that owners and crews may neglect to prepare the inspections because their strong confidence for the ship condition due to young ship age. As a result of a great effort of Korean government and shipping companies to reduce a detention rate, the detention rate has been recently reduced to 0.3 percent. The results also require companies with the flag of convenience ships to spend more effort to reduce the detention rate, too. We expect that using social networking service by Korea Register will lower the detention rate by sharing relevant information real-time to ships and owners.
본 논문은 모바일 TFT-LCD 구동 집 회로와 임베디드 소프트웨어를 이용한 자동 화질 레지스터 최적화시스템을 제안한다. 이러한 시스템은 LCD모듈의 중요한 화질 평가 요소인 평균 감마 오차, 감마 조정 시간, 플리커 잡음 및 명암비 등을 최적화하기 위해 모바일 LCD구동 집적회로 내의 감마조정 레지스터들과 전압 설정 레지스터 들을 자동적으로 제어한다. 개발된 알고리즘과 임베디드 소프트웨어는 거의 모든 유형의 LCD모듈에 적용 가능하다. 개발된 화질 최적화 시스템은 측정 대상이 되는 모듈 (MUT, LCD 모듈), 제어 프로그램, 휘도 측정용 멀티미디어 디스플레이 측정기 및 인터페이스용 제어 보드로 구성되어 있다. 제어 보드는 DSP와 FPGA로 구성 되 어 있고, RGB 및 CPU 인터페이스를 지원한다.
Stabilizer fins are installed on each side of a ship to control its roll motion. The most common stabilizer fin is a rolling control system that uses the lift force on the fin surface. If the angle of attack of a stabilizer fin is zero or the speed is zero, it cannot control the roll motion. The Coanda effect is well known to generate lift force in marine field. The performance of stabilizer fin that applies the Coanda effect has been verified by model tests and numerical simulations. It was found that a stabilizer fin that applied the Coanda effect at Cj = 0.085 and a zero angle of attack exactly coincided with that of the original fin at α = 26°. In addition, the power needed to generate the Coanda effect was not high compared to the motor power of the original stabilizer fin.
The welding distortion of a hull structure in the shipbuilding industry is inevitable at each assembly stage. The geometric inaccuracy caused by welding distortion tends to preclude the introduction of automation and mechanization and requires additional man-hours for adjustment work during the following assembly stage. To overcome this problem, a distortion control method should be applied. For this purpose, it is necessary to develop an accurate prediction method that can explicitly account for the influence of various factors on the welding distortion. The validity of this prediction method must also be clarified through experiments. For the purpose of reducing the weld-induced bending deflection, this paper proposes the plastic counter-deforming method (PCDM), which uses line heating as the optimum distortion control method. The validity of this method was substantiated by a number of numerical simulations and actual measurements.
Converting technology has developed to print information for the decades. Recently, this technology (like gravure, gravure-offset) is rising as an alternative way for mass production of printed electronics such as RFID, solar cell. For the width of printing line is under 10 microns, registration error should be minimized less than several microns. Tension disturbance is main cause of registration error and this should be minimized before the substrate is transported into printing zone. With PI controller, it is possible to suppress the disturbance within 2% of operating tension. But register error appears more than 10 micron using PIcontroller considering noise. So LQG controller is needed as an alternative control method. In this paper, the comparision of PI and LQG controller in the converting machine including measured noise and tension disturbance is presented. It is shown that the LQG controller is more suitable for precision tension control in printed electronics.
본 컨트롤러는 기존 고속인쇄기 인쇄 속도인 250 [mpm]의 두 배 속도인 500 [mpm]의 고속 인쇄에서도 사용할 수 있는 고성능 레지스터 컨트롤러를 개발해 오차 보정을 좀 더 정확하고 신속하게 하는 것에 그 목적이 있다. 즉, 고속 인쇄기에서 인쇄물의 인쇄오차 보상을 위한 고속 인쇄기용 레지스터 컨트롤러의 특성을 분석하고, 고성능 DSP를 이용하여 기존의 하드웨어에 의존하던 기능의 상당 부분을 소프트웨어로 처리함으로써 간단한 하드웨어 구조와 고성능 오차 보상 기능을 갖는 레지스터 컨트롤러를 개발하였다.
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[게시일 2004년 10월 1일]
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