Yoon, Changwook;Chen, Bichen;Ye, Xiaoning;Fan, Jun
JSTS:Journal of Semiconductor Technology and Science
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v.17
no.4
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pp.543-551
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2017
SOL (Short, Open and Load) calibration based on iterative error sensitivity is proposed in this paper. With advanced SOL calibration, unknown parasitic parameters at on-chip terminations are accurately estimated up to 20 GHz. Artificial terminations are designed on printed circuit board (PCB) to experiment the proposed method. On-chip SHORT, OPEN and LOAD fabricated inside silicon shows the accuracy of proposed calibration method through the comparison with known fixture S-parameter after de-embedding.
LCA (Life Cycle Assessment), that unifies the scale of various environmental impacts, and simulated annealing are applied to optimizing electrolysis of wastewater from PCB (Printed Circuit Board) production. The changes of environmental impact can be quantified with LCA and the total changes of environmental impacts can be expressed as a function of power consumed, Cu recycled, $Cl_2$, NOx and SOx discharged through restriction of feasible reactions. In a single-variate condition, the environmental optimum can be easily obtained through plotting and comparing each environmental impact value. In 8V potentiostatic electrolysis, the lowest environmental impact can be achieved after 90min. To optimize a multi-variate conditional system, simulated annealing can be applied and this can give the quick and near optimum in complex systems, where many input and output materials are involved, through experimentally measured values without a theoretical modeling.
외부에서 발생되는 전자파가 특정 구조물 내에 침투하는 경우, 특히 구조체가 도체로 이루어 졌을 때, 구조체의 크기에 따른 특정 주파수가 공진을 일으켜 내부 PCB(Printed Circuit Board), 회로 등에 악영향을 미친다. 본 논문에서는 개구면이 존재하는 공진기에 전자기파가 입사되는 상황을 모드매칭(MM: Mode Matching)을 이용해서 해석한다. 이때 외부 전자파로 인해 개구면에 생기는 새로운 소스를 표면 등가 이론(Surface equivalence theorem)을 이용하여 등가 자기전류로 모델링하여, 공진기 내 외부의 전자기장을 구한 후 개구면에서 접선성분의 경계조건을 적용시켰다. 본 논문에서 사용된 계산식의 검증을 위해 3차원 유한 요소법(FEM: Finite Element Method)기반의 프로그램인 HFSS를 이용 하였다.
Journal of the Korean Society for Precision Engineering
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v.32
no.7
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pp.627-631
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2015
Conventional etching technology is in the face of problems such as dishing, erosion resulting from non-uniform removal of film. Advanced printed circuit board (PCB) requires accurate wire formation with the aid of planarization by chemical mechanical polishing (CMP). Linear roll CMP is a line contact continuous process which removes the film by pressurization and rotation while slurry is supplied to polishing pad attached to the roll. This paper focuses on the design of floating nozzle on the linear roll CMP equipment which makes the slurry supply uniformly on the roll pad. Experimental results show that removal rate using the floating nozzle increases 3 times higher than that without it and non-uniformity is less than 15%.
Through-hole PCB(Printed Circuit Board) was soldered by flow soldering process using cleaning or noncleaning fluxes. Preheating temperature and conveyor speed were changed in the range of 323∼413K and 0.3∼2m/min respectively. The soldered joints were tensile tested in order to evaluated bonding strength. As experimental results, relatively high tensile fracture load, 120∼140N, were obtained in case of preheating temperature of 383K, and conveyor speed was 0.6∼1.0 m/min. Fractured surfaces of higher tensile strength show some dimple area, while those of lower tensile fracture load show brittle fracture.
We report the new design of a miniature electromagnetic actuator for probe-based data storage with anti-vibration mechanism. The actuator consists of a media substrate, silicon frame, 2 pairs of magnets, a spacer, and a printed circuit board (PCB). The total area of the device is $11.2{\times}11.2 mm^2$ while the data recording area is $7.4{\times}7.4 mm^2$. A net momentum fee structure was included for high vibration resistance. The simulation shows that the lateral vibration can be reduced to below 100 nm for 1 G acceleration if the counter mass is adjusted with $1\%$ difference. The peak power for ${\pm}50 {\mu}m$ displacement is below 50 mW for a actuator with a resonance at 200 Hz.
Journal of electromagnetic engineering and science
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v.11
no.3
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pp.207-212
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2011
This paper presents a CPW-fed antenna with three slots. The proposed antenna can operate at 1.9~2.1 GHz and 2.9~3.3 GHz which are generated by the two rectangular slots, and 4.5~11.6 GHz which is generated by the main patch. The semicircle-slot is used as a band-notched filter to stop at a desired band (5.150~5.825 GHz) limited by IEEE 802.11a or HIPERLAN/2 applications. The currents concentrate around corresponding slots at the desired band. The proposed antenna is very small in size, with overall dimensions of $27{\times}32{\times}1\;mm^3$ etched onto an FR4-printed circuit board (PCB).
Electric power in large devices is controlled by digital circuits, such as switching mode power supply. This kind of power circuits require accurate current sensor for power distribution. We studied characteristics of shunt resistor, which has many advantages for commercial application compared to Hall-effect current sensor. We applied ceramic package to the shunt resistor. Ceramic package has good thermal conductivity compared to plastic package, and this point is important for space requirement in Printed Circuit Board (PCB). Another advantage of the ceramic package is that surface mount technology (SMT) can be used for production. Our experimental results showed that the ceramic packaged resistor showed about 50% lower temperature than the plastic packaged one. Burning point and frequency characteristics are also discussed.
JSTS:Journal of Semiconductor Technology and Science
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v.10
no.1
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pp.45-48
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2010
An inter-pin skew compensation scheme is proposed, which minimizes the inter-pin skew of parallel interface induced by unequal trace length and loading of printed circuit board (PCB). The proposed scheme measures the inter-pin skew and compensates during power-up with simple hardware. The proposed scheme is applied to 3.2-Gb/s/pin DDR4 SDRAM and implemented in a 0.18 m CMOS process. The inter-pin skew is compensated in 324-cycles of 400-MHz clock and the skew is compensated to be less than 24-ps.
Failure mode and effects analysis (FMEA) is a widely used technique to assess or to improve reliability of products or processes at early stage of development. Traditionally, the prioritization of failures for corrective actions is performed by evaluating risk priority numbers (RPN). In practice, due to insufficient evaluation criteria specific to related products and processes, RPN is not always evaluated properly. This paper reestablishes an effective methodology for prioritization of failure modes in FMEA procedure. Revised evaluation criteria of RPN are devised and a refined FMEA sheet is introduced. To verify the proposed methodology, it is applied to inspection processes of PCB products.
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[게시일 2004년 10월 1일]
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