• 대한전자공학회논문지TC
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• 제37권1호
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• pp.12-22
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• 2000

본 논문에서는 트리 구조의 가입자 전달망인 APON(ATM passive optical network)에서 멀티클래스트래픽의 효율적인 전송을 위한 윈도우 기반 허락 분배 기법을 제안하였다. 제안된 기법은 상향 셀들의 다중화를 위한 허락 분배 과정에서 ATM 트래픽 클래스별 전송 특성을 고려함을써 각 트래픽 유형별 QoS를 보장할 수 있도록 설계되었다. 이를 위하여 상향 프레임의 주기적 요구 블록 (RAU)에 트래픽 유형별 요구 필드를 두고, 윈도우 기반 허락 분배 알고리즘을 수행하여 각 트래픽의 특성을 고려한 전송 허락이 이루어지도록 한다. 엄격한 전송 지연 성능을 요구하는 CBR/VBR 트래픽에 대해서는 Running-window 개념을 사용한 최소화할 수 있도록 하고, ABR 트래픽에 대해서는 CBR/VBR 허락 분배 후 여분 대역을 우선적으로 할당함으로써 전송 지연을 줄인다. 또한 대역 할당 후 남은 대역은 UBR 트래픽에게도 예약이 가능하도록 함으로써 망 자원의 이용률을 높일 수 있도록 하였다. 시뮬레이션을 통해 제안된 기법의 성능이 기존 프로토콜에 비해 우수함을 보였다.

• 대한전자공학회논문지TC
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• 제41권8호
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• pp.9-18
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• 2004

IEEE 802.11 DCF(Distributed Coordination Function) 프로토콜은 무선 매체의 공유를 위하여 단말간 경쟁기반의 분산 채널접근 방법을 제공한다. 그러나, 이 방법은 단말 수가 증가함에 따라 많은 충돌(Collision)을 야기한다. 따라서, 지연 지터 그리고 효율측면에서 IEEE 802.11 DCF의 성능은 급격하게 감소한다. 본 논문에서는 IEEE 802.11 DCF 시스템의 성능을 향상시키기 위해 간단하고 효율적인 DCF/VG(Distributed Coordination Function with Virtual Group) 방법을 제안한다. 제안하는 방법에서, 각 단말은 캐리어 검출을 통해 현재 채널의 경쟁 수준(Contention Level)을 측정하고 경쟁 수준에 따라 독립적으로 가상 그룹 주기(Virtual Group Cycle)를 결정한다. 가상 그룹 주기는 하나 이상의 가상 그룹들로 이루어지며 하나의 가상 그룹은 한번의 유휴 기간(Idle Period)과 한번의 번잡 기간(Busy Period)을 갖는다. 단말은 가상 그룹 주기 중에서 자신이 선택한 가상 그룹에서만 동작하며 다른 그룹에서는 동작하지 않는다. 즉, 단말이 선택한 가상 그룹에서는 IEEE 802.11 DCF처럼 유휴 슬롯을 검출하면 백오프 카운터(Backoff Counter)를 감소시키고 백오프 카운터가 0이 되면 데이터 패킷을 전송한다. 그러나 다른 가상 그룹에서는 유휴 슬롯을 검출하더라도 백오프 카운터를 감소시키지 않는다. 제안하는 방법을 수학적 분석과 시뮬레이션을 통해 IEEE 802.11 DCF와 성능을 비교 분석한다. 성능 비교 분석 결과, 제안하는 방법이 다양한 경쟁 수준 환경에서 높은 효율과 낮은 지연 및 지터를 가짐을 확인하였다.

• 한국정보통신학회논문지
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• 제19권1호
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• pp.185-191
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• 2015

본 논문에서는 원자력 안전등급 제어기기의 안전 통신망 구현을 위한 원자력 안전등급 통신 보드를 제안한다. 원자로 보호계통이 아날로그에서 디지털화되면서 디지털 통신망을 사용하게 되었다. 디지털 통신망은 원자력 안전등급에 사용되는 통신망으로 안전등급에서 요구하는 성능 및 시험을 통과한 통신보드가 제공되어야 한다. 통신 프로토콜 계층은 OSI 7 계층 중 물리계층, 데이터링크 계층, 어플리케이션계층만을 사용한다. 데이터 링크 계층에서는 사이버 보안을 위해 데이터 패키지를 변경하였다. 데이터 건전성을 위해 CRC32를 사용 하였으며 데이터 수신에 대해서는 재요청 및 응답을 하지 않는 단방향 통신만을 함으로써 원자력 안전계통에 영향을 주지 않게 설계 되었다. 또한 원자력안전등급을 획득하기 위해서 요건, 설계, 검증의 절차에 따라 설계하였다. 하드웨어검증을 위해 전자파 시험, 노화분석 시험, 육안검사, 번인시험, 내환경 시험 및 내진 시험과 같은 기기 검증을 수행 하였다. 또한 FPGA 펌웨어 검증을 위해 IEEE 1074의 생명주기를 준수하여 단위시험과 통합 시험을 실행 하였다[1-3].