본 논문은 고전압 실험실에서 시변성 전자계의 측정 및 평가에 관한 것으로 전자적 외란은 주로 전력장비의 지락고장 및 개폐조작에 의해 기인되며, 전자회로와 제어장비틀은 전자방해작용에 매우 민감하다. 주어진 전자환 경에 대한 전자방해작용의 레벨을 평가하는 것은 필수적이다. 전계는 40 Hz-2oo MHz 범위의 대역폭을 갖는 전계센서로 관측되었으며, 시변성 자계는 출력이 입사신호에 직접적으로 비례하는 루프형 센서로 측정되었다. 또한 진동성 과도전류와 차단파 임펄스전압에 의해 유도된 전자방해작용의 레벨파 전자 차폐의 외함설계에 관한 정보를 주는 사변성 전자계의 주파수 성분을 고속프리에변환으로 분석하였다.
The retention and fatigue properties of ferroelectric LiNbO$_3$ thin films were studied. Metal-ferroelectric-semiconductor(MFS) devices by using rapid thermal annealed LiNbO$_3$/Si structures were successfully fabricated and demonstrated nonvolatile memory operations of the MFS devices. The I$_{D}$-V$_{G}$ characteristics of MFSFET\`s showed a hysteresis loop due to the ferroelectric nature of the LiNbO$_3$ thin film. The ferroelectric capacitors showed practically no polarization degradation up to about 10$^{10}$ switching cycles when subjected to symmetric bipolar voltage pulse (peak-to-peak 6V, 50% duty cycle) in the 500kHz. The retention properties of the LiNbO$_3$ thin films were quite good up to about 10$^{3}$ s . s .
본 논문에서는 A/D, D/A 변환의 한 방식인 1-bit interpolation 방법을 개선, 보완한 1-bit interpolation per-channel u-law companding PCM변환방법을 제시하고 실험회로를 구성하여 이의 동작을 확인하였다. 실험회로는 시중에서 입수하기 수월한 소자들인 TTl, logic IC 및 741 OP Amp 등으로 구성하였다. 실험결과로서는 40dB에 걸친 입력 dynamic range와 40dB 이상의 출력 dynamic range를 얻을 수 있었다. 본 논문에서 제시한 per-channel A/D, D/A변환기는 현용의 공통 codec의 단점을 충분히 보완시킬 수 있을 뿐 아니라 다중화에 있어서도 상당한 잇점을 지니고 있다.
Today's size of production operations in the packaging paper sector I sconstantly increasing , featuring integral processing systems, high-speed paper machines, and the increased marketing of lower basis weight products. The risk factors involved in these large investments lie more than ever in the available furnish potential and ongoing requirements for further closure of water loops and lower operating costs. A comparison is drawn between recovered paper furnish mixtures used in European mills with regard to fibre properties, strength potential and contaminant content, Both the furnish situation and development trends in modern fluting and testliner machines are instigating concept changes in stock preparation, the approach flow as well as in process water and rejects technology. Developments are currently focussed for example on more efficient debris separation using fine slotted screening, optimized refining , more systematic process water management with loop separation and integral water clarification as well as more efficient removal of microstickies, fillers and fines through appropriate combination of rejects handling and water clarification processes. Product quality differentiation depends decisively on strength characteristics as a function of refining , fines removal , paper machine technology, and sizing . Maximum availability of today's high speed paper machines and , as a result, cost effective production can be ensured by optimum balancing of all subsystems with in the overall concept and by reliable control of problems with contaminants and deposits.
Torque ripple content and variable switching frequency operation of conventional direct torque control (DTC) are reduced by the integration of space vector modulation (SVM) into DTC. Integration of space vector modulation to conventional direct torque control known as SVM-DTC. It had been more frequently used method in renewable energy and machine drive systems. In this paper, SVM-DTC is used to control the rotor side converter (RSC) of a wind driven doubly-fed induction generator (DFIG) because of its advantages such as reduction of torque ripples and constant switching frequency operation. However, flux and torque ripples are still dominant due to distorted current waveforms at different operations of the wind turbine. Therefore, to smoothen the torque profile a Neural Network Controller (NNC) based SVM-DTC has been proposed by replacing the PI controller in the speed control loop of the wind turbine controller. Also, stability analysis and simulation study of DFIG using process reaction curve method (RRCM) are presented. Validation of simulation study in MATLAB/SIMULINK environment of proposed wind driven DFIG system has been performed by laboratory developed prototype model. The proposed NNC based SVM-DTC yields superior torque response and ripple reduction compared to other methods.
In this paper, we analyze experimental results by applying the PHILS model to a lab-scale superconducting current limiter system for its actual application in medium-voltage direct current (MVDC) systems. Superconducting current limiters exhibit effective current-limiting performance in circuit breaker operations, particularly in limiting large fault currents within a short period, addressing the challenges posed by the increasing use of renewable energy and the integration of DC medium-voltage distribution systems. The development of such superconducting current limiters faces various technical and cost disadvantages, especially when applying a medium-voltage 35kV level system, which is intended for future introduction. The proven lab-scale superconducting current limiter system and the PHILS model are combined and integrated into the actual system. Our plan involves analyzing the limiter's performance, assessing its impact on the system, and preparing for its application in future medium-voltage systems. Utilizing RTDS, a simulation was conducted by connecting actual scaled-down equipment and systems, with the analysis results presented.
본 연구에서는 지하수 관정을 활용하고 밀폐형-개방형이 결합된 복합지열시스템(CWG 시스템)을 시설재배지에 적용하여 열원측 및 부하측의 열교환량과 투입된 전력량 대비 효율을 평가하였다. 또한, 운전 과정에서의 외기온도 및 시설재배지 온도를 평가하여 복합지열시스템 적용시의 냉난방 효과를 분석하였다. 냉방운전시 열원측 열교환량 평가결과, 약 235 L/min의 지하수가 유입되는 개방형에서 평균 90.0 kW/h, 약 85 L/min의 순환수가 유동하는 밀폐형에서 40.1 kW/h의 열교환량이 발생하였으며, 전체 열교환량은평균 130.1 kW/h로 분석되었다. 부하측에서 실질적으로 전달되는 열교환량은 평균 110.4kW/h로 평가되었다. 복합지열시스템의 냉방효율을 분석한 결과, 평균 EER는 5.63으로 분석되었다. 난방운전 시 열원측 열교환량 평가결과, 약 266 L/min의 지하수가 유입되는 개방형에서 평균 60.4 kW/h, 약 86 L/min의 순환수가 유동하는 밀폐형에서 22.4 kW/h의 열교환량이 발생하였으며, 전체 열교환량은 평균 82.9 kW/h로 분석되었다. 부하측에서 실질적으로 전달되는 열교환량은 평균 112.0 kW/h로 평가되었다. 복합지열시스템의 난방효율을 분석한 결과, 평균 COP는 3.92로 분석되었다. 외기온도와 CWG 시스템을 적용한 시설하우스 및 비교 시설하우스 내부온도와의 상관관계를 분석한 결과 30RT 용량의 CWG 시스템 하우스가 비교 하우스에 비해 외기온도 $20^{\circ}C$인 경우 $3.4^{\circ}C$, 외기온도 $25^{\circ}C$인 경우 $6.8^{\circ}C$, 외기온도 $30^{\circ}C$인 경우 $10.1^{\circ}C$, 외기온도 $35^{\circ}C$인 경우 $13.4^{\circ}C$의 온도가 저감되는 것으로 평가되었다. 이러한 결과를 볼 때, 본 시스템을 적용할 경우 일반적으로 외기온도가 $30^{\circ}C$ 이상을 보이는 여름철에 CWG 시스템을 적용하지 않은 시설재배지에 비해 약 $10^{\circ}C$ 이상의 냉방효과가 나타낼 수 있을 것으로 판단된다. 이와 같은 결과는 시설재배지의 복합지열시스템 설계에 활용될 수 있고, 다양한 조건에서의 시험성과와 종합하여 복합지열시스템의 냉난방 효과에 대한 보다 명확한 규명이 가능할 것으로 판단된다.
오랫동안 교통신호제어의 효율을 보다 정확하게 평가하기 위한 다양한 방법들이 모색되어 왔다. 요즘에는 HILSS (Hardware-in-the-Loop-Simulation System) 기법을 응용하여 통신환경, 하드웨어 성능, 제어장치의 운영상황 등 물리적 제어환경까지 고려한 평가가 가능한 수준으로 발전하고 있다. 본 연구에서는 CORSIM(5.0)을 교통류 시뮬레이션 모형으로 하고 COSMOS를 교통제어센터로 하여 COSMOS가 CORSIM의 시뮬레이션 가로망의 모든 교차로에 대해 실시간으로 현시진행을 직접 제어하는 방식의 온라인평가모형을 개발하였다. 개발된 평가모형을 검증하기 위해 시뮬레이션에서의 센터 신호계획 반영 정확도를 검증하였으며, 사례연구를 통해 온라인 평가모형에서의 각 가로별 지체시간 분포가 CORSIM 독립시뮬레이션에서의 지체시간 분포비교를 통해 모형의 유효성을 검증하였다. 평가 결과 개발된 평가모형은 COSMOS에 대응하는 실시간 제어에 대응할 수 있음을 보여주었으며, 센터 신호계획에 정확하게 반응하였다. 또한 지체시간 분포 비교를 통해 입력 TOD에 의한 시뮬레이션 결과와 온라인 TOD에 의한 시뮬레이션 결과가 다르지 않은 것으로 나타나 유효한 온라인 평가모형임을 알 수 있었다.
이 논문에서는 낮은 stand-by power 및 DLL의 재동작 후 fast relocking 구조를 가지는 저전력, 고속 VISI 칩용 DLL(지연 고정 루프) 기반의 다중 클락 발생기를 제안하였다. 제안된 구조는 주파수 곱셈기를 이용하여 주파수 체배가 가능하며 시스템 클락의 듀티비에 상관없이 항상 50:50 듀티비를 위한 Duty-Cycle Correction 구조를 가지고 있다. 또한 DAC를 이용한 디지털 컨트롤 구조를 클락 시스템이 standby-mode에서 operation-mode 전환 후 빠른 relocking 동작을 보장하고 아날로그 locking 정보를 레지스터에 디지털 코드로 저장하기 위해 사용하였다. 클락 multiplication을 위한 주파수 곱셈기 구조로는 multiphase를 이용한 feed-forward duty correction 구조를 이용하여 지연 시간 없이 phase mixing으로 출력 클락의 duty error를 보정하도록 설계하였다. 본 논문에서 제안된 DLL 기반 다중 클락 발생기는 I/O 데이터 통신을 위한 외부 클락의 동기 클락과 여러 IP들을 위한 고속 및 저속 동작의 다중 클락을 제공한다. 제안된 DLL기반의 다중 클락 발생기는 $0.35-{\mu}m$ CMOS 공정으로 $1796{\mu}m\times654{\mu}m$ 면적을 가지며 동작 전압 2.3v에서 $75MHz\~550MHz$ lock 범위와 800 MHz의 최대 multiplication 주파수를 가지고 20psec 이하의 static skew를 가지도록 설계되었다.
프리스케일러는 PLL(Phase Locked Loop)의 동작속도를 결정하는 중요한 부분으로서 저전력의 요구조건 또한 만족해야 한다. 따라서 프리스케일러에 적용되는 TSPC(True single pulse clocked) D-플립플롭의 설계가 중요하다. 기존의 TSPC D-플런플롭은 출력단의 글리치(glitch) 문제와 클럭의 프리차지(precharge)구간에서 내부노드의 불필요한 방전으로 인한 소비전력이 증가하는 단점이 있다. 본 논문에서는 프리차지와 방전을 위한 클럭 트랜지스터 패스를 공유함으로서 클럭 트랜지스터의 수를 감소시켰고, 입력 단에 PMOS 트랜지스터를 추가하여 프리차지 구간동안의 불필요한 방전을 차단함으로서 소비전력을 최소화하였다. 또한 출력 단에 mos 트랜지스터를 추가함으로서 글리치 문제를 제거했고, 안정적인 동작을 하는 TSPC D-플립플롭을 제안하였다. 제안된 D-플립플롭을 프리스케일러에 적용시켜 검증한 결과 3.3V에서의 최대동작주파수는 2.92GHz, 소비전력은 10.61mw로 기존의 회로$^[6]$와 비교하였을 때 PDP(Power-Delay-Product) 측면에서 $45.4\%$의 개선된 결과를 얻었다.
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[게시일 2004년 10월 1일]
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