대역폭 제한 그래프신호의 신호복원을 위해서 최대의 정보를 제공하기 위한 그래프 상의 노드를 선택하는 샘플링 집합 선택 알고리즘에 대해 연구한다. 저 복잡도 선택알고리즘을 구현하기 위해 직접적인 비용함수인 신호 복원오차를 최소화 하는 대신, 신호 복원오차의 최대값을 최소화하는 방법에 대해 집중한다, 이를 위해, 추가적인 복잡도 개선을 위해 유용한 근사화공식을 적용하여 성능손실을 최소화하면서 복잡도를 개선한 저 복잡도 탐욕알고리즘을 제안한다. 다양한 그래프신호에 대한 폭넓은 실험을 통해, 기존 저 복잡도 방식과 신호복원성능 및 복잡도를 평가 비교하여 기존방식대비 신호복원 및 복잡도면에서 모두 성능 개선이 있음을 보였으며, 이는 실시간 응용분야에서 실용적인 해결방식으로써 경쟁력 있는 대안을 제시한다.
본 논문에서는 선반가공에서 모터전류 신호를 이용하여 공구 파손을 감지하는 연구를 수행하였다. 본 연구에서는 먼저, 다양한 환경 변화에 대한 모터 전류 신호의 특성을 명확하게 파악하기 위해 신뢰성을 갖고 있는 절삭력과 모터전류 사이의 상관관계를 분석하였으며, 이를 기준으로 하여 공구파손시의 모터 전류 신호에 대해 분석하였다. 다양한 가공 실험을 통하여 절삭조건 변화에 따른 절삭력 신호와 주축 모터전류 신호의 정적 성분에 대한 상관관계를 분석하였다. 그 결과 절삭력과 모터전류 사이에 비례관계가 존재한다는 것을 알 수 있었으며, 이를 통해 모터 전류 신호만으로도 공구 파손을 감지 할 수 있을 것으로 판단하였다. 한편, 다양한 공구 파손 실험을 통해 절삭력과 모터전류 신호 사이에도 높은 상관관계가 존재함을 확인하였다. 이러한 공구파손 신호와 일반적인 선반가공의 가공신호를 분류하기 위해 본 논문에서는 새로운 방식의 감지 방법을 제시하였다. 제시한 분류 방법에 대해 여러 차례에 걸친 검증을 통해 공구파손 감지를 위한 모터 전류신호의 감지 신뢰성을 평가하였다.
본 논문에서는 2.3-2.7GHz의 WiMAX용 TDD 중계기의 송수신 안테나 제어를 위해서 상향링크 구간과 하향링크 구간에 대한 구분 신호를 생성하는 모듈을 설계 및 구현하였다. RF 처리부와 Baseband 처리부로 나뉘어 설계하였으며, 본 회로의 기능은 WiMAX 신호와 시간 동기를 맞추고, 상향링크 구간과 하향링크 구간에 대한 구분 신호를 생성하는 것이므로, RF 처리부에는 수신경로만 구현되어 있다. 또한 RF 처리부의 대부분을 하나의 칩으로 제작하여 설계 면적을 최소화 하였으며, WiMAX 신호의 Preamble과 DL-MAP 정보를 검출하기 위해서 WiMAX Modem을 사용하여 Baseband 처리부를 설계하였다. 본 설계는 국내외의 2.3-2.7GHz WiMAX 신호에 대해 모두 처리가 가능하다.
본 논문에서는 MIMO-OFDM 시스템에서 월쉬 부호화된 훈련신호를 이용하는 새로운 채널 추정 방식을 제안하였다. 월쉬 부호화된 훈련신호는 시간 영역에서 서로 직교하도록 설계된다. 이러한 직교성을 이용하여 월쉬 디코딩을 수행하면 시간 영역에서 원하는 훈련 신호를 분리할 수 있고 채널 추정이 가능하다. 컴퓨터 시뮬레이션 결과 제안된 방법은 계산량 감소에도 불구하고 최적 훈련 신호를 사용하는Li의 원래 방법[4]과 비교했을 때 거의 동일한 mean square error (MSE) 성능을 보였다.
Recently, many large organizations have multiple data sources (MDS') distributed over different branches of an interstate company. Local patterns analysis has become an effective strategy for MDS mining in national and international organizations. It consists of mining different datasets in order to obtain frequent patterns, which are forwarded to a centralized place for global pattern analysis. Various synthesizing models [2,3,4,5,6,7,8,26] have been proposed to build global patterns from the forwarded patterns. It is desired that the synthesized rules from such forwarded patterns must closely match with the mono-mining results (i.e., the results that would be obtained if all of the databases are put together and mining has been done). When the pattern is present in the site, but fails to satisfy the minimum support threshold value, it is not allowed to take part in the pattern synthesizing process. Therefore, this process can lose some interesting patterns, which can help the decider to make the right decision. In such situations we propose the application of a probabilistic model in the synthesizing process. An adequate choice for a probabilistic model can improve the quality of patterns that have been discovered. In this paper, we perform a comprehensive study on various probabilistic models that can be applied in the synthesizing process and we choose and improve one of them that works to ameliorate the synthesizing results. Finally, some experiments are presented in public database in order to improve the efficiency of our proposed synthesizing method.
Upon introducing satellite communication system to Korea, one of the important problems to cope with is the effect from the probable intentional interference I.e. jamming. In this paper we have investigated how much the performance of ordinary PSK signal and Directed Sequence Spread Spectrum PSK signal degrade by the effect of jamming in the satellite communication system. In analysis we have consider the M ary PSK signal and the liniter type nonlinear satellite transponder in an environment of uplink tone or noise jamming plus Gaussian noise and downlink Gaussian noise. Using the derived error rate equation we have evaluated the error performance of BPSK and QPSK systems and compared this with that of DS BPSK system. Form the results, we know that the nonlinear satellite system is degraded more severely by the effect of noise jamming than tone jamming and the effect of tone jamming on the error rate performance can be reduced more remarkably by increasing the process gain in DS BPSK system rather than increasing carrier to jamming noise power ratio in conventional BPSK system.
본 논문에서는 광디스크 메모리의 재생성능에 주요한 영향을 미치는 jitter를 향상시키는 방법이 검토되었다. 광디스크 제조공정에 있어서 타공정의 변수를 고정한 상태에서 단일의 조작을 통해 jitter value를 저감화시키기 위해 펄스 폭 조정기를 제작하였다. 펄스 폭 조정기폭 적용하여 입력신호의 level을 조정한 결과 6.9%의 최소 jitter value를 확보하였다.
본 논문에서는 DFT를 활용한 순차적 스펙트럼 센싱 알고리즘을 제안한다. 기존의 FFT를 이용한 센싱 알고리즘의 경우 FFT의 특성상 한번에 모든 주파수 성분을 구하여 임계값과 비교하는 구조로 불필요한 계산량을 포함하고 있다. 제안하는 센싱 알고리즘에서는 DFT를 활용하여 우선순위에 따라서 주파수 성분을 순차적으로 구하고 이를 임계값과 비교하여 신호의 존재 여부를 판단한다. 제안하는 센싱 알고리즘은 기존의 FFT를 이용한 센싱 알고리즘과 유사한 검출 성능을 제공하면서 신호의 조기 검출 여부에 따라 스펙트럼 센싱에 필요한 계산량을 현저하게 줄일 수 있다.
Journal of information and communication convergence engineering
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제17권4호
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pp.285-289
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2019
A 1.9-GHz linear CMOS power amplifier is presented. An adaptive bias circuit (ABC) that utilizes an AC ground to detect the power level of the input signal is proposed to enhance the linearity and efficiency of the power amplifier. The ABC utilizes the second harmonic component as the input to mitigate the distortion of the fundamental signal. The input power level of the ABC was detected at the AC ground located at the VDD node of the power amplifier. The output of the ABC was fed into the inputs of the power stage. The input signal distortion was mitigated by detecting the input power level at the AC ground. The power amplifier was designed using a 180 nm RFCMOS process to evaluate the feasibility of the application of the proposed ABC in the power amplifier. The measured output power and power-added efficiency were improved by 1.7 dB and 2.9%, respectively.
Journal of information and communication convergence engineering
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제3권1호
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pp.28-32
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2005
In this paper, we propose a novel test method to effectively detect hard and soft faults in CMOS 2-stage op-amps. The proposed method uses a very high frequency sinusoidal signal that exceeds unit gain bandwidth to maximize the fault effects. Since the proposed test method doesn't require any complex algorithms to generate the test pattern and uses only a single test pattern to detect all target faults, therefore test costs can be much reduced. The area overhead is also very small because the CUT is converted to a unit gain amplifier. Using HSPICE simulation, the results indicated a high degree of fault coverage for hard and soft faults in CMOS 2-stage op-amps. To verify this proposed method, we fabricated a CMOS op-amp that contained various short and open faults through the Hyundai 0.65-um 2-poly 2-metal CMOS process. Experimental results for the fabricated chip have shown that the proposed test method can effectively detect hard and soft faults in CMOS op-amps.
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[게시일 2004년 10월 1일]
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