최근에는 교육수준의 향상, 소득증대, 대중매체의 발달 등으로 인하여 성인 교정환자의 수요가 상당히 증가하고 있다. 성인환자는 어린환자에 비해 상대적으로 구강내 도재수복물을 장착하고 있는 경우가 많아 도재치에 대한 교정용 브라켓의 직접접착의 기회도 증가하고 있다. 자연치에서는 법랑질을 산부식하여 비교적 쉽게 접착력을 증진시킬 수 있으나 도재치에서는 임상에서 브라켓이 너무 쉽게 탈락하거나 오히려 도재파절의 위험성이 존재하여 도재치에 대한 효과적인 직접접착법에 대하여 관심을 갖게 되었다. 그러나, 이러한 접착효율에 대한 다양한 연구가 있었으나 아직 정설로 받아들여지는 것은 없는 실정이다. 본 연구는 임상에서 비교적 간단히 이용할 수 있는 몇 가지 방법을 in vitro 상의 실험을 통하여 그 결과를 비교검토하여 효과적인 방법을 제시하고자 시행되었다. 우선 장석형 도재인 Ceramco II로 도재 시편을 제작하였다. 도재의 표면처리방법은 Glazing한 도재 자체를 사용하기 위해서는 무처리하였으며, 거칠기를 부여하기위해서는 불화수소산으로 산부식하거나 Microetcher II로 Sandblasting, 또는 불화수소산과 Sandblasting을 복합처리하였다. 접착레진은 화학중합형 인 Ortho-two와 광중합형인 Transbond를 사용하였다 모든 시편에는 도재 프라이머를 도포하였다. 실험군은 7가지 군으로 나누어 브라켓의 전단강도를 측정하였다. 1. 도재의 표면처리에 대한 비교에서 Ortho-two군내에서는 불화수소산이나 sandblasting으로 표면거칠기를 부여한 군이 무처리군에 비해 높은 전단강도를 갖는다. Transbond군내에서는 각각의 표면처리에 따른 유의성있는 차이가 없었다. 2. 불화수소산이나 Sandblasting처리군에서는 화학중합형 레진인 Ortho-two가 광중합형 레진인 Transbond보다 높은 전단강도를 갖는다. 3. 도재 파절율의 비교에서는 무처리군이 표면거칠기를 부여한 군에 비해 매우 낮은 파절율 갖는다. 4. E(Transbond+Intact)군의 평균전단강도는 134.4kg/$cm^2$ 로 본 실험군중 가장 낮은 것으로 나타났다. 이것은 선학들이 제안한 임상적용가능 전단강도보다 크므로 7가지군 모두 임상적으로 교정력을 가하기 에 충분한 전단강도를 갖는다. 그러나, 도재의 파절율을 고려해볼 때 파절율이 상대적으로 낮은 무처리군이 임상적으로 더 효과적일 것으로 사료된다.
High-k dielectric materials such as $HfO_2$, $ZrO_2$ and $Al_2O_3$ increase gate capacitance and reduce gate leakage current in MOSFET structures. This behavior suggests that high-k materials will be promise candidates to substitute as a tunnel barrier. Furthermore, stack structure of low-k and high-k tunnel barrier named variable oxide thickness (VARIOT) is more efficient.[1] In this study, we fabricated the $WSi_2$ nanocrystals nonvolatile memory device with $SiO_2/HfO_2/Al_2O_3$ tunnel layer. The $WSi_2$ nano-floating gate capacitors were fabricated on p-type Si (100) wafers. After wafer cleaning, the phosphorus in-situ doped poly-Si layer with a thickness of 100 nm was deposited on isolated active region to confine source and drain. Then, on the gate region defined by using reactive ion etching, the barrier engineered multi-stack tunnel layers of $SiO_2/HfO_2/Al_2O_3$ (2 nm/1 nm/3 nm) were deposited the gate region on Si substrate by using atomic layer deposition. To fabricate $WSi_2$ nanocrystals, the ultrathin $WSi_2$ film with a thickness of 3-4 nm was deposited on the multi-stack tunnel layer by using direct current magnetron sputtering system [2]. Subsequently, the first post annealing process was carried out at $900^{\circ}C$ for 1 min by using rapid thermal annealing system in nitrogen gas ambient. The 15-nm-thick $SiO_2$ control layer was deposited by using ultra-high vacuum magnetron sputtering. For $SiO_2$ layer density, the second post annealing process was carried out at $900^{\circ}C$ for 30 seconds by using rapid thermal annealing system in nitrogen gas ambient. The aluminum gate electrodes of 200-nm thickness were formed by thermal evaporation. The electrical properties of devices were measured by using a HP 4156A precision semiconductor parameter analyzer with HP 41501A pulse generator, an Agillent 81104A 80MHz pulse/pattern generator and an Agillent E5250A low leakage switch mainframe. We will discuss the electrical properties for application next generation non-volatile memory device.
단결정규소 웨이퍼를 15% HF-에탄올 용액에서 양극 산화시켜 다공질규소를 얻는 과정에서 전류밀도와 에칭시간에 따라 굴절률이 주기적으로 변하는 다층의 다공질규소층(porous silicon multilayers)을 구현하였다. 그리고 다층의 다공질규소층(I), 다공질규소 발광층, 또 다른 다층의 다공질규소층(II)의 순으로 구성된 porous silicon microcavity(PSM)를 제작하고 그 물성을 조사하였다. PSM 상하에 위치한 다층의 다공질규소층의 단면을 AFM(Atomic Force Microscope)으로 조사한 결과 고굴 절률과 저굴절률이 주기적으로 교차하는 층이 균일하게 형성되었으며, 중앙의 다공질규소 발광층도 균일하게 나타났다. 다층의 다공질규소층 및 다공질규소 발광층의 두께를 각각 실효파장의 1/4배 및 2배가 되도록 하였을 때 특정파장의 필터로 쓰일 수 있는 브래그 반사경(Bragg reflector)의 특성이 나타났다. 또한 PSM의 발광 스펙트럼은 그 반치폭이 현저히 감소하고 발광의 세기가 크게 증가되는 경향을 보였다.
최근 고해상도 디스플레이가 주목받으면서 기존 비정질 실리콘(a-Si)을 대체할 수 있는 재료에 관한 연구가 활발히 진행되고 있다. a-Si의 경우 간단한 공정 과정, 적은 생산비용, 대면적화가 가능하다는 장점이 있지만 전자 이동도가 매우 낮은 단점이 있다. 반면, 산화물 반도체는 비정질 상태에서 전자 이동도가 높으며 큰 밴드갭을 가지고 있어 투명한 특성을 나타낼 뿐만 아니라, 저온공정이 가능하여 기판의 제한이 없는 장점을 가지고 있다. 대표적으로 가장 널리 연구되고 있는 산화물 반도체는 a-IGZO(amorphous indium-gallium-zinc oxide)이다. 그러나 InZnO(IZO) 기반의 산화물 반도체에서 carrier suppressor 역할을 하는 Ga(gallium)은 수요에 대한 공급이 원활하지 못하여 비싸다는 단점이 있다. 그러므로 경제적이면서 a-IGZO와 유사한 전기적 특성을 나타낼 수 있는 suppressor 물질이 필요하다. 따라서 본 연구에서는 IZO 기반의 산화물 반도체에서 Ga을 Hf(hafnium), Zr(zirconium), Si(silicon)으로 대체하여 용액증착(solution-deposition) 공정으로 각각의 채널층을 형성한 back-gate type의 박막 트랜지스터(thin-film transistor, TFT) 소자를 제작하였다. 용액증착 공정은 물질의 비율을 자유롭게 조절할 수 있고, 대기압의 조건에서도 공정이 가능하기 때문에 짧은 공정시간과 저비용의 장점이 있다. 제작된 소자는 p-type Si 위에 게이트 절연막으로 100 nm의 열산화막이 성장된 기판을 사용하였다. 표준 RCA 클리닝 후에 각 solution 물질을 spin coating 방식으로 증착하였다. 이후, photolithography, develop, wet etching의 과정을 거쳐 채널층 패턴을 형성하였다. 또한, 산화물 반도체의 전기적 특성을 향상시키기 위해서 후속 열처리 과정(post deposition annealing, PDA)은 필수적이다. CTA 방식은 높은 열처리 온도와 긴 열처리 시간의 단점이 있다. 따라서, 본 연구에서는 $100^{\circ}C$ 이하의 낮은 온도와 짧은 열처리 시간의 장점을 가지는 MWI (microwave irradiation)를 후속 열처리로 진행하였다. 그 결과, 각 물질로 구현된 소자들은 기존 a-IGZO와 비교하여 적은 양의 carrier suppressor로도 우수한 전기적 특성 및 안정성을 얻을 수 있었다. 따라서, Si, Hf, Zr 기반의 산화물 반도체는 기존의 Ga을 대체하여 저비용으로 디스플레이를 구현할 수 있는 IZO 기반 재료로 기대된다.
PURPOSE. The aim of this study was to evaluate the microshear bond strength (µSBS) of four computer-aided design/computer-aided manufacturing (CAD/CAM) blocks repaired with composite resin using three different surface treatment protocols. MATERIALS AND METHODS. Four different CAD/CAM blocks were used in this study: (1) flexible hybrid ceramic (FHC), (2) resin nanoceramic (RNC), (c) polymer infiltrated ceramic network (PICN) and (4) feldspar ceramic (FC). All groups were further divided into four subgroups according to surface treatment: control, hydrofluoric acid etching (HF), air-borne particle abrasion with aluminum oxide (AlO), and tribochemical silica coating (TSC). After surface treatments, silane was applied to half of the specimens. Then, a silane-containing universal adhesive was applied, and specimens were repaired with a composite, Next, µSBS test was performed. Additional specimens were examined with a contact profilometer and scanning electron microscopy. The data were analyzed with ANOVA and Tukey tests. RESULTS. The findings revealed that silane application yielded higher µSBS values (P<.05). All surface treatments were showed a significant increase in µSBS values compared to the control (P<.05). For FHC and RNC, the most influential treatments were AlO and TSC (P<.05). CONCLUSION. Surface treatment is mandatory when the silane is not preferred, but the best bond strength values were obtained with the combination of surface treatment and silane application. HF provides improved bond strength when the ceramic content of material increases, whereas AlO and TSC gives improved bond strength when the composite content of material increases.
Objectives: This study evaluated the effects of different surface conditioning methods on the bond strength of orthodontic brackets to glazed full-zirconia surfaces. Materials and Methods: Glazed zirconia (except for the control, Zirkonzahn Prettau) disc surfaces were pre-treated: PO (control), polishing; BR, bur roughening; PP, cleaning with a prophy cup and pumice; HF, hydrofluoric acid etching; AA, air abrasion with aluminum oxide; CJ, CoJet-Sand. The surfaces were examined using profilometry, scanning electron microscopy, and electron dispersive spectroscopy. A zirconia primer (Z-Prime Plus, Z) or a silane primer (Monobond-S, S) was then applied to the surfaces, yielding 7 groups (PO-Z, BR-Z, PP-S, HF-S, AA-S, AA-Z, and CJ-S). Metal bracket-bonded specimens were stored in water for 24 hr at $37^{\circ}C$, and thermocycled for 1,000 cycles. Their bond strengths were measured using the wire loop method (n = 10). Results: Except for BR, the surface pre-treatments failed to expose the zirconia substructure. A significant difference in bond strengths was found between AA-Z ($4.60{\pm}1.08MPa$) and all other groups ($13.38{\pm}2.57-15.78{\pm}2.39MPa$, p < 0.05). For AA-Z, most of the adhesive remained on the bracket. Conclusions: For bracket bonding to glazed zirconia, a simple application of silane to the cleaned surface is recommended. A zirconia primer should be used only when the zirconia substructure is definitely exposed.
We give a textured front on silicon wafer for high-efficiency solar cells by using micro contact printing method which uses PDMS (polydimethylsiloxane) silicon rubber as a stamp and SAM (self assembled monolayer)s as an ink. A random pyramidal texturing have been widely used for a front-surface texturing in low cost manufacturing line although the cell with random pyramids on front surface shows relatively low efficiency than the cell with inverted pyramids patterned by normal optical lithography. In the past two decades, the micro contact printing has been intensively studied in nano technology field for high resolution patterns on silicon wafer. However, this promising printing technique has surprisingly never applied so far to silicon based solar cell industry despite their simplicity of process and attractive aspects in terms of cost competitiveness. We employ a MHA (16-mercaptohexadecanoic acid) as an ink for Au deposited $SiO_2/Si$ substrate. The $SiO_2$ pattern which is same as the pattern printed by SAM ink on Au surface and later acts as a hard resist for anisotropic silicon etching was made by HF solution, and then inverted pyramidal pattern is formed after anisotropic wet etching. We compare three textured surface with different morphology (random texture, random pyramids and inverted pyramids) and then different geometry of inverted pyramid arrays in terms of reflectivity.
We have synthesized carbon nanotubes by thermal chemical vapor deposition of $C_2H_2$ on transition metal-coated silicon substrates. Carbon nanotubes are uniformly synthesized on a large area of the plain Si substrates, different from Previously reported porous Si substrates. It is observed that surface modification of transition metals deposited on substrates by either etching with dipping in a HF solution and/or $NH_3$ pretreatment is a crucial step for the nanotube growth prior to the reaction of $C_2H_2$ gas. We will demonstrate that the diameters of carbon naotubes can be controlled by applying the different transition metals.
본 연구에서는 RF magnetron sputtering을 이용하여 실리콘 박막 태양전지용 ZnO:Al 전면전극을 제작하고 다양한 식각조건에 따른 ZnO:Al 박막의 표면형상 변화와 함께 전기적 및 광학적 특성 변화를 조사하였다. pin 구조를 갖는 실리콘 박막 태양전지의 효율 향상을 위해서는 입사광의 산란효과에 따른 광포획 증가가 필수적이며 이를 위하여 ZnO:Al 전면전극의 표면텍스처링 형성이 필요하다. 식각용액으로는 HCl과 HF 등을 사용하였으며 식각용액 농도 및 식각시간을 변화시켰다. 식각 후의 ZnO:Al 박막의 표면형상은 SEM(Scanning Electron Microscope)과 AFM(Atomic Force Microscope)을 이용하여 분석을 하였고, UV-visible-nIR spectrometer를 이용하여 총 투과도 및 산란 투과도를 측정하였다. 이 외에도 four-point probe 및 Hall measurement를 이용하여 전기적 특성 변화를 조사하였다. 다양한 식각조건에 따라 제조된 ZnO:Al 박막 위에 실리콘 박막 태양전지를 제작하여 전면전극의 표면형상에 따른 태양전지 성능변화를 비교 분석하였다.
In this paper, a novel ultraviolet sensor is presented based on a photoluminescent porous silicon. Porous silicon layer was formed by chemical etching of surface of pn junction in a $HF(48%)-HNO_3(60%)-H_20$ solution. Incident ultraviolet(UV) light is converted to visible light by photoluminescent porous silicon layer, and then this visible light generates electron-hole pairs in the pn junction, which produces a photocurrent flow through the device. In order to maximize detection efficiency, the peak sensitivity wavelength of the pn junction diode was matched with the peak wavelength of Photoluminescence from porous silicon layer. The porous silicon ultraviolet sensor showed a large output current as UV intensity increases and but very low sensitivity to visible light. The detection sensitivity of porous silicon sensor was calculated as 2.91mA/mW. These results are expected to open up a possibility that the present porous silicon sensor can be used for detecting UV light in a visible background, compared to silicon UV detectors which have an undesirable response to visible light.
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[게시일 2004년 10월 1일]
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