When the shell-type roller gate is partly open, at a certain height the large vibration is caused due to resonance and the vibration can cause damage to the gate. In this study, the review on amplitude of vibration and the possible resonance occurring at the time of opening or closing of gate is performed. Throughout the natural frequency analysis, the installation location of the measuring instrument was selected. On opening or closing of gate, the measurement of gate vibration is performed. The natural frequencies according to the opening range of the gate is analyzed. As a result of measurement and analysis, we proposed ranges in which vibration occurs largely and resonance is predicted as an avoiding open ranges, or the safe opening or closing of the shell-type roller gate. The application of this paper's avoiding open range estimation method of shell-type roller gate can be utilized as the basic data for the systematic and rational maintenance management of dams and submerged weirs in the future, and it is expected that this study can bring forth.
KSII Transactions on Internet and Information Systems (TIIS)
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제17권11호
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pp.3145-3162
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2023
As an important technology of the internetwork, wireless sensor network technique plays an important role in indoor localization. Non-line-of-sight (NLOS) problem has a large effect on indoor location accuracy. A location algorithm based on improved particle filter and directional probabilistic data association (IPF-DPDA) for WSN is proposed to solve NLOS issue in this paper. Firstly, the improved particle filter is proposed to reduce error of measuring distance. Then the hypothesis test is used to detect whether measurements are in LOS situations or NLOS situations for N different groups. When there are measurements in the validation gate, the corresponding association probabilities are applied to weight retained position estimate to gain final location estimation. We have improved the traditional data association and added directional information on the original basis. If the validation gate has no measured value, we make use of the Kalman prediction value to renew. Finally, simulation and experimental results show that compared with existing methods, the IPF-DPDA performance better.
On the basis of a structural analysis of radial gate (i.e. Tainter gate), the current paper focuses on weight minimization according to the location of the arms on a radial gate. In spite of its economical significance, there are hardly any previous studies on the optimum design of radial gate. Accordingly, the present study identifies the optimum position of the support point for a radial gate that guarantees the minimum weight satisfying the strength constraint conditions. This study also identifies the optimum position for 2 or 3 radial arms with a convex cylindrical skin plate relative to a given radius of the skin plate curvature, pivot point, water depth, ice pressure, etc. These optimum designs are then compared with previously constructed radial gates. Local genetic and hybrid-type genetic algorithms are used as the optimum tools to reduce the computing time and enhance the accuracy. The results indicate that the weights of the optimized radial gates are appreciably lower than those of previously constructed gates.
홍수조절지는 하천 제내지 측에 제방을 축조하고 제방 일부 구간에 횡월류위어를 설치해 일정규모 이상의 홍수사상 발생 시 홍수량 일부를 월류시켜 저류하는 홍수저감시설이다. 다양한 하천시설물이 존재하는 하천 내에서 홍수조절지의 운영 최적화를 위해서는 기존 시설과의 연계 운영을 함께 검토해야 할 필요가 있다. 본 연구에서는 하도 내 수문 시설의 영향을 고려해 홍수조절지 횡월류위어의 위치 변화에 따른 수로 내 수위 저감 및 유량 분담 효과를 분석하였다. 수문 시설의 영향을 고려하기 위해 수로 내 2문의 방사형 수문을 설치하였으며, 수문으로부터 상류 방향으로 횡월류위어의 위치를 이동시키며 수로 내 수위 변화와 횡월류위어의 월류량을 측정하였다. 실험 결과 횡월류위어의 위치가 수문에 가까울수록 수위 저감 효과가 크게 나타났으며, 유량 분담 효과는 큰 변화가 없는 것으로 확인되었다. 2개소 이상의 횡월류위어 운영 시에는 충분한 저류공간이 확보되어 횡월류위어의 위치에 따른 수위 저감 효과의 변화가 크지 않은 것으로 확인되었다. 또한, 수문 운영 시 1개소 횡월류위어의 위치 변화에 따른 수위 저감율을 경험식으로 산정해 향후 홍수조절지 계획 시 활용 가능한 기초자료를 제공하고자 한다.
In recent years, attempts have been made to greatly improve the display quality of active-matrix liquid crystal display devices, and many techniques have been proposed to solve such problems as gate signal delay, feed-through voltage and image sticking[1-3]. To improve these problems which are caused by the feed-through voltage, we have evaluated new driving methods to reduce the feed-through voltage. Two level gate-pulse was used for the gate driving of the cst-on-common structure pixels. These gate driving methods offer better feed-through characteristics than conventional simple gate pulse. Optimized step signal will compensate by step pulse time and voltage. The evaluation of the suggested driving methods were performed by using a TFT-LCD array simulator PDAST which can simulate the gate, data and pixel voltages of a certain pixel at any time and at any location on a TFT array. The effect of the new driving method was effectively analyzed.
For a die casting mold, generally, the casting layout design should be considered based on the relation among injection system, casting condition, gate system, and cooling system. Also, the extent or the location of product defects was differentiated according to the various relations of the above conditions. In this research, in order to optimize the casting layout design of an automotive Oil Pan_DX2E, Computer Aided Engineering (CAE) simulation was performed with two layout designs by using the simulation software (AnyCasting). The simulation results were analyzed and compared carefully in order to apply them into the production die-casting mold. During the filling process with two models, internal porosities caused by air entrapments were predicted and also compared with the modification of the gate system and overflow. With the solidification analysis, internal porosities occurring during the solidification process were predicted and also compared with the modified gate system.
We present an alternative process whereby deuterium is delivered to the location where the gate oxide reside by an implantation process. Deuterium ions were implanted using different energies to account for the topography of the overlaying layers and placing the D peak at the top of gate oxide. A short anneal at forming gas was performed to remove the D-implantation damage. We have observed that deuterium ion implantation into the gate oxide region can successfully remove the interface states and the bulk defects.
한국소성가공학회 2003년도 The Korea-Japan Plastics Processing Joint Seminar
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pp.33-39
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2003
Injection molding is widely used in producing various plastic parts due to its high productivity and the demand for high precision injection molded products is ever increasing. To achieve successful product quality and precision, the design of gating and runner systems in the injection mold is very important since it directly influences melt flow into the cavity. Some defects such as weld lines and overpacking can be effectively controlled with proper selection of gate locations. In the present study, the design of gate locations in injection molding of a dashboard for automobiles was carried out with CAMPmold, a PC-based simulation system for injection molding. A dummy runner was developed to simulate a runner system in order to increase the efficiency of the analysis. The numbers and locations of gates were varied in the present investigation as that an acceptable design was obtained in terms of reduced maximum pressure and clamping force.
This study shows an optimization procedure for an automatic determination on the gate position to ensure the fill-uniformity within a part cavity by using the injection molding simulation. For an optimization, the maximum pressure-difference within a part cavity induced at the stage of filling is used to evaluate degree of fill-uniformity. In addition, a direct search scheme based on the reduction of design space is developed and applied in the optimization problem. This corresponding proposed methodology was applied in the optimization on the gate location for a CD-tray molding, as a result, showed the improvement of the fill-uniformity within the cavity.
An active-matrix LCD using thin film transistors (TFT) has been widely recognized as having potential for high-quality color flat-panel displays. Pixel-Design Array Simulation Tool (PDAST) was used to profoundly understand the gate si후미 distortion and pixel charging capability. which are the most critical limiting factors for high-quality TFT-LCDs. Since PDAST can simulate the gate, data and pixel voltages of a certain pixel on TFT array at any time and at any location on an array, the effect of the resistivity of gate line material on the pixel operations can be effectively analyzed. The gate signal delay, pixel charging ratio and level-shift of the pixel voltage were simulated with varying the parameters. The information obtained from this study could be utilized to design the larger area and finer image quality panel.
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[게시일 2004년 10월 1일]
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