본 연구에서는 평활화 유한요소법(Smoothed finite element method)을 도입한 위상분야법(Phase-field method)에 대해 소개하고자 한다. 위상분야법은 최근 균열 개시 및 전파 해석에 많이 사용되는 기법으로 균열 표면을 추적하기 위한 추가적인 처리기법이 필요하지 않는 특징이 있다. 위상분야법에서 복잡한 균열 전파를 포착하기 위해 높은 정확도의 변형률 에너지를 평활화 유한요소법을 도입하여 계산하였다. 평활화 유한요소법은 유한요소를 하위 셀로 나누고 각각의 하위 셀을 평활화 영역으로 재조립하여 변형률 에너지를 계산하게 된다. 또한 해석 시간 단축을 위하여 쿼드트리 요소망을 제안한 기법에 사용하였다. 수치 예제를 통하여 제안한 기법을 참조해 및 유한요소법과 비교하여 검증하였다.
본 논문은 암호화 장치 및 오류정정부호화 장치 등에서 핵심적으로 사용되고 있는 유한체승산기(finite-field multiplier)의 최적화된 구조를 제안한다. 제안된 구조는 LFSR(Linear Feedback Shift Register)구조를 갖는 유한체 승산기에서 소비전력과 회로면적을 최소화 하여 기존의 LFSR 구조를 바탕으로 하는 유한체 승산기에 비하여 효율적인 승산을 이루도록 한다. 기존의 LFSR 구조의 유한체 승산기는 m비트의 다항식을 승산 하는데 3${\cdot}$m개의 플립플롭(flip-flop)이 필요하다. 1개의 플립플롭은 2개의 래치(latch)로 구성되기 때문에 6${\cdot}$m개의 래치가 소요된다. 본 논문에서는 4${\cdot}$m개의 래치(m 개의 플립플롭과 2${\cdot}$m개의 래치)로 m 비트의 다항식을 승산 할 수 있는 유한체 승산기를 제안하였다. 본 논문의 유한체 승산기는 기존의 LFSR 구조의 유한체 승산기에 비하여 회로구현에 필요한 래치의 개수가 1/3(약 33%)이 감소하였다. 결과적으로 기존의 방법에 비하여 저 소비전력 및 저 면적의 유한체 승산기를 암호화 장치 및 오류정정부호화 장치 등에서 효과적으로 사용이 가능하다.
Numerical modeling for electromagnetic exploration methods are essential to understand behaviours of electromagnetic fields in complex subsurfaces. In this study, a finite element method was adopted as a numerical scheme for the 2.5-dimensional forward problem. And a finite element equation considering linear conductivity variation was proposed when 2.5-dimensional differential equation to couple eletric and magnetic field was implemented. Model parameters were investigated for near-field with large source effects and far-field with responses dominantly by homogeneous half-space. Numerical responses by this study were compared with analytic solutions in homogeneous half-space and compared with other three dimensional numerical results.
Motivated by the problem of determining all right ideals of a group algebra FG for a finite group G over a finite field F, we explicitly determine the faithful irreducible representations of some finite metacylic groups over finite fields. By using that result, we determine the structure of all right ideals of the group algebra for the symmetric group $S_3$ over a finite field F, as an example.
In this paper, we exhibit the explicit forms of continued fraction expansions of a family of algebraic power series over a finite field and we study their asymptotic distribution of approximation exponents.
유한체 연산은 부호이론과 암호학에 널리 쓰이고 있으므로, 유한체 연산의 복잡도를 낮출 수 있는 연산기가 절실하게 필요하다. 그런데 연산기의 복잡도는 유한체의 원소를 표현하는 방법에 달려있다. 복잡도를 줄이기 위해서, 지금까지 알려진 원소를 표현하는 가장 좋은 방법이 최적정규기저를 사용하는 것이다. 본 논문에서는 최적정규기저로 표현된 원소의 곱셈시에 구축되는 곱셈행렬의 1의 개수를 최소화하는 알고리즘을 개발하여 시간과 공간을 최소화하는 곱셈기를 제안하고자 한다.
본 연구에서는 무한 유체에 놓여있는 유한 길이의 탄성 원통 쉘에 외부에서 비스듬히 평면파가 입사할 때 발생하는 음향 산란 현상을 이론적으로 연구했다. 유한 길이의 원통 쉘에서는 해석적인 산란 해가 존재하지 않기 때문에, Kirchhoff 가정을 적용한 Ye의 산란 기법[Z. Ye, J. Acoust. Soc. Am. 102, 877-884 (1997)]을 사용했다. 탄성 원통 쉘의 특성은 3차원 탄성파 이론을 적용하여 구현했으며 원통 쉘 내부의 유체를 고려했다. 유도된 해석 해를 이용하여 내부 유체가 산란 음장에 미치는 효과, Rayleigh 변수에 대한 산란 음장, 탄성 재질의 변화에 따른 먼 거리 산란 함수를 살펴보았다.
This paper deals with the analysis of the transient characteristics of a superconducting a.c. generator(SCG) using Finite Element Method. Since the magnetic field induced by the field current and the armature currents are not sinusoidally distributed in a generator, the conventional equivalent circuit method, in general, uses the fundamental component only and is done in frequency domain. But the finite element analysis makes it possible to analyze the transient magnetic field distribution and the electrical characteristics of the double shields of SCG in time domain.
Some limits are in two-dimensional analysis by finite element method to electromagnetic machine having finite dimension. Therefore three-dimensional analysis by finite element method, which are modeling original form of models are needed in order to gain accurate solutions. This paper present three-dimensional time varing magnetic field analysis method using electric field E and magnetic scarlar potential $\Omega$, and examine sample model.
The finite-field multiplication can be applied to the wide range of applications, such as signal processing on communication, cryptography, etc. However, an efficient algorithm and the hardware design are required since the finite-field multiplication takes much time to compute. In this paper, we propose a radix-4 systolic multiplier on $GF(2^m)$ with comparative area and performance. The algorithm of the proposed standard-basis multiplier is mathematically developed to map on low-cost systolic cell, so that the proposed systolic architecture is suitable for VLSI design. Compared to the bit-serial and digit-serial multipliers, the proposed multiplier shows relatively better performance with low cost. We design and synthesis $GF(2^{193})$ finite-field multiplier using Hynix $0.35{\mu}m$ standard cell library and the maximum clock frequency is 400MHz.
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[게시일 2004년 10월 1일]
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