• 제목/요약/키워드: Clock Offset

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4 병렬 동기 구조를 이용한 MB-OFDM UWB 수신기 설계 및 평가 (A MB-OFDM UWB Receive Design and Evaluation Using 4. Parallel Synchronization Architecture)

  • 신철호;최상성;이한호;백정기
    • 한국전자파학회논문지
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    • 제16권11호
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    • pp.1075-1085
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    • 2005
  • 본 논문은 IEEE802.15.3a Alt-PHY로 표준화중인 MB-OFDM WB(Multi-Band Orthogonal Frequency Division Multiplexing Ultra Wide Band) 시스템 수신기 설계 방안을 제시하고 링크 마진(link margin) 설계를 위해 4 병렬 구조에 의한 구현 손실을 정량적으로 분석하는 것이다. 먼저 MB-OFDM UWB 시스템의 전송 방식을 설명하고, 동기 구조를 완전한 디지털 방식으로 설계하기 위해 반송 주파수 옵셋(carrier frequency offset)과 샘플링 클락옵셋(sampling clock offset)이 MB-OFDM UWB 시스템에 미치는 영향을 분석하였다. 그리고 이러한 반송 주파수 옵셋과 샘플링 클락 옵셋을 추정하고 보상하기 위한 알고리즘과 VLSI 구현을 위하여 MB-OFDM UWB 시스템의 패킷 전송 구조를 이용한 4 병렬 동기 구조를 제시하였다. 본 논문에서 제시한 시스템 동기를 위한 수신 구조와 단순화된 4 병렬 구조에 의한 구현 손실 값은 UWB-OFDM 시스템 규격에서 제시한 최대 허용 가능한 반송 주파수 옵셋 및 샘플링 클락 옵셋에서 최대 3.08 dB로 시뮬레이션을 통해 분석되었다.

DETERMINATION OF GPS RECEIVER CLOCK ERRORS USING UNDIFFERENCE PHASE DATA

  • Yeh, Ta-Kang;Chung, Chen-Yu;Chang, Yu-Chung;Luo, Yu-Hsin
    • 대한원격탐사학회:학술대회논문집
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    • 대한원격탐사학회 2008년도 International Symposium on Remote Sensing
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    • pp.277-280
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    • 2008
  • Enhancing the positioning precision is the primary pursuit of GPS users. To achieve this goal, most studies have focused on the relationship between GPS receiver clock errors and GPS positioning precision. This study utilizes undifferentiated phase data to calculate GPS clock errors and to compare with the frequency of cesium clock directly, thus verifying estimated clock errors by the method used in this paper. The relative frequency offsets from this paper and from National Standard Time and Frequency Laboratory of Taiwan match to $1.5{\times}10^{12}$ in the frequency instability, suggesting that the proposed technique has reached a certain level of quality. The built-in quartz clocks in the GPS receivers yield relative frequency offsets that are 3 to 4 orders higher than those of rubidium clocks. The frequency instability of the quartz clocks is on average two orders worse than that of the rubidium clock. Using the rubidium clock instead of the quartz clock, the horizontal and vertical positioning accuracies were improved by 26-78% (0.6-3.6 mm) and 20-34% (1.3-3.0 mm), respectively, for a short baseline. These improvements are 7-25% (0.3-1.7 mm) and 11% (1.7 mm) for a long baseline. Our experiments show that the frequency instability of clock, rather than relative frequency offset, is the governing factor of positioning accuracy.

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UFIR 필터 Ladder 알고리즘 이용 GPS Holdover 성능 추정 (Estimation of GPS Holdover Performance with Ladder Algorithm Used for an UFIR Filter)

  • 이영규;양성훈;이창복;허문범
    • 제어로봇시스템학회논문지
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    • 제21권7호
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    • pp.669-676
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    • 2015
  • In this paper, we described the simulation results of the phase offset performance of a clock in holdover mode which was normally operated in GPS Disciplined Oscillator (GPSDO). In the TIE model, we included the time error term caused by environmental temperature variation because one of the most important parameters of clock phase error is the frequency offset and drift caused by the variation of temperature. For the simulation, we employed Maximum Time Interval Error (MTIE) for the performance evaluation when the frequency offset and drift are estimated by using an Unbiased Finite Impulse Response (UFIR) filter with ladder algorithm. We assumed that the noise in the GPS measurement is white Gaussian with zero mean and 1 ns standard deviation, and temperature linearly varies with a slope of $1{^{\circ}C}$ per hour. From the simulation results, the followings were observed. First, with the estimation error of temperature of less than 3 % and the temperature compensation period of less than 900 seconds, the requirement of CDMA2000 phase synchronization under 10 us could be achieved for more than 40,000 seconds holdover time if we employ an OCXO (Oven Controlled Crystal Oscillator) clock. Second, in order to achieve the requirement of LTE-TDD under 1.5 us for more than 10,000 seconds holdover time, below 3 % estimation error and 500 seconds should be retained if a Rubidium clock is adopted.

GPS 반송파위상 데이터를 이용한 시계오차 추출 (DETERMINATION OF CLOCK OFFSET USING GPS CARRIER PHASE MEASUREMENTS)

  • 하지현;박관동;이창복
    • Journal of Astronomy and Space Sciences
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    • 제22권4호
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    • pp.491-500
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    • 2005
  • 세계 각국은 국제적으로 통일된 시각동기 체계를 따르고 있으며 국가표준시 유지를 위하여 GPS(Global Positioning System)를 활용하고 있다. 현재 국내 GPS 기반 시각동기 연구는 코드데이터와 방송궤도력을 사용하고 있다. 이 연구에서는 보다 정확한 시계오차 추출을 위하여 반송파위상 데이터를 사용하였으며, 방송궤도력 뿐만 아니라 정밀궤도력, 신속궤도력, 그리고 초신속궤도력을 사용하였다. 정밀궤도력을 사용하여 산출된 시계오차를 참값으로 가정하였을 때, 신속궤도력과 초신속궤도력의 경우 약 0.5ns의 정밀도를 나타내었으며, 방송궤도력의 경우는 2ns 이하의 정밀도를 나타내었다.

LCOS 마이크로디스플레이 구동용 보정회로 설계 (Design of Calibration Circuit for LCOS Microdisplay)

  • 이연성;위정욱;한충우;송남철
    • 한국정보통신학회:학술대회논문집
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    • 한국정보통신학회 2022년도 추계학술대회
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    • pp.469-471
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    • 2022
  • 본 논문에서는 아날로그 구동 방식의 4K UHD LCOS 패널을 구동하기 위해 디지털 픽셀을 아날로그 픽셀로 변환하는 과정에서 발생되는 이득 오차, DC 옵셋, 샘플링 클럭의 위상 오차를 보정하기 위한 보정회로의 구현 방법을 기술한다. 제안된 보정회로는 이득 및 DC 옵셋 보정 회로와 샘플링 클럭 위상 조정 회로로 구성되며, FPGA와 비디오 앰프를 이용하여 구현하였다.

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UWB MAC의 Time Slot 동기를 통한 시스템 성능 개선 (System Performance Improvement of IEEE 802.15.3a By Using Time Slot Synchronization In MAC Layer)

  • 오대건;정정화
    • 대한전자공학회논문지TC
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    • 제43권3호
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    • pp.84-94
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    • 2006
  • 본 논문은 UWB (Ultra Wide Band) 시스템의 성능 개선을 위해서 Superframe 주기를 이용한 MAC(Medium Access Control) 계층 time slot 동기 알고리즘을 제안한다. Multi-band ORM Alliance (MBOA) 에서 제안한 UWB시스템에서는 Time Slot의 동기를 위해서 Medium Access Slot (MAS) 와 MAS사이의 guard time에 단말기들 간의 MAC 계층 주파수 오프셋으로 야기될 수 있는 시간 오차의 최대값인 MaxDrift를 더해주게 된다. MaxDrift를 더한 만큼 MAS에서 데이터를 전송할 수 있는 시간이 줄어들게 되므로 각각의 MAS에 MaxDrift를 더해주는 방식은 전체 시스템 성능의 저하를 가져오게 된다. 본 논문에서는 시스템의 성능을 높이고자 time slot동기를 guard time을 증가시키는 방식이 아닌, Superframe주기로 전송되는 연속된 Beacon Frame을 수신하여 주파수 오프셋 값을 estimation하여 보정해주는 방법을 제안한다. Piconet을 초기화시킨 Device는 내부 clock을 이용해서 Superframe주기로 Beacon을 전송을 하므로, Piconet에 접속하려는 단말기들은 연속된 Beacon을 수신하여 Piconet을 생성한 단말기의 MAC계층과 수신한 단말기와의 MAC계층 주파수 오프셋을 구할 수 있다. 각각의 수신 단말기에서 측정한 상대적 주파수 오프셋 값을 내부적으로 estimation한 각각의 MAS의 position에 가감시켜 Piconet을 생성한 단말기에서 estimation한 MAS position에 동기를 맞출 수 있다. 제안된 알고리즘을 통해서 단말기들 간의 최대 주파수 오프셋 값과 관계없이 MaxDrift로 인해서 낭비되는 시간을 각 MAS당 1clock 이내로 줄일 수 있다. 제안된 알고리즘을 하드웨어로 합성한 결과 390개의 Logic Cell이 소모되었으며, 시뮬레이션 결과 최대주파수 오프셋이 20ppm, 40ppm, 80ppm일 때 MAS당 오차범위가 main clock의 1clock이내였으며 기존의 방법에 비해서 각각 1%, 2%, 4%의 throughput이 향상되었다.

Method of Clock Noise Generation Corresponding to Clock Specification

  • Lee, Young Kyu;Yang, Sung Hoon;Lee, Chang Bok;Kim, Sanhae;Song, Kyu-Ha;Lee, Wonjin;Ko, Jae Heon
    • Journal of Positioning, Navigation, and Timing
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    • 제5권3호
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    • pp.157-163
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    • 2016
  • Clocks for time synchronization using radio signals such as global navigation satellite system (GNSS) may lose reference signals by intentional or unintentional jamming. This is called as holdover. When holdover occurs, a clock goes into free run in which synchronization performance is degraded considerably. In order to maintain the required precise time synchronization during holdover, accurate estimation on main parameters such as frequency offset and frequency drift is needed. It is necessary to implement an optimum filter through various simulation tests by creating clock noise in accordance with given specifications in order to estimate the main parameters accurately. In this paper, a method that creates clock noise in accordance with given specifications is described.

개선된 자동 주파수 보정회로를 이용한 광대역 클록 발생기 설계 (A Wideband Clock Generator Design using Improved Automatic Frequency Calibration Circuit)

  • 정상훈;유남희;조성익
    • 전기학회논문지
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    • 제60권2호
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    • pp.451-454
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    • 2011
  • In this paper, a wideband clock generator using novel Automatic frequency calibration(AFC) scheme is proposed. Wideband clock generator using AFC has the advantage of small VCO gain and wide frequency band. The conventional AFC compares whether the feedback frequency is faster or slower then the reference frequency. However, the proposed AFC can detect frequency difference between reference frequency with feedback frequency. So it can be reduced an operation time than conventional methods AFC. Conventional AFC goes to the initial code if the frequency step changed. This AFC, on the other hand, can a prior state code so it can approach a fast operation. In simulation results, the proposed clock generator is designed for DisplayPort using the CMOS ring-VCO. The VCO tuning range is 350MHz, and a VCO frequency is 270MHz. The lock time of clock generator is less then 3us at input reference frequency, 67.5MHz. The phase noise is -109dBC/Hz at 1MHz offset from the center frequency. and power consumption is 10.1mW at 1.8V supply and layout area is $0.384mm^2$.

수중 음향 네트워크를 위한 시간 동기화 기술 동향 분석에 대한 연구 (A Survey of Time Synchronization Techniques in Underwater Acoustic Networks)

  • 조아라;윤창호;임용곤
    • 한국통신학회논문지
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    • 제39C권3호
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    • pp.264-274
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    • 2014
  • 수중음향 네트워크를 이용한 다양한 수중 어플리케이션에서 노드들은 서로 통신을 통하여 협업 또는 자율 독립적으로 동작하기 때문에 노드들 간 시간 동기화 문제는 중요한 이슈가 되고 있다. 또한, 수중 음향네트워크에서는 육상 네트워크에서와 달리 GPS 사용불가, 긴 전파지연, 해류에 의한 노드의 이동, 제한적 전력소비, 낮은 전송속도 등의 고유의 제약 사항이 있어 수중 노드들의 시간 동기화를 위해서는 이러한 제약 들이 반드시 고려된다. 본 논문에서는 수중음향 네트워크를 위해 보다 효율적인 시간 동기화 프로토콜 개발을 위해, 현재까지 개발되었던 수중 동기화 프로토콜의 특징을 비교 분석하여 현재 (state-of-the-art) 수중 음향 네트워크 동기화 연구 동향의 흐름을 정리한다.

고속 UWB에서 주파수 편이 보상을 사용한 거리추정 성능향상 (Ranging Enhancement using Frequency Offset Compensation in High Rate UWB)

  • 남윤석;장익현
    • 정보처리학회논문지C
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    • 제16C권2호
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    • pp.229-236
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    • 2009
  • WPAN에서는 해상도가 높은 UWB 신호를 사용하여 노드 간의 거리를 추정하고 이로부터 이동노드의 위치를 추정한다. 비동기 거리추정 방식은 고정노드와 이동노드 간에 비동기 상태에서 노드간의 거리를 추정하는 바 각 노드 국부클럭의 주파수 차이에 의한 영향이 심각하다. 고속 UWB에서는 각 노드 국부클럭의 주파수 차이에 의한 영향을 감소시키기 위하여 비동기 TWR 방식을 연속으로 수행하고, 상대주파수 편이 보상방안을 제시하고 있다. 본 논문에서는 고속 UWB의 상대주파수 편이 보상 수식을 완성하고, 이를 적용하는데 대한 문제점을 분석하고, 정확한 주파수편이 보상 방안을 제안한다. 거리추정 방식은 원래의 TWR, 상대주파수 편이 보상 및 정확한 주파수 편이 보상 방식에 의한 TWR에 대하여 시뮬레이션으로 성능을 분석하였다. 상대주파수편이 방식과 정확한 주파수편이 방식은 잡음이 없는 상태에서는 유사한 성능을 나타내었다. 제안된 정확한 주파수 편이 방식은 SNR이 열악한 환경에서 상대주파수 편이 보상 방식보다 정확한 거리를 추정하는 것을 확인하였다.