기존에 사용되었던 알루미늄 배선 공정은 공정의 배선 크기가 줄어들면서 한계에 다다르고 있다. 따라서 이를 대체하기 위해 여러 가지 새로운 방법들이 고안되고 있으며, 그중 알루미늄을 비저항이 낮고 EM(electro-migration) 저항성이 뛰어난 구리로 대체하려는 연구가 진행되고 있다. 구리 배선은 이미 electroplating 공정을 이용해 산업에 적용되고 있으며, seed layer로는 sputtering 법을 이용하고 있다. 하지만 sputtering 을 포함한 PVD 법은 대부분 종횡비나 단차 피복도가 좋지 않기 때문에 이를 CVD로 교체한다면 많은 장점을 가질 수 있다. 하지만 CVD 공정을 진행하기 위해서는 많은 문제점들이 있는데, 이중 전구체에 대한 문제도 빼놓을 수 없는 이슈이다. Cu(dmamb)2 는 기존에 사용하던 $\beta$-diketonate 계열의 전구체보다 화학적으로 많은 장점을 가지고 있어, CVD 공정에 적합하다. 이에 따라 구리 박막 증착의 공정 조건을 설계하고, 고품질의 박막을 증착하기 위한 다양한 처리법을 고안하여 증착 실험을 진행하였다. 기본적으로 구리는 확산력이 좋아 실리콘계열의 기판에서 확산력이 매우 좋아 기판 내로 확산되기 때문에 이를 방지하기 위하여 Ta, Ti 계열의 박막을 사용하여 확산을 방지하고 있다. 따라서 전이 금속 박막의 표면과 증착 분위기 등을 고려하여 구리를 증착하였으며, 표면의 미세구조 및 성분을 FESEM 등을 통해 분석하였다.
실리콘 태양전지의 pn 접합 계면특성을 조사하기 위해서 p형 실리콘 기판 위에 전기로를 이용한 $POCl_3$ 공정을 통하여 n형의 불순물을 주입하여 pn접합을 만들었다. n형 불순물의 확산되어 들어가는 공정시간이 길고 공정온도가 높을수록 면저항은 줄어들었다. n형 불순물의 주입이 많아질수록 pn 접합 계면에서의 전자친화도가 줄어들면서 면저항은 감소되었다고 할 수 있다. n형 반도체의 페르미레벨이 높아지면서 공핍층도 생기지만 n형 불순물이 많아지면서 공핍층의 폭은 점점 좁아지고 쇼키 장벽의 높이도 낮아지면서 자유전자와 홀 쌍의 이동이 쉽게 이루어지게 되었다. n형의 불순물 확산공정시간이 긴 태양전지 셀에서 F.F. 계수가 높게 나타났으며, 효율도 높게 나타났다.
압력수 확산공정은 정수공정에서 응집제나 염소용해수를 고압의 압력수로 분사하여 혼합하는 공정이다. 본 연구의 목적은 압력수 확산공정에 대한 전산유체역학적(Computational Fluid Dynamics) 진단을 통해 투입한 약품의 완전 혼합거리 및 혼합 거리를 줄이기 위한 확산판의 크기와 설치거리를 도출하는 것이다. 진단결과 2,200 mm 대형관에 $5kg/cm^2$ 압력수를 50mm, 100 mm 분사관으로 분사할 경우 혼합이 완료되는 혼합거리는 4D였다. 혼합거리를 줄이기 위해 분사관 전방에 확산판을 설치할 경우 분사관이 50 mm일 때 0.1D 직경의 확산판을 분사관 전방 0.2D 거리에 설치하면 혼합거리를 3D로 줄일 수있다. 그러나 분사관이 100 mm인 경우는 확산판의 크기와 설치 거리와는 상관없이 확산판이 없는 4D보다 확산거리를 줄일 수 없는 것으로 진단되었다. 따라서 2,200 mm 관에 압력수를 분사하는 경우는 50 mm 분사관을 설치하는 것이 100 mm보다 훨씬 효율적인 것으로 나타났다.
고전압 전력반도체의 수요는 산업의 전반에 걸쳐 증가하고 있는 추세이며, 특히 자율주행이나 전기자동차와 같은 교통 수단에 이용되는 경우 전동차의 동력 추진 제어 장치에 3.3 kV 이상의 IGBT 모듈 부품이 사용되고 있으며, 전동차의 신설과 유지 관리에 따른 부품의 조달이 매년 증가하고 있다. 게다가 기술 진입 장벽이 매우 높은 기술로서 해당 산업계에서는 고전압 IGBT부품의 최적화 연구가 절실히 요구되고 있다. 3.3 kV 이상 고전압 IGBT 소자 개발을 위해 웨이퍼의 비저항 범위 설정과 주요 단위 공정의 최적 조건이 중요한 변수이며, 높은 항복 전압을 위한 핵심 기술로 junction depth의 확보가 무엇보다 중요하다. 최적의 junction depth를 확보하기 위한 제조 공정 중에서 단위 공정 중 한 단계인 확산 공정의 최적화를 살펴보았다. 확산 공정에서는 주입되는 가스의 종류와 시간 그리고 온도가 주요 변수이다. 본 연구에서는 단위 공정의 시뮬레이션을 통하여 고전압 IGBT 소자 개발을 위한 웨이퍼 저항의 (Ω cm) 범위를 설정하고, 확산 공정의 온도에 따른 확산 공정의 WDR(Well drive in) 조건 최적화에 대하여 연구한 결과 링 패턴의 width 23.5 ~ 25.87 ㎛에 대하여 junction depth는 7.4 ~ 7.5 ㎛를 얻어 3.3 kV 고전압 전력반도체 지지에 최적화할 수 있었다.
본 논문에서는 반도체 공정 시뮬레이션을 위해 산화, 확산 및 이온 주입 공정을 모델링하고, 효율적인 실행과 상호 연관된 연속 공정의 시뮬레이션이 가능하도록 통합화된 환경을 구축하였다. 점성적 스트레스 모델을 이용한 산화 공정은 유속-압력 알고리즘과 경계요소법을 이용하여 안정된 해를 얻었으며, 선확산과 산화증배 현상이 포함된 확산 공정은 전진해법과 유한요소법을 이용하였다 또한 이온 주입 공정은 TRIM을 기본으로 다양한 공정 조건에 대한 모델이 추가된 몬테카를로 방법을 사용하였다. 편리한 사용자 입력 인터페이스와 그래픽적 출력을 제공하고, 윈도즈의 API함수를 이용하여 PC상에서 적은 메모리로도 빠른 결과를 얻을 수 있도록 하였으며, 객체 지향적인 모듈화로 타 시뮬레이터와의 호환성이 가능하도록 구성하였다.
새로운 불순물(dopant) 원료인 스핀온 쏘스를 사용하여 붕소를 실리콘천에 이단계 확산시키는 공정을 검토하였다. predeposition후의 확산충의 두께의 drive-in 확산후의 두께에 비하여 무시할 수 없이 큰 경우에 대하여 이단계 확산공정이 끝난 후의 확산층의 두께를 예측할 수 있는 간단한 방법을 제안하였다. 제안된 방법에 의하여 불순물 확산충의 두께를 예측하였으며 그 결과를 실험적으로 측정된 값과 비교하였다.
반도체 소자가 초고집적화 되어감에 따라 반도체 공정에서 선폭은 줄어들고 박막은 다층화 되어가고 있다. 이와 같은 제조 공정 하에서는 Si 기판과 금속 박막간의 확산이 커다란 문제로 부각되어 왔다. 특히 Cu는 높은 확산성에 의하여 Si 기판과 접합에서 많은 확산에 의한 문제가 발생하게 되며, 또한 선폭이 줄어듦에 따라 고열이 발생하여 실리콘으로 spiking이 발생하게 된다. 이러한 확산을 방지하기 위하여 이 논문에서는 Tungsten - Carbon - Nitrogen (W-C-N)에 Boron (B)을 첨가하였고, Boron 타겟 power을 조절하여 다양한 조성을 가지는 W-B-C-N 확산방지막을 제작하여 각 조성에 따른 증착률을 조서하였고 $1000^{\circ}C$까지 열처리하여 그 비저항을 측정하여 각 특성을 확인하였다.
본 연구는 boron-doped 실리콘 기판에 heavy 인온인 비소를 먼저 이온 주입시키고 비소의 주입에 의해 실리콘 표면이 손상된 영역에 다시 인을 이온 주입시켰을때, 인의 확산을 관찰하기 위해 microtec 시뮬레이터를 통해 모의공정실험을 실행하였다. 손상된 비정질의 실리콘 기판에서 열처리 전과 inet(N/sub 2/) 분위기에서 인은 느리게 확산을 하였다. 그렇지만 dry와 wt oxidation 열처리 분위기에서는 의의 확산 속도가 증가됨 (OED:oxidation-enhanced idfusion)을 관찰되었다. 실리콘 기판에서 인의 확산을 관찰하기 위해 ICECREM 시뮬레이터를 사용하여 앞의 경우와 동일하게 먼저 비소를 주입하여 실리콘 표면에 손상을 입히고 그 다음 공정에서 인을 주입하였을 때, 열처리 전과 inet, dry 산화분위기에서는 비정질의 실리콘 기판에 이온 주입한 경우와 동일하게 의의 확산 속도가 증가하였지만, wet 산화분위기에서는 오히려 dry 산화분위기에서 보다 확산이 늦어짐이 관찰되었다.
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[게시일 2004년 10월 1일]
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