Chemical mechanical polishing (CMP) 공정은 deep 서브마이크론 집적회로의 다층배선구조률 실현하기 위해 inter-metal dielectric (IMD), inter-layer dielectric layers (ILD), pre-metal dielectric (PMD) 층과 같은 절연막 외에도 W, Al, Cu와 같은 금속층을 평탄화 하는데 효과적으로 사용되고 있으며, 다양한 소자 제작 및 새로운 물질 등에도 광범위하게 응용되고 있다. 하지만 Cu damascene 구조 제작으로 인한 CMP 응용 과정에서, 기계적으로 깨지기 쉬운 65 nm의 소자 이하의 구조에서 새로운 저유전상수인 low-k 물질의 도입으로 인해 낮은 하력의 기계적 연마가 필요하게 되었다. 본 논문에서는 전기화학적 기계적 연마 적용을 위해, I-V 특성 곡선을 이용하여 active, passive, transient, trans-passive 영역의 전기화학적 특성을 알아보았으며, Cu 막의 표면 형상을 알아보기 위해 scanning electron microscopy (SEM) 측정과 energy dispersive spectroscopy (EDS) 분석을 통해 금속 화학적 조성을 조사하였다.
CMP(Chemical Mechanical Polishing)는 VLSI의 제조공정에서 실리콘웨이퍼의 절연막내에 있는 토포그래피를 제어할 수 있는 광역 평탄화 기술이다. 또한 최근에는 실리콘웨이퍼의 나노토포그래피(Nanotopography)가 STI의 CMP 공정에서 연마 후 필름의 막 두께 변화에 많은 영향을 미치게 됨으로 중요한 요인으로 대두되고 있다. STI CMP에 사용되는 CeO$_2$ 슬러리에서 첨가되는 계면활성제의 농도에 따라서 나노토포그래피에 미치는 영향을 제어하는 것이 필수적 과제로 등장하고 있다. 본 연구에서는 STI CMP 공정에서 사용되는 CeO$_2$ 슬러리에서 계면활성제의 농도에 따른 나노토포그래피의 의존성에 대해서 연구하였다. 실험은 8 "단면연마 실리콘웨이퍼로 PETEOS 7000$\AA$이 증착 된 것을 사용하였으며, 연마 시간에 따른 나노토포그래피 의존성을 알아보기 위해 연마 깊이는 3000$\AA$으로 일정하게 맞췄다. 그리고 CMP 공정은 Strasbaugh 6EC를 사용하였으며, 패드는 IC1000/SUBA4(Rodel)이다. 그리고 연마시 적용된 압력은 4psi(Pounds per Square Inch), 헤드와 정반(table)의 회전속도는 각각 70rpm이다 슬러리는 A, B 모두 CeO$_2$ 슬러리로 입자크기가 다른 것을 사용하였고, 농도를 달리한 계면활성제가 첨가되었다. CMP 전 후 웨이퍼의 막 두께 측정은 Nanospec 180(Nanometrics)과 spectroscopic ellipsometer (MOSS-ES4G, SOPRA)가 사용되었다.
In CMP for semiconductor wafer films, the acceptable within-chip planarity, within-wafer and wafer-to-wafer nonuniformity could be achieved by conditioning. The role of conditioning is to remove continuously polishing residues from pad and to maintain the initial pad surface pores. To reach these requirements, the diamond grits disk has been considered as a conventional conditioner. However, we have investigated many defects as scratch on wafers out of diamond grits shedding, contaminations from bonding materials, and pad pore subsidences by over-conditioning. So, this paper studies the effect of ultrasonic vibration in CMP conditioning as a representative. The effect of ultrasonic vibration was certified through ILD, Metal CMP.
반도체소자의 제조 공정 기술 중 구리패턴을 얻기 위해서 사용하는 화학 기계적 연마(CMP)를 이용한 평탄화와 연마 공정에서 Wafer에 도포된 구리의 두께를 실시간으로 측정하여 정밀하게 제어할필요가 있는데, 이때 획득되는 센서값을 실제 두께 값으로 환산하는 계산과정에서 오차가 발생할 수 있다. 실제 측정 값에 근사한 값을 얻도록 단순평균을 이용한 방법, 이동 평균, 필터 들을 사용하여 결과를 비교하여 옹고스트롬 단위의 두께를 실시간으로 측정하는 제어 시스템의 편차를 줄이도록 하는 방법의 구현에 대해 기술한다.
최근 범세계적인 그린에너지 정책에 관련해 화석연료를 대체할 수 있는 수소, 풍력, 태양광 등의 대체 에너지에 대한 관심이 고조되고 있다. 이러한 여러 대체에너지 중에서도 태양광을 전기에너지로 변환하는 태양전지에 관한 연구가 집중되고 있다. 태양전지는 구조적으로 단순하고 제조 공정도 비교적 간단하지만, 보다 널리 보급되기 위해서는 경제성 향상이라는 문제점을 해결해야 한다. 이를 위해서는 기존의 실리콘 태양전지를 대체할 수 있는 신물질에 대한 연구가 필요하며, 그 중에서도 반도체 기술을 이용한 박막형 태양전지는 기존의 실리콘 태양 전지가 가지고 있는 고비용이라는 문제점을 극복할 수 있을 것으로 기대를 모으고 있다. 박막형 태양전지의 박막 재료로는 CIGS, CdTe 등이 연구되어지고 있지만, 아직까지는 기존의 실리콘 태양전지에 비해 에너지변환효율이 낮은 이유로 인해 실용화가 많이 이루어지지 못하고 있는 것이 사실이다. 이러한 박막형 태양전지의 재료들 중에서도 CdTe는 이종접합 박막형 태양전지에 흡광층으로 사용되는 것으로 상온에서 1.45eV 정도의 밴드갭(band gap) 에너지를 갖는 II-VI족 화합물반도체로써 태양광 스펙트럼과 잘 맞는 이상적인 밴드랩 에너지와 높은 광흡수도 때문에 박막형 태양전지로 가장 주목을 받고 있다. CdTe 박막의 제조 방법으로는 진공증착법(vacuum evaporation), 전착법(electrodeposition), 스퍼터링법(sputtering) 등이 있지만 본 연구에서는 스퍼터링법을 이용하여 박막을 증착하였다. 이상과 같이 증착된 CdTe 박막을 화학적기계적연마(CMP, chemical mechanical polishing) 공정을 적용시킴으로써, 태양전지의 에너지변환효율에 직접적인 영향을 끼칠 수 있는 CdTe 박막의 물리적, 전기적 특성들의 변화를 연구하기 위한 선행 연구를 진행하였다. 특히 본 연구에서는 CdTe 박막의 화학적 기계적 연마 특성을 분석하여 정규화를 통한 모델링을 수행하였다. 또한 화학적기계적연마 공정 전과 후의 표면 특성을 관찰하기 위해 SEM(scanning electron microscopy)과 AFM(atomic forced microscope)를 이용하였으며, 구조적 특성 관찰을 XRD(X-ray diffraction)를 사용하여 실험을 수행하였다.
Chemical Mechanical Polishing(CMP) is popularly used in production of semiconductor because of large area polishing ability probability of improvement for more integrated circuit. However, present CMP processing causes some non-uniformity errors which can be critical for highly integrated circuit. Previous studies predict that flow-field of slurry during CMP can create non-uniformity, but no quantitative measurement has conducted. In this study, using PIV, slurry velocity flow-field during CMP is measured by changing the ratio of RPM of pad and carrier with tuned PIV system adequate for small room in CMP machine and Cabot's non-groove pad Epad-A100. The result show that velocity of slurry is majorly determined by pad-rpm and the ratio of between carrier and pad rpm make some changes in streamlines.
As device sizes are scaled down to submicron dimensions, planarization technology becomes increasingly important for both device fabrication and formation of multilevel interconnects. Chemical mechanical polishing (CMP) has emerged recently as a new processing technique for achieving a high degree of planarization for submicron VLSI applications. The polishing process has many variables, and most of which are not well understood. The factors determine the planarization performance are slurry and pad type, insert material, conditioning technique, and choice of polishing tool. Circuit density, pattern size, and wiring layout also affect the performance of a CMP planarization process. This paper presents the results of studies on CMP process window characterization for 0.35 micron process with 5 metal layers.
Chemical Mechanical Polishing (CMP) refers to a material removal process done by rubbing a work piece against a polishing pad under load in the presence of chemically active and abrasive containing slurry. CMP process is a combination of chemical dissolution and mechanical action. The mechanical action of CMP involves hydrodynamic behavior. The liquid slurry is trapped between the work piece and pad forming a hydrodynamic film. For the first step to understand material removal mechanism of the CMP process, the hydrodynamic analysis is done with semiconductor wafer. Three-dimensional Reynolds equation is applied to get pressure distribution of the slurry film. Shear stress distributions on the wafer surface are also analyzed
In chemical mechanical polishing(CMP) there are many factors affecting the results. Temperature is one of the factors and it affects the removal rate. That is, the higher it arise, the more the material is removed. But the detailed temperature behavior is not discovered. In this study, we discover the distribution of temperature across the pad where the wafer has just been polished. And then we reveal the cause of the result in connection with the mechanical structure. In addition, we also discover the relationship of the friction force and normal force. With the result of two forces, we get the friction coefficient and obtain the contact model of the wafer and pad.
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[게시일 2004년 10월 1일]
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