• The Proceeding of the Korean Institute of Electromagnetic Engineering and Science
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• v.10 no.1
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• pp.16-32
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• 1999

• Journal of Korean Tunnelling and Underground Space Association
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• v.20 no.1
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• pp.225-234
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• 2018

Domestic urban areas are experiencing serious traffic congestion problems due to continuous population growth and increased traffic volume. In order to solve the problem of traffic congestion, the study of great depth underground double deck tunnels using underground space is being actively carried out in the urban areas. The characteristics of great depth underground double deck tunnels are low in cross section, so the spread of fire smoke is expected to spread faster than the road tunnel in case of fire. Therefore, it is necessary to provide a fire smoke delay device which delays the spread of fire smoke when a fire occurs in a tunnels. In the previous study, the diffusion effect was analyzed according to the blocking area when the fire smoke spread delay device was operated through the 3D CFD in the study of preventing the smoke spread in the case of the tunnel fire. A study on fire smoke diffusion delay device using spring elasticity which is excellent in applicability to a tunnel and economical value is studied. In this study, fire smoke spread delay system was developed to fire smoke delay was experimentally analyzed. Fire smoke delay effect of fire smoke delay device appeared. Therefore, it is considered that the can minimize the damage of the victims when installed in the great depth underground double deck tunnels.

• The Journal of Korean Institute of Communications and Information Sciences
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• v.26 no.5A
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• pp.801-808
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• 2001

본 논문에서는 전파의 도달시간을 이용한 이동통신 측위 시스템에서 사용되는 직접해, 최소 자승, 테일러 시리즈 그리고 찬 알고리즘의 성능을 분석하고, 각 알고리즘을 사용하여 계산된 결과를 궤환시켜 이동국의 위치를 재계산함으로써 보다 향상된 측위를 할 수 있는 결정 궤환 방법을 제안한다. 제안된 방법은 규칙 7셀 좌표와 불규칙 셀 좌표를 이용하여 이동국을 위치시킨 후, 전파의 지연시간에 따른 측위오차와 표준편차 그리고 각 알고리즘별 발산횟수를 조사하였으며, 실험결과 결정 궤환 방법을 사용하였을 경우 기존의 방법보다 향상된 성능을 보였다.

• Electronics and Telecommunications Trends
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• v.15 no.5 s.65
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• pp.86-93
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• 2000

지하 탐사용 레이더를 이용하여 지하에 매설된 구조물의 위치를 파악하고 그에 따른 근사 이미지의 추출 방법을 제안하였다. 기본원리는 구조물에 의해 산란되어 수신 안테나로 유입되는 펄스신호의 지연시간과 크기를 측정하는 데 있으며, 측정의 실용성을 위하여 레이더 탐색경로에 따른 수신신호의 절대치 적분 방법을 사용하였다. 일반적으로 지하매질은 침투 주파수에 따라서 다양한 분산 및 손실 특성을 나타내는데, 이러한 매질 특성은 다항 Debye 모델을 이용하여 기술되었다. 3차원 전파(電波) 전파(傳播)를 위한 시뮬레이션에는 FDTD(Finite Difference Time Domain) 방법을 사용하였다.

• Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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• 2011.05a
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• pp.344-347
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• 2011

Unlike a terrestrial wireless sensor network which uses radio waves, UWASN(Underwater Acoustic Sensor Network) relies on acoustic waves. There are lots of ongoing researches for long latency and limited bandwidth of underwater sensor network by using acoustic wave. Packets transferred by node often colide in underwater sensor network due to long latency. To solve this kind of problem, in general, Back-off scheme which is used in wireless network is used. However, fixed Slot-time according to node allocation generates useless time delay, and this lowers network performance. In this thesis, active setting technique of Slot-time is proposed, and applied for already studied MAC protocol. At the conclusion, it was proved that the MAC protocol using the proposed scheme has better performance than existing MAC protocol as a result comparison.

• The Journal of Korean Institute of Communications and Information Sciences
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• v.32 no.8A
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• pp.813-819
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• 2007

In this paper, the effect of a propagation delay resulting from the use of an OFDM-based cellular system with a transparent mobile multi-hop relay(MMR) is initially analyzed. Then, channel estimation techniques, a least square(LS) method and a minimum mean square error(MMSE) method, for the OFDM systems with throughput enhancement(TE) MMR or cooperative MMR are proposed. The proposed channel estimation techniques can overcome the performance degradation caused by the propagation delay in TE MMR or cooperative MMR systems. It is demonstrated by computer simulation that the proposed channel estimation techniques for OFDM systems with transparent MMR are superior to the conventional techniques in terms of mean square error(MSE) and bit error rate(BER).

• 전자공학회논문지 IE
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• v.48 no.2
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• pp.6-11
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• 2011

This paper describes the design of new method of propagation delay measurement in micro and nanostructures during characterization of ASIC standard library cell. Providing more accuracy timing information about library cell (NOR, AND, XOR, etc.) to the design team we can improve a quality of timing analysis inside of ASIC design flow process. Also, this information could be very useful for semiconductor foundry team to make correction in technology process. By comparison of the propagation delay in the CMOS element and result of analog SPICE simulation, we can make assumptions about accuracy and quality of the transistor's parameters. Physical implementation of phase error accumulation method(PHEAM) can be easy integrated at the same chip as close as possible to the device under test(DUT). It was implemented as digital IP core for semiconductor manufacturing process($0.11{\mu}m$, GL130SB). Specialized method helps to observe the propagation time delay in one element of the standard-cell library with up-to picoseconds accuracy and less. Thus, the special useful solutions for VLSI schematic-to-parameters extraction (STPE), basic cell layout verification, design simulation and verification are announced.

• Proceedings of the IEEK Conference
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• 1998.06a
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• pp.843-846
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• 1998

산술연산을 수행하는 가산기는 ALU(arithmetic logic unit)의 성능을 좌우하는데 매우 중요한 역할을 하며, 어떠한 캐리 생성 방식을 사용하는냐에 따라 그 성능이 결정될 수 있다. RCA(Ripple carry adder)는 간단하고, 쉬운 설게로 널리 사용되자만, 캐리의 전파지연 문제로 인해 고속의 가산기 응용에의 부적합하다. 또한, CLA(carry lookahead adder)방식의 가산기는 캐리의 지연시간이 가산기의 단수와 무관하므로, 연산속도를 높일 수 있는 장점이 있지만 더하고자 하는 bit의 수가 클수록 회로가 매우 복잡해지는 큰 단점을 가지고 있다. 따라서, 본 논문에서는 간단하면서도 성능이 우수한 64bit 가산기를 설계하고 시뮬레이션을 통하여 설계된 회로의 우수성을 증명하였다.

• Proceedings of the Korean Information Science Society Conference
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• 2004.10a
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• pp.691-693
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• 2004

0.18$\mu\textrm{m}$ 표준 셀 라이브러리로 구현할 때 2.69㎱의 임계 경로 지연을 가지는 SIMD구조의 포화 덧셈기를 설계하였다. 기존의 설계에서 임계 경로를 구성하는 CLA를, 8비트까지만 자리올림(Carry)이 전파될 때 정확한 계산을 보장하는 근사 덧셈기의 형태로 설계한 결과, 임계 경로 시간 지연을 약 22% 감소시킬 수 있었다. 파이프라인 구조 프로세서에서 사용될 포화 덧셈기의 근사계산이 실패하는 경우에는, 추가적인 2개의 클록주기 동안 재 계산을 수행하게 된다.

• Proceedings of the Korea Multimedia Society Conference
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• 2002.05c
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• pp.44-48
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• 2002

본 논문에서는 한국형 디지털 서명 표준인 KCDSA에서 사용할 목적으로 개발된 국내 해쉬 함수 표준인 HAS-160 알고리즘을 VLSI 설계하였다. 하나의 단계연산을 하나의 클럭에 동작하고 단계연산의 핵심이 되는 4개의 직렬 2/sup 3/ 모듈러 가산기를 CSA(Carry Save Adder)로 구현하여 캐리 전파시간을 최소로 하고 HAS-160 해쉬 알고리즘의 특징인 메시지 추가생성을 사전에 계산하여 지연시간을 줄이는 설계를 하였다. 설계된 해쉬 프로세서를 0.25 urn CMOS 스탠다드 셀 라이브러리에서 합성한 결과 총 게이트 수는 약 21,000개이고 최대 지연 시간은 5.71 ns로 최대 동작주파수 약 175 MHz서 약 1,093 Mbps의 성능을 얻을 수 있었다.