• 제목/요약/키워드: 전력 제어 시스템

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실시간 CFD 모델링을 위한 오픈소스 분산 컴퓨팅 기술 연구 (A Research about Open Source Distributed Computing System for Realtime CFD Modeling (SU2 with OpenCL and MPI))

  • 이준엽;오종우;이동훈
    • 한국농업기계학회:학술대회논문집
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    • 한국농업기계학회 2017년도 춘계공동학술대회
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    • pp.171-171
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    • 2017
  • 전산유체역학(CFD: Computational Fluid Dynamics)를 이용한 스마트팜 환경 내부의 정밀 제어 연구가 진행 중이다. 시계열 데이터의 난해한 동적 해석을 극복하기위해, 비선형 모델링 기법의 일종인 인공신경망을 이용하는 방안을 고려하였다. 선행 연구를 통하여 환경 데이터의 비선형 모델링을 위한 Tensorflow활용 방법이 하드웨어 가속 기능을 바탕으로 월등한 성능을 보임을 확인하였다. 그럼에도 오프라인 일괄(Offline batch)처리 방식의 한계가 있는 인공신경망 모델링 기법과 현장 보급이 불가능한 고성능 하드웨어 연산 장치에 대한 대안 마련이 필요하다고 판단되었다. CFD 해석을 위한 Solver로 SU2(http://su2.stanford.edu)를 이용하였다. 운영 체제 및 컴파일러는 1) Mac OS X Sierra 10.12.2 Apple LLVM version 8.0.0 (clang-800.0.38), 2) Windows 10 x64: Intel C++ Compiler version 16.0, update 2, 3) Linux (Ubuntu 16.04 x64): g++ 5.4.0, 4) Clustered Linux (Ubuntu 16.04 x32): MPICC 3.3.a2를 선정하였다. 4번째 개발환경인 병렬 시스템의 경우 하드웨어 가속는 OpenCL(https://www.khronos.org/opencl/) 엔진을 이용하고 저전력 ARM 프로세서의 일종인 옥타코어 Samsung Exynos5422 칩을 장착한 ODROID-XU4(Hardkernel, AnYang, Korea) SBC(Single Board Computer)를 32식 병렬 구성하였다. 분산 컴퓨팅을 위한 환경은 Gbit 로컬 네트워크 기반 NFS(Network File System)과 MPICH(http://www.mpich.org/)로 구성하였다. 공간 분해능을 계측 주기보다 작게 분할할 경우 발생하는 미지의 바운더리 정보를 정의하기 위하여 3차원 Kriging Spatial Interpolation Method를 실험적으로 적용하였다. 한편 병렬 시스템 구성이 불가능한 1,2,3번 환경의 경우 내부적으로 이미 존재하는 멀티코어를 활용하고자 OpenMP(http://www.openmp.org/) 라이브러리를 활용하였다. 64비트 병렬 8코어로 동작하는 1,2,3번 운영환경의 경우 32비트 병렬 128코어로 동작하는 환경에 비하여 근소하게 2배 내외로 연산 속도가 빨랐다. 실시간 CFD 수행을 위한 분산 컴퓨팅 기술이 프로세서의 속도 및 운영체제의 정보 분배 능력에 따라 결정된다고 판단할 수 있었다. 이를 검증하기 위하여 4번 개발환경에서 운영체제를 64비트로 개선하여 5번째 환경을 구성하여 검증하였다. 상반되는 결과로 64비트 72코어로 동작하는 분산 컴퓨팅 환경에서 단일 프로세서 기반 멀티 코어(1,2,3번) 환경보다 보다 2.5배 내외 연산속도 향상이 있었다. ARM 프로세서용 64비트 운영체제의 완성도가 낮은 시점에서 추후 성공적인 실시간 CFD 모델링을 위한 지속적인 검토가 필요하다.

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DS/CDMA 시스템의 역방향 링크에서 얼랑용량 계산에 따른 사용자 수와 셀 커버리지 (Capacity and Coverage according to Calculations of the Erlang Capacity in the Reverse Link of a DS/CDMA System)

  • 권영수;김항래;김남
    • 한국전자파학회논문지
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    • 제13권9호
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    • pp.947-955
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    • 2002
  • 불완전 전력제어된 역방향 링크에서 얼랑용량과 링크마진을 구하는 각각의 차단확률을 유도하고, 시스템 파라메터와 차단확률이 같은 조건에서 그 값을 구하여 도시, 교외, 개방지역에서 사용자 수와 셀 커버리지와의 관계를 분석할 때 파라메터로 적용하였다. 이때 얼랑용량은 현실적인 셀 용량으로 적용될 수 있고, 링크마진의 적용은 셀 커버리지 계산에서 신뢰성을 높일 수 있었다. 차단확률이 5 % 이내에서 E$_{b}$/N$_{o}$ 값을 7 dB에서 5 dB로 낮추는 경우에 링크마진을 2.8 dB로 똑같이 적용해도 셀 용량은 18 얼랑에서 31 얼랑으로 증가하였고, 이때 도시, 교외, 개방지역에서 셀 커버리지는 각각 0.4 km, 1 km, 2.5 km씩 증가하였다. 또한 E$_{b}$/N$_{o}$ 값이 5 dB에서 차단확률을 5 %에서 2 %로 낮출 경우 링크마진은 0.88 dB 더 증가시켜야 하며, 이때 용량이 31 얼랑에서 3얼랑 감소함에 따라 0.15 km, 0.5 km, 1.5 km 씩 줄어드는 범위 내에서 신뢰성을 높이고 양질의 서비스 제공이 가능하였다.

낮은 복잡도의 Deeply Embedded 중앙처리장치 및 시스템온칩 구현 (Low-Complexity Deeply Embedded CPU and SoC Implementation)

  • 박성정;박성경
    • 한국산학기술학회논문지
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    • 제17권3호
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    • pp.699-707
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    • 2016
  • 중앙처리장치를 중심으로 하는 각종 내장형 시스템은 현재 각종 산업에 매우 광범위하게 쓰이고 있다. 특히 사물인터넷 등의 deeply embedded (심층 내장형) 시스템은 저비용, 소면적, 저전력, 빠른 시장 출시, 높은 코드 밀도 등을 요구한다. 본 논문에서는 이러한 요구 조건을 만족시키는 중앙처리장치를 제안하고, 이를 중심으로 한 시스템온칩 플랫폼을 소개한다. 제안하는 중앙처리장치는 16 비트라는 짧은 명령어로만 이루어진 확장형 명령어 집합 구조를 갖고 있어 코드 밀도를 높일 수 있다. 그리고, 다중사이클 아키텍처, 카운터 기반 제어 장치, 가산기 공유 등을 통하여 로직 게이트가 차지하는 면적을 줄였다. 이 코어를 중심으로, 코프로세서, 명령어 캐시, 버스, 내부 메모리, 외장 메모리, 온칩디버거 및 주변 입출력 장치들로 이루어진 시스템온칩 플랫폼을 개발하였다. 개발된 시스템온칩 플랫폼은 변형된 하버드 구조를 갖고 있어, 메모리 접근 시 필요한 클락 사이클 수를 감소시킬 수 있었다. 코어를 포함한 시스템온칩 플랫폼은 상위 언어 수준과 어셈블리어 수준에서 모의실험 및 검증하였고, FPGA 프로토타이핑과 통합형 로직 분석 및 보드 수준 검증을 완료하였다. $0.18{\mu}m$ 디지털 CMOS 공정과 1.8V 공급 전압 하에서 ASIC 프론트-엔드 게이트 수준 로직 합성 결과, 50MHz 동작 주파수에서 중앙처리장치 코어의 논리 게이트 개수는 7700 수준이었다. 개발된 시스템온칩 플랫폼은 초소형 보드의 FPGA에 내장되어 사물인터넷 분야에 응용된다.

전파 음영지역 해소를 위한 항로표지관리용 하이브리드 통신 시스템에 관한 연구 (A study on the hybrid communication system to remove the communication shadow area for controller system of navigational aids)

  • 전중성
    • Journal of Advanced Marine Engineering and Technology
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    • 제37권4호
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    • pp.409-417
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    • 2013
  • 하이브리드 통신을 지원하는 하이브리드 통신 신호처리 제어보드는 저전력의 8-bit 마이크로콘트롤러인 ATxmega128A1으로 설계하였으며, 마이크로콘트롤러는 하이브리드 통신을 위한 모뎀과 GPS 모듈 등을 직렬 인터페이스하기 위해 8개의 UART 포트가 갖추어져 있으며, CLI(Command Line Interpreter) 프로그램은 각 포트의 인터페이스를 사용자 환경에 맞게 설정할 수 있으며, 내부에 2K 바이트의 프로그램 매개변수와 프로그램이 동작하는데 필요한 데이터를 저장할 수 있는 EEPROM과 128K 바이트의 플래시 메모리 및 프로그램이 실행되는 8K 바이트의 SRAM으로 구성되어 있다. 항로표지의 원격 관리를 VHF, CDMA, TRS 통신의 경로설정 최적화(Path Optimization) 기능을 갖는 하이브리드 통신을 이용하면 개별 통신 방식별로 음영지역이 존재하는 경우에도, 최적의 통신방식을 선택하여 통신을 수행하게 됨으로써, 통신 음영지역의 해소가 가능하다. 또한 통신장치마다 동일한 데이터 프레임을 사용함으로써 데이터의 호환성을 높였다. 실험은 30일 동안 각 부표에서 매 5분마다 데이터를 취득하였으며, 데이터 수신율은 99.4 % 이상을 보였다.

10MHz/77dB 다이내믹 영역을 가진 선형 가변 이득 증폭기 (10MHz/77dB dynamic range CMOS linear-in-dB variable gain amplifiers)

  • 차진엽;여환석;김도형;범진욱
    • 대한전자공학회논문지SD
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    • 제44권8호
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    • pp.16-21
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    • 2007
  • 본 논문은 구조물 모니터링을 위한 광섬유 센서 시스템의 수신단 응용을 위한 CMOS 기반의 가변 이득 증폭기 집적회로 설계에 초점을 두고 있다. 차동증폭기와 선형 linear-in-dB 제어기를 사용한 3단 가변 이득 증폭기를 제시하였다. 제안된 가변이득 증폭기는 전류의 비에 의해 증폭기의 이득이 linear-in-dB 하게 조절되는 일반적인 가변 이득 증폭기의 변형된 형태이다. 본 논문에서 제안된 가변 이득 증폭기는 1.5 dB의 간격으로 77 dB의 다이내믹 영역을 가졌다. 이득오차는 77 dB 다이내믹 영역에서 1.5 dB 이하를 얻었다. 동작범위는 10 MHz를 얻었으며, 단일 1.8 V 전압에서 13.8 mW의 전력소모 특성을 보였다. 이 가변 이득 증폭기는 Magnachip 사의 $0.18{\mu}m$ CMOS 공정을 사용하여 구현되었으며, 유효면적은 $430{\mu}m{\times}350{\mu}m$ 이었다. 제안된 가변 이득 증폭기는 구조물 모니터링을 위한 광섬유 센서 시스템의 수신단에 적용이 가능하였다 측정 결과에 따라 제안된 방법은 다이내믹 영역의 증대와 좋은 linear-in-dB 특성 관점에서 유효하였다.

2중 컨버터 구조를 갖는 계통 연계형 UPS의 DC 충전 알고리듬에 관한 연구 (A Study on DC Changing Algorithm of the Line-Interactive UPS with Dual Converter Structure)

  • 이우철;유동상
    • 조명전기설비학회논문지
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    • 제19권3호
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    • pp.27-34
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    • 2005
  • 본 논문에서는 2개의 컨버터 구조를 갖는 삼상 계통 연계형 UPS에 대하여 연구한다. 삼상UPS시스템은 2개의 능동 전력 보상기 구조로 이루어져 있다. 하나는 직렬형으로 .전원전압과 동상의 전압원으로 동작하여 전원전압의 변동, 왜곡시에도 정현파 전원전류와 고역률을 갖도록 동작한다. 병렬형은 전원전압과 위상을 맞춘 종전의 정현파 전압원으로 동작하여 부하에 안정되고 낮은 THD를 갖는 정현파 전압을 공급한다. 본 논문에서는 직렬형, 병렬형 능동보상기에서 전원전압의 크기에 따라 충전 방법에 대하여 제시한다. 종전의 계통 연계형 UPS는 DC 충전과 출력전압을 동시에 제어하였는데, 2개의 컨버터 구조를 갖는 UPS 시스템에서는 직렬형 보상기도 DC 충전을 할 수 있어 직렬형과 병렬형을 사용한 충전 알고리듬을 연구할 필요가 있다. 따라서 DC link단의 전압을 안정시켜 본래의 직렬형, 병렬형 구조의 보상기의 안정성 향상에 기여할 수가 있다. 제안된 방법의 타당성은 시뮬레이션과 실험 결과를 통하여 입증된다.

전자파표면유속계의 성능개선 및 실용화 (Improvement of Microwave Water Surface Current Meter and its Commercialization)

  • 김영성;이현석
    • 한국수자원학회:학술대회논문집
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    • 한국수자원학회 2011년도 학술발표회
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    • pp.85-85
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    • 2011
  • 홍수기에 안전하고 정확한 유량측정을 통하여 물관리에 필요한 기초수문자료를 확보하고자 한국수자원공사에서 1993년도부터 홍수유량측정기술 확보를 위한 연구를 시작하였다. 그간의 연구성과를 바탕으로 1999년도에 하천의 유속을 비접촉식으로 측정할 수 있는 홍수용 전자파표면유속계를 개발하여 특허등록하였고 그와 동시에 이의 상품화를 추진하여 2010년도까지 75대를 보급하여 실무에서 이용하고 있다. 이동식인 홍수용 전자파표면유속계를 바탕으로 2001년도에는 고정식 실시간 홍수유량측정측정시스템을 개발하여 특허등록하였고, 이 시제품을 현재 용담 수자원시험유역의 동향지점에서 시험운영하고 있다. 또한, 현장 유량측정실무자들의 홍수용 전자파표면유속계 개선요구에 따라 편각용 전자파표면유속계 시제품을 개발하였으며, 이는 임의의 한 지점에 설치한 한 대의 장비로 좌우 여러 측선의 유속을 동시에 측정할 수 있는 다점 측정기능을 갖도록 성능을 개선하였다. 이에 따라 홍수시 유량측정에 소요되는 시간이 줄어들어 신속하게 유량측정을 완료할 수 있는 계기를 마련하였다. 이와 더불어 유속측정 범위를 확장하여 홍수시의 고유속 뿐만 아니라 0.5 m/s 이하의 저유속까지 측정할 수 있는 범용 전자파표면유속계의 시제품을 추가로 개발하였다. 이 장비는 최저유속 0.03 m/s의 측정을 실내시험을 통하여 입증하였다. 범용 전자파표면유속계는 상품화 시제품의 개발을 목표로 기존 시제품의 현장시험을 통하여 현장적용상의 문제점에 대한 해결에 주력하였다. 첫째, 평갈수용 전자파표면유속계의 사용편의를 개선하기 위하여 소형화 및 경량화를 추진하였고, 이를 위하여 사용주파수를 기존의 10 GHz에서 24 GHz로 변경함으로써 $35{\times}35\;cm$ 크기의 기존안테나를 $22{\times}22\;cm$ 크기로 소형화하였으며 송수신부의 무게는 기존 18 kg에서 3.3 kg으로 혁신적으로 줄이는데 성공하였다. 이를 위하여 안테나는 기존의 반사형안테나에서 도파관슬롯배열안테나로 변경하였다. 둘째, 측정값의 안정화를 위하여 안테나의 특성을 개선하여 부엽(side-lobe) 레벨 30 dB 이하 그리고 전후방비(front-back ratio) 50 dB 이하로 개선하여 안테나가 지향하는 방향 이외의 위치에서 반사되는 불필요한 신호를 줄였다. 또한 적응형 이득제어(adaptive gain control)기법의 채택으로 미소 신호에 대한 안정적 측정 및 과다 신호에 대한 능동적 감쇄를 할 수 있도록 시스템을 구성하여 전 유속범위에 대한 안정적 측정을 가능토록 설계 및 제작하였다. 셋째, 자가점검 기능을 탑재하여 유속측정 전에 기기의 상태에 대한 self test기능을 통하여 측정자가 기기의 상태를 사전에 파악 가능토록함으로써, 기기 오작동에 대한 능동 대처할 수 있도록 하였다. 이외에도 저전력 회로설계를 통하여 배터리 사용시간을 확장하였고, 기존의 전자파표면유속계가 가지고 있던 방습 및 방수에도 내성을 갖는 제품으로 설계하였으며 스마트기기를 이용한 무선측정 및 세련된 디자인 등 사용자의 요구사항을 충분히 반영하였다.

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CIM(Combined Integer Mapping)을 이용한 OFDM 송신기의 IFFT 메모리 감소 (Memory Reduction of IFFT Using Combined Integer Mapping for OFDM Transmitters)

  • 이재경;장인걸;정진균;이철동
    • 대한전자공학회논문지TC
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    • 제47권10호
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    • pp.36-42
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    • 2010
  • FFT(Fast Fourier Transform)는 IEEE 802.22와 같은 여러 무선표준에서 사용되는 OFDM 시스템의 주요 블록 중 하나이다. FFT의 전력소모 감소, 면적감소, 고속동작을 위해 새로운 FFT 아키텍처 개발, twiddle factor 곱셈을 위한 곱셈기의 수나 면적감소, 제어회로의 단순화 등에 초점을 둔 FFT 프로세서의 구현에 관한 연구가 지속적으로 진행되어왔다. FFT의 입력포인트 수 N이 증가함에 따라 $log_2N$ 개의 각 FFT 스테이지 구현에 사용되는 시프트레지스터(또는, 페모리)가 차지하는 비중이 전체 FFT회로의 70%이상이 되며 이러한 메모리들은 FFT의 처음 두 스테이지에 집중되어 두 스테이지의 메모리가 전체 메모리의 75%를 차지한다. 본 논문에서는 OFDM 송신부의 IFFT(Inverse Fast Fourier Transform)에서 요구되는 메모리 사이즈를 감소시키기 위해 입력변조신호, 파일럿(pilot)신호, 널(null) 신호의 mapping을 IFFT와 결합하는 새로운 기법을 제안한다. Cognitive radio 시스템에 적용하기 위한 2048포인트 IFFT를 제안한 방법으로 설계하고 메모리가 차지하는 면적에서 기존의 방법과 비교하여 38.5%이상의 이득을 가짐을 보인다.

기후변화에 따른 도암댐유역의 유출 및 수질변화 분석 (Analysis of Discharge and Water Quality change of Doam Reservoir by Climate Change)

  • 김정민;김영도;강부식
    • 한국수자원학회:학술대회논문집
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    • 한국수자원학회 2012년도 학술발표회
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    • pp.908-908
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    • 2012
  • 국내 기후 특성상 하절기에 집중되는 강우로 인해 댐의 건설을 홍수조절, 용수확보 및 전력생산 등의 목적에 있어서 불가피하다. 이와 같은 저수지와 하류하천은 댐 수문 개폐에 따라 흐름변화로 인하여 수체의 거동 및 수질 변화가 발생하며, 일반적인 하천과는 다른 특성을 지니게 된다. 또한 수심이 깊은 저수지의 경우에는 흐름방향과 더불어 수심 방향의 특성도 중요하며, 수리 및 수질 모형의 연계를 통한 3차원적인 해석을 필요로 한다. 유역 내 지상 또는 대기에서 발생한 모든 오염물질은 강우에 의해 하천과 호수와 같은 수체로 유입되며, 강우가 발생했을 때 유역의 토지피복 상태와 수리, 지형, 강우강도, 토양의 특성에 의해 하천으로 유입되는 오염물질의 농도와 부하특성이 달라진다. 비점오염물질의 축적이 가능한 호수나 저수지에서는 비점오염원의 유입이 더 큰 문제가 되며, 유량이 극히 미미한 하천의 경우에는 강우초기에 일시에 집중적으로 유입되는 초기 오염 부하량이 문제가 된다. 강우유출수의 하천 유입은 강우 현상과 밀접한 관계를 맺고 있으므로 그 제어가 쉽지 않다. 이러므로 이를 총괄하는 유역통합관리기술이 필요로 하며, 기존의 유역통합관리기술은 댐 상류유역을 중심으로 개발되고 있으며, 댐 상류유역과 저수지, 하류하천으로 구분되어 연구되어 왔다. 또한 각각의 모형이 개별적으로 적용되어 통합적인 평가시스템이 표준화되지 않은 관계로 댐 상하류 모니터링 자료가 연계된 실무 적용이 이루어지지 않고 있다. 따라서 하천 수리 수문학적 역학구조를 이해하고 그 특성에 적합하게 평가할 수 있는 표준화된 시스템이 구축되어야 한다. 또한 효과적인 유역통합관리를 위해서는 하천의 현재 뿐만 아니라 장래에 대한 예측부분도 포함되어야 한다. 본 연구에서는 댐 유역에서의 유출과 수질 변화를 모의하고 이를 이용하여 저수지 내에서의 오염물질 거동에 대해서 해석하였다. 또한 기후변화에 따른 유역, 저수지 및 하천에 미치는 영향을 고려하기 위하여 고해상도 지역기후전망 모의자료를 이용하여 수문학적 스케일로 통계적 상세화한 후 지역별 상세수문시나리오를 생산하여 미래 예측에 활용하였다. 기후변화 시나리오의 상세화를 통한 상세지역의 기후를 예측하고, 예측된 기상자료를 이용하여 유역모델을 모의하여 미래의 유출 및 수질 변화를 파악할 수 있는 기술 개발로 인해 저수지의 운영에 도움을 주고, 주수지의 치수증대 사업 등 유출의 변화에 따른 하류하천 변화를 파악할 수 있고, 기후변화에 따른 하류하천에 대한 홍수기 때 치수, 이수 및 방재에 대하여 기초자료를 제공할 수 있을 것으로 판단된다.

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CMOS 공정 기반의 X-대역 위상 배열 시스템용 다기능 집적 회로 설계 (Design of CMOS Multifunction ICs for X-band Phased Array Systems)

  • 구본현;홍성철
    • 대한전자공학회논문지TC
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    • 제46권12호
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    • pp.6-13
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    • 2009
  • X-대역의 위상 배열 시스템에 응용 가능한 전력 증폭기, 6-bit 위상 변위기, 6-bit 디지털 감쇠기 및 SPDT 송수신 스위치를 각각 설계 및 측정하였다. 모든 회로는 CMOS 0.18 um 공정을 사용하여 구현되었다. 전력 증폭기는 2-단 차동 및 cascode 구조를 가지며, 20 dBm 의 P1dB, 19%의 PAE 의 성능을 8-11 GHz 주파수 대역에서 보였다. 6-bit 위상 변위기는 Embedded switched filter 구조를 가지며, 스위치용 nMOS 트랜지스터 및 마이크로스트립 선로로 인덕턴스를 구현하였다. $360^{\circ}$ 위상 제어가 가능하며 위상 해상도는 $5.6^{\circ}$ 이다. 8-11 GHz 주파수 대역에서 RMS phase 및 amplitude 오차는 $5^{\circ}$ 및 0.8 dB 이하이며, 삽입손실은 약 $-15.7\;{\pm}\;1,1\;dB$ 이다. 6-bit 디지털 감쇠기는 저항 네트워크와 스위치가 결합된 Embedded switched Pi-및 T-구조이며, 위상 배열 시스템에서 요구하는 낮은 통과 위상 변동 특성을 가지는 구조가 적용되었다. 최대 감쇠는 31.5 dB 이며 진폭 해상도는 0.5 dB 이다. 8-11 GHz 주파수 대역에서 RMS amplitude 및 phase 오차는 0.4 dB 및 $2^{\circ}$ 이하이며, 삽입손실은 약 $-10.5\;{\pm}\;0.8\;dB$ 이다. SPDT 송수신 스위치는 series 및 shunt nMOS 트랜지스터의 쌍으로 구성되었으며 회로의 면적을 최소화하기 위해 1개의 수동 인덕터만으로 SPDT 기능을 구현하였다. 삽입손실은 약 -1.5 dB, 반사손실은 -15 dB 이하이며, 송수신 격리 특성은 -30 dB 이하이다. 각각의 칩 면적은 $1.28\;mm^2$, $1.9mm^2$, $0.34\;mm^2$, $0.02mm^2$ 이다.