• Proceedings of the Korean Information Science Society Conference
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• 2005.07a
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• pp.766-768
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• 2005

컴퓨팅 환경이 무선과 휴대용 시스템으로 변화하면서, 전력효율이 점점 중요해지고 있다. 특히 내장형 시스템일 경우에 더욱 그러한데 이중 메모리에서 소모되는 전력이 전체 전력소모의 두 번째 큰 요소가 되고 있다. 메모리 시스템에서의 전력소모를 줄이기 위해서 DRAM의 저전력 모드인 냅모드(nap mode)를 활용할 수 있다. 냅모드는 액티브 모드(active mode)일 때의 $28\%$의 전력만을 소모한다. 하지만 하드웨어 컨트롤러는 운영체제가 협조하지 않으면 이 기능을 효율적으로 활용하지 못한다. 이 논문에서는 DRAM의 액티브 유닛(active unit)의 수를 최소화하는 방법에 초점을 맞춘다. 운영체제는 참조되지 않는 메모리를 냅모드에 놓음으로써 최소한의 유닛들만을 액티브 모드에 놓아 프로그램이 수행될 수 있도록 피지컬(physical) 페이지들을 할당한다. 이것은 PAVM(Power Aware Virtual Memory) 연구의 일반화된 시스템 전반에 대한 연구라고 할 수 있다. 우리는 모든 피지컬 메모리를 고려하고 있으며, 특히 평균적으로 전체 메모리의 절반을 사용하는 버퍼 캐시를 고려하고 있다. 버퍼 캐시의 용량과 그 중요성 때문에 PAVM 방식은 버퍼 캐시를 고려하지 않고는 완전한 해법이 되지 못한다. 이 논문에서 우리는 메모리의 사용처를 분석하고 저전력 페이지 할당 정책을 제안한다. 특히 프로세스의 주소공간에 매핑(mapping)된 페이지들과 버퍼 캐시가 고려된다. 이 두 종류의 페이지들간의 상호작용과 그 관계를 분석하고 저전력을 위해 이러한 관계를 이용한다.

• 전기의세계
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• v.45 no.10
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• pp.41-43
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• 1996

저는 암기입니다. 전통 있는 대한전기학회의 하계대회에 초대되어 강연하게 되어 정말 영광스럽게 생각합니다. 저는 지난달까지 일본 동경전력(주)의 부사장으로 재직하였습니다만, 이번에 관련기업인 통신사업을 하고 있는 동경통신 network의 사장으로 이동하게 되었습니다. 전력사업과는 다릅니다만, 통신사업이라는 장래에 유망한 새로운 공공사업에서 힘을 발휘해 볼 생각입니다. 오늘은 이 자리를 빌어서, 제가 40여년 일해온 전력사업에 관해, 그 장래에 대해 이야기 하고자 합니다.

• The Journal of the Korea institute of electronic communication sciences
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• v.10 no.5
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• pp.587-592
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• 2015

According to increase in the use of the LED, the demand for low power consumption LED display design of the controller block has increased. In this paper, the low power LED controller block was designed through the power source supply that leads adiabatic operation from constant current source circuit operated by digital signal control. The proposed circuit was implemented using a 0.35um CMOS process. and it demonstrated linear operation of the circuit. From the simulation result, the proposed circuit was evaluated with about 82% power consumption reduction effect in comparison with conventional LED controller block. This research is expected to be helpful for the low power operation and the solution for heat problem of LED display.

• The Journal of the Institute of Internet, Broadcasting and Communication
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• v.18 no.1
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• pp.167-171
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• 2018

We have developed ideal products that need low power by utilizing astable multivibraters since we are in need of technology that can be adaptable to any environments anytime because tons of thousands of electric products and IT products need to be operated by low power DC motors. Since motors generally use much electricity in an initial stage of operation, we have testified and proved the technology that can be furnished with any kinds of motors including those of AC and DC by loading them with on-off systems with electric pulse with operating methodology that has realized low-electrical operation when normally operated.

• Convergence Security Journal
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• v.12 no.3
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• pp.27-34
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• 2012

In this paper, using a new low-power consumption method for ZigBee device, which consume low-power using an output power control algorithm through RSSI monitoring as interlocking wireless network using ZigBee which has advantages of a low-power consumption, a low-cost, a compatibility and a draft international standardization enacted by IEEE and ZigBee Alliance, with wired network using built coaxial cable to overcome the disadvantage of the existing wireless sensor network, is proposed. Effectiveness of the output power control algorithm through RSSI monitoring has been verified by experimentation for more optimized low-power consumption.

• Proceedings of the Korean Information Science Society Conference
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• 2004.04a
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• pp.526-528
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• 2004

본 논문은 유무선 환경에서 TCP를 이용한 데이터 전송 시 에이젼트를 이용하여 패킷 손실의 원인을 분석, 무선 링크에서 발생한 패킷 손실에 대해서는 혼잡 윈도우 크기를 유지하고, 유선 링크에서 발생한 패킷 손실에 대해서는 지역 재전송을 수행하는 저 전력 전송기법을 제안한다. 제안하는 저 전력 전송기법은 전송 후 WNIC를 저 전력 모드로 전환시킴으로써 WNIC 전력소비를 최소화한다. NS2 시뮬레이션 결과 기존 TCP 보다 무선 링크에서 에러 발생시 67~177(%) 성능향상과 22~44(%) 에너지 감소효과를 보였고, 유선 링크에서 에러 발생시 3~22(%)의 성능 향상과 2~13(%) 에너지 감소 효과를 나타냈다.

• Proceedings of the Korea Information Processing Society Conference
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• 2010.04a
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• pp.326-329
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• 2010

USN(Ubiquitous Sensor Network) 기반 융 복합 사업화 및 서비스를 실현 하는데 있어서 가장 큰 문제점 중에 하나가 센서부의 높은 전력소모 문제로서, 기존의 설비산업용 센서(온도, 압력, 유량, 레벨, 스트레인게이지 등)는 상전과 같은 방식의 전원 공급을 요구하므로 저전력 센싱(Low-Power Sensing) 시스템으로 개발하기에 어려움이 있기 때문에, USN 의 저전력화의 장점과 시너지효과를 발휘할 수 있는 USN 에 적합한 설비산업용 저전력 센싱 핵심기술에 대한 연구가 필요하다. 이를 해결하기 위한 방안으로, 센싱주기와 다양한 환경에 따른 상황 예측기법과 같은 센싱 방법의 소프트웨어적 효율화 기법 들을 제안하였으며, 이를 융합한 지능형 센싱 핵심기술을 개발하였다.

• 전자공학회논문지 IE
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• v.47 no.2
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• pp.1-7
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• 2010

This paper presents a low power digital PLL architecture and design for implementation of the PLL-based frequency synthesizers. In the proposed architecture, a wide band digital logic quadricorrelator is used for preliminary frequency detector and a narrow band digital logic quadricorrelator is used for final DCO control. Also, a circuit technique for reducing leakage current is adopted in order to minimize the standby mode power consumption of the deactivated block. The proposed digital PLL is designed and verified by MyCAD with MOSIS 1.8V $0.35{\mu}m$ CMOS technology, and the simulation results show that the power consumption can be lowered by more than 20%.

• Proceedings of the KIEE Conference
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• 2008.10b
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• pp.536-537
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• 2008

최근 홈 네트워킹 기술과 연동된 가전제어 및 서비스에 대한니즈가 증대�� 있어 다양한 디지털 가전기기가 개발되고 있다. 특히 국내외적으로 많은 홈 네트워크 관련 제품들이 생산되고 있으며 이는 궁극적으로 이기종 네트워크 환경에서 유무선 통신의 구된 없이 다양한 기기를 네트워크에 접속할 수 있는 서비스를 제공한다. 기존 중 저속 전력선 모뎀의 경우 홈 네트워크에서 전력선으로 들어오는 신호를 수신하기 위해 전력소모가 가장 많은 Main Processor에서는 항상 Wake-On 상태를 유지하고 있다. 하지만 중 저속 전력선 모뎀의 송수신을 관장하는 Main Processor를 보게 되면 크게 통신 프로토콜을 관장하는 Main CPU와 실제 전력선 신호 송수신을 관장하는 PLC Core로 나뉠 수 있다. 홈네트워크상에 전력선으로 들어오는 신호를 수신하기 위해서는 PLC Core는 항상 Wake-On 상태를 유지해야 하지만 Main CPU의 경우는 전력소모를 최소화하기 위해 Idle 상태를 유지하더라도 Host Controller와의 Stand-by & Wake On 신호와 인터럽트 발생기능을 이용하게 되면 전력선 통신에 문제가 없이 대기모드를 지원하는 저전력 전력선 통신 모뎀 개발이 가능하다. 이에 본 연구에서는 저전력 대기모드를 지원하는 전력선 통신 모뎀 개발에 관한 연구를 하고자 한다.

• Proceedings of the Korean Information Science Society Conference
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• 2001.10c
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• pp.58-60
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• 2001

제한된 전력 원을 사용하는 휴대용기기의 대중화에 따라 제한된 전력 원을 보다 효율적으로 사용할 수 있게 하는 저 전력에 대한 연구가 활발히 진행 중에 있다. 특히 휴대용 기기의 성능이 더욱더 고성능화 됨에 따라 휴대용 기기에도 SRAM, DRAM, SDRAM등의 각종 메모리 시스템이 사용되기 시작하였다. 또한 이러한 메모리 시스템은 전체 시스템에 있어서 주요한 전력소모 요인이 되었다 따라서 본 논문에서는 이러한 메모리 장치에 대한 전력 소모 특성을 분석 수행하였으며 분석 수행 방법에 있어서 기존의 방법과는 다르게 Address, Data, 제어신호등에 따른 에너지 소모 특성을 분석함으로서 기존의 연구와는 다르게 H/W차원뿐 아니라 더 상위레벨의 S/W차원가지의 에너지 소모 절감 기법 개발을 위한 흑은 저 전력 S/W 제작을 위한 자료로서 사용될 수 있는 기초 자료를 제공하였다.