• Proceedings of the Korea Information Processing Society Conference
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• 2016.04a
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• pp.412-413
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• 2016

최근 그린IT가 주요 사업으로 급부상하면서 다양한 분야에서 소비전력 저감 관련 연구가 활발히 진행 중이다. 특히, 멀티미디어서비스 발전에 따라 '국내 셋톱박스가 2,000만대 이상 보급되었으나 미사용 대기시간에도 상당한 양의 전력을 소비하여 국가 전력 수급에 많은 영향을 주고 있어 이에 대한 해결방안이 시급히 요구되고 있는 상황이다. 방송 서비스 사업자는 방송 콘텐츠의 활용성 증대, H/W교체 주기 연장 및 소비전력 저감 등의 이점으로 인하여 저전력 모드를 지원하는 셋톱박스에 가상화 서비스 제공 기술을 적용하기 위한 방법을 또한 모색하고 있다. 본 논문은 셋톱박스의 발전 방향이 하이브리드화, 고기능/복합화 함으로써 소비전력이 더욱 증가하고 있으므로 셋톱박스의 소비전력 저감을 보장하고, 가상화 서비스를 제공하기 위한 고려사항과 에너지 효율성을 보장하는 방법을 제공한다.

• Journal of KIISE:Computer Systems and Theory
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• v.33 no.3
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• pp.166-177
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• 2006

The cache size tends to grow in the embedded processor as technology scales to smaller transistors and lower supply voltages. However, larger cache size demands more energy. Accordingly, the ratio of the cache energy consumption to the total processor energy is growing. Many cache energy schemes have been proposed for reducing the cache energy consumption. However, these previous schemes are concerned with one side for reducing the cache energy consumption, dynamic cache energy only, or static cache energy only. In this paper, we propose a hybrid scheme for reducing dynamic and static cache energy, simultaneously. for this hybrid scheme, we adopt two existing techniques to reduce static cache energy consumption, drowsy cache technique, and to reduce dynamic cache energy consumption, way-prediction technique. Additionally, we propose a early wake-up technique based on program counter to reduce penalty caused by applying drowsy cache technique. We focus on level 1 data cache. The hybrid scheme can reduce static and dynamic cache energy consumption simultaneously, furthermore our early wake-up scheme can reduce extra program execution cycles caused by applying the hybrid scheme.

• The Journal of the Korea institute of electronic communication sciences
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• v.14 no.6
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• pp.1145-1152
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• 2019

In this paper, a low power current mode 12-bit ADC(: Analog to Digital Converter) is proposed to mix digital circuits and analog circuits with the advantages of low power consumption and high speed operation. The proposed 12 bit ADC is implemented by using 4-bit ADC in a cascade structure, so its power consumption can be reduced, and the chip area can be reduced by using a conversion current mirror circuit. The proposed 12-bit ADC is SK Hynix 350nm process, and post-layout simulation is performed using Cadence MMSIM. It operates at a supply voltage of 3.3V and the area of the proposed circuit is 318㎛ x 514㎛. In addition, the ADC shows the possibility of operating with low power consumption of 3.4mW average power consumption in this paper.

• NEWSLETTER 전기공업
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• no.97-19 s.188
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• pp.13-27
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• 1997

• Journal of the Institute of Electronics Engineers of Korea SD
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• v.43 no.10 s.352
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• pp.134-139
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• 2006

In this paper we present the Low-Power Bus Driven Floorplan(BDF) in which the bus power consumption is minimized by using a new cost function. The previously reported BDF has used the cost function which minimizes only the chid and the bus area. However, such a cost function may not consider the bus power consumption determined by the topology of a bus in case of the segmented bus design. In this paper, we formulate a new cost function which. reflects the communication frequency and the real distance between blocks in a bus to model the bus power consumption. For the Low-Power BDF with the new cost function, the experimental results show the bus power consumption cost is reduced by 11.43% on the average.

• Journal of the Institute of Electronics Engineers of Korea SC
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• v.41 no.6
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• pp.17-25
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• 2004

In this paper, we propose a new small swing domino logic for low-power consumption. To reduce the power consumption, both the precharge node and the output node swing the range from 0 to $V_{REF}$- $V_{THN}$, where $V_{REF}$=VDD-n $V_{THN}$ (n=1, 2, and 3). This can be done by adding the inverter structure on domino logic that allows a full swing or a small swing on its input terminal without leakage current. Compared to previous works, the proposed structure can save the power consumption of more than 30% for n=0, 1, 2, and 3 in the equation of $V_{REF}$=VDD-n $V_{THN}$. A multiplier applying the proposed domino logic has been designed and fabricated using a 0.35-${\mu}{\textrm}{m}$ n-well CMOS process under 3.3-V supply voltage. Compared with other previous works, it shows a 30% power reduction and a better feature in power-delay product.lay product.

• Proceedings of the Korean Information Science Society Conference
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• 2007.06d
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• pp.440-444
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• 2007

센서 네트워크를 구성하는 각 노드는 AA형 건전지를 사용하여 2년 6개월 이상 동작하는 것을 목표로 하며, 따라서 저전력을 고려하여 설계되어야 한다. 본 논문에서는 저전력 센서 네트워크를 위한 분산 컴퓨팅 모델을 제안한다. 제안된 모델은 우선 센서 노드에서 처리를 위한 에너지 소비와 통신을 위한 에너지 소비의 크기를 분석한다. 그리고 처리 에너지 비용을 지불하여 통신 에너지 감소라는 이득을 얻을 수 있음을 보인다. 한편, 이 기법은 특정 센서 노드의 에너지를 집중적으로 소비할 수 있음을 보이고, 이를 해결할 수 있는 에너지 균형 분산 컴퓨팅 모델을 제안한다. 시뮬레이션 기반 실험 결과 제안된 모델이 전체적인 에너지 소비를 낮추었을 뿐 아니라 센서 노드들 간에 에너지 균형도 이루고 있음을 알 수 있었다.

• Proceedings of the IEEK Conference
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• 2008.06a
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• pp.1155-1156
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• 2008

현재 에너지 소비를 줄이기 위한 연구들이 활발히 진행되고 있다. 그 중 대형 LCD TV 분야는 전체 소비전력의 약 70%이상이 백라이트에 의한 소비이므로, 대형 LCD TV의 전력 절감을 위해서는 효율적인 백라이트 설계에 대한 연구가 매우 중요한 부분이다. 따라서 본 연구에서는 백라이트의 효율적인 전력 소비를 위해 다채널 영상 분할 LED백라이트 밝기 제어를 통한 저전력 BLU 설계하였다. 본 연구를 통한 실험을 한 결과 60%이상의 전력 절감효과를 측정하여 연구의 유효함을 입증하였다.

• 월간 기계설비
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• s.323
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• pp.35-39
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• 2017

일본에서 불황속에서도 성장한 산업은 1인 소비행태를 활용한 비즈니스이다. 장기불황을 겪으며 자연스레 합리적인 소비에 눈을 떴다. 실속형 소비라고 할 수 있다. 한국에서도 혼합, 혼술, 혼영 등의 신조어가 이를 증명한다. 또한 소득이 줄면서 자연스레 절약의식이 강해졌고 제품만 튼튼하다면 "남이 쓰던 물건인데"라는 쓸데없는 생각은 하지 않는다.

• 전기의세계
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• v.41 no.10
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• pp.38-42
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• 1992

전력수급는 경제규모의 확대와 국민소득 증대에 따라 계속적으로 증가될 것이 예상되고 있다. 국민경제에 필수불가결한 전력이 안정적으로 공급되기 위해서는 발전소의 건설도 중요하지만 현재 우리 사회에는 지방화, 민주화 확산과 환경에 대한 관심등이 고조되면서 발전소 건설여건이 날로 어려워지고 있을 뿐만 아니라 대부분의 에너지도 수입에 의존하고 있는 특수성에도 불구하고 낭비적이고 비효율적인 소비현상을 보이고 있어 앞으로의 전력정책은 그 동안의 공급위주에서 벗어나 수요측면에서 수요관리 및 소비절약등에 역점을 두어 추진될 것이다. 이를 위해 앞에서 언급한 수요관리 및 전기소비 절약을 강력히 추진하여 장기적으로 전기저소비형사회가 되도록 유동함에 아울러 기존설비의 수명연장, 효율 및 기능 향상 그리고 기술개발등에 대한 집중적인 투자와 지원을 할 계획이다.