• The Journal of Korean Institute of Communications and Information Sciences
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• v.25 no.12B
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• pp.2141-2153
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• 2000

본 논문에서는 DMT 기반의 xDSL 시스템의 수신단에서 발생하는 샘플링 위상 옵셋과 샘플링 주파수 옵셋에 의한 타이밍 오류를 분석한 후, 디지털 수신기에서 이를 보상하기 위한 비동기식 샘플링(full digital PLL) 방식을 제안한다. 기존의 논문에서는 DMT 방식의 xDSL 시스템에서 샘플링 위상 옵셋을 delay-rotor 특성을 이용한 주파수영역 위상 회전기로 보상하는 비동기식 샘플링 방식을 제안한 바 있다. 그러나 수신단에서 샘플링 시 존재하는 타이밍 오류로 인해 저역통과 필터링된 수신신호는 더 이상 delay-rotor 특성이 성립하지 않아 성능이 크게 저하된다. 본 논문에서는 샘플링 위상 옵셋을 완벽하게 보상할 수 있는 데이터 구간의 환형 컨벌루션화(circular convolution) 방식을 제안한다. 또한 샘플링 위상 옵셋과 샘플링 주파수 옵셋이 동시에 존재하는 경우 이를 보상할 수 있는 개선된 시간/주파수 혼성영역 보상방식을 제안한다. 또한 추가의 오버헤드를 사용하지 않고 샘플링 위상 옵셋과 샘플링 주파수 옵셋을 보상할 수 있는 시간영역 보상방식을 제안한다. 마지막으로 DMT 방식의 ADSL 시스템에 본 논문에서 제안된 비동기식 샘플링 방식들을 적용하여 모의실험을 통해 성능을 분석하고 기존의 방식과 비교하여 성능의 우수성을 확인한다.

• Proceedings of the IEEK Conference
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• 2000.11a
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• pp.369-372
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• 2000

본 논문에서는 P-HEMT Gate-바이어스 튜닝에 의한 위상동기 마이크로파 발진기를 설계하였다. 설계된 유전체 발진기는 병렬궤환공진 형태로서 P-HEMT의 게이트단에서 전압을 제어하여 전압제어발진기 형태로 주파수를 가변시키므로서 안정된 위상동기신호를 나타나도록 하였다. 위상동기방식은 외부에서 제공되는 125㎒의 기준주파수를 SRD로 체배시켜 하모닉 신호를 이용한 마이크로파 샘플링 위상검파 방식으로 설계하였으며, 유전체 발진기의 자유발진신호와 샘플링 신호사이의 위상비교에 의하여 ±1㎒ 범위의 고안정 특성을 갖는 13.25㎓대역의 위상고정 발진기의 동기화와 저 위상잡음을 나타내었다.

• The Journal of Korean Institute of Communications and Information Sciences
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• v.19 no.10
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• pp.1982-1990
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• 1994

We implemented a PLDRO(Phase Locked Dielectric Resonator Oscillator) using the concept of the feedback property of PLL(Phase Locked Loop) for Ku-band(10.95-11.70 GHz). The conventional approaches to a PLDRO design use varactor diode tuning method.. But in theis paper, the PLDRO has the advantage of the frequency sensitivity to changes in the supple voltage of the oscillating device without the frequency-variable part by varactor diode voltage-control. and uses a SPD(Sampling Phase Detector) for phase-comparision. The PLDRO is composed of the DRO phase-locked to the reference signal of UHF band by using a SPD for high frequency stability and can be available for European FSS(Fixed Satellite Service) at 10.00GHz. The PLDRO generates the output power of 8.67 dBm at 10.00 GHz and has a phase noise of -81 dBc/Hz at 10 kHz offset from carrier. The hamonic and spurious characteristics have -42.33 dBc and -65dBc respectively. This PLDRO has much better frequency stability, lower phase noise, and more economical effect for a satellite system than conventional DRO.

• The Journal of Korean Institute of Communications and Information Sciences
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• v.19 no.10
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• pp.1973-1981
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• 1994

A PLDRO(Phase Locked Dielectric Resonator Oscillator) in Ku-band(10.95-11.70GHz) is designed with the concept of the feedback property of PLL(Phase Locked Loop). A series feedback type DRO is developed, and VCDRO(Voltage Controlled Dielectric Resonator Oscillator) using a varactor diode as a voltage-variable capacitor is implemented to tune oscillating frequency electrically. Then, PLDRO is designed by using a SPD(Sampling Phase Detector). This PLDRO is phase-locked voltage controlled DRO to reference source(VHF band) by SPD at 10.00 GHz for European FSS(Fixed Satellite Service). The PLDRO generates output power greater than 10dBm at 10.00 GHz and has phase noise of -80 dBc/Hz at 10 KHz offset from carrier. This PLDRO achieves much better frequency stability than conventional VCDRO.

• Journal of Navigation and Port Research
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• v.30 no.10 s.116
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• pp.847-853
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• 2006

In this paper, we designed VCO(voltage controlled oscillator} that is composed of a dielectric resonator and a varactor diode, and the PLDRO(phase locked dielectric resonator oscillator) that is combined with the sampling phase detector and loop filter. The results at 12.05 GHz show the output power is 13.54 dBm frequency tuning range approximately +/- 7.5 MHz, and power variation over the tuning range less than 0.2 dB, respectively. The phase noise which effects on bits error rate in digital communication is obtained with -114.5 dBc/Hz at 100 kHz offset from carrier, and The second harmonic suppression is less than -41.49 dBc. These measured results are found to be more improved than those of VCO without adopting PLL, and the phase noise and power variation performance characteristics show the better performances than those of conventional PLL.

• The Journal of Korean Institute of Electromagnetic Engineering and Science
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• v.23 no.11
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• pp.1280-1287
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• 2012

The 3.2~6.5 GHz wideband YTO(YIG Tuned Oscillator) module is designed, fabricated and measured. To improve the phase noise characteristic of the YTO module, offset PLL(Phase Locked Loop) structure with sampling mixer is applied. This YTO module is composed of sampling mixer, phase detector, loop filter, current driver, and YTO. The phase noise of the fabricated YTO module is measured as -100 dBc/Hz at 10 kHz offset frequency, which approximates the predicted result at the center frequency of 4.5 GHz. This YTO module presents over 10 dB improved phase noise compared to conventional PLL module from operating frequency.

• The Journal of Korean Institute of Electromagnetic Engineering and Science
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• v.16 no.1 s.92
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• pp.49-55
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• 2005

In this paper, the phase locked harmonic oscillator(PLHO) using the analog PLL(Phase Locked Loop) is designed and implemented for a wireless LAN system. The harmonic oscillator is consisted of a ring resonator, a varactor diode and a PLL circuit. Because the fundamental fiequency of 8.5 GHz is used as the feedback signal for the PLL and the 2nd harmonic of 17.0 GHz is used as the output, a analog frequency divider for the phase comparison in the PLL system can be omitted. For the simple PLL circuit, the SPD(Sampling Phase Detector) as a phase comparator is used. The output power of the phase locked harmonic oscillator is 2.23 dBm at 17 GHz. The fundamental and 3rd harmonic suppressions are -31.5 dBc and -29.0 dBc, respectively. The measured phase noise characteristics are -87.6 dBc/Hz and -95.4 dBc/Hz at the of offset frequency of 1 kHz and 10 kHz from the carrier, respectively.

• The Journal of Korean Institute of Communications and Information Sciences
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• v.39C no.7
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• pp.573-581
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• 2014

We proposed a hopping phase estimator to demodulate the received signals without any hopping information in frequency hopping spread spectrum systems. The demodulation process in this paper is as follows: hopped frequency tracking is accomplished by choosing a frequency component with maximum amplitude after taking discrete Fourier transform and a hopping frequency estimator which estimates the phase generated by hopped frequency is established through difference product and down-sampling. We obtained the probability density function and variance performance of the proposed estimator and confirmed that the analysis and the simulation results were agreed with each other.

• Proceedings of the KIPE Conference
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• 2014.11a
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• pp.111-112
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• 2014

본 논문에서는 그리드 코드에서 요구하는 반주기 실효치 계산 방식을 국내 계통에 적용하기 위한 실효값(RMS) 계산 알고리즘을 제안한다. 정확한 실효값을 계산하기 위해서는 국내 계통 60Hz에 적합한 샘플링 주파수가 적용되어야 한다. 따라서 기존의 실효값 계산 알고리즘과 제안하는 실효값 알고리즘을 시뮬레이션 및 실험데이터를 제시하고, 속응성 및 오차 특성을 비교 제시한다.

• Proceedings of the IEEK Conference
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• 2000.09a
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• pp.601-604
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• 2000

본 논문에서는 MCMA(modified constant modulus algorithm) 블라인드 등화 알고리듬을 고속 데이터 통신에 적합한 FSE(fractionally spaced equalize.)에 적용시킨 FS-MCMA를 제안하였다. 제안한 FS-MCMA는 위상 복원문제와 같은 CMA의 단점을 보완하기 위하여 M-ary QAM 신호의 경우 다중레벨로 등화하는 기존의 MCMA 이용하였고 주기 T의 간격으로 수신되는 심볼을 2배 이상으로 샘플링하는 기법, 즉 FSE를 도입하여 높은 테이터율을 요구하는 멀티미디어 통신에 적합하도록 구성하였다. 컴퓨터 모의 실험을 시행한 결과를 residual ISI 측면에서 기준을 정하고 비교하였는데 4dB정도의 성능향상을 보였으며, 또한 기존의 CMA보다 154dB 정도의 성능향상을 보였다.