• 제목/요약/키워드: 비트시스템

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AE32000 호환 32-비트 EISC 마이크로프로세서 설계 (Design of an AE32000-compatible 32-bit EISC Microprocessor)

  • 곽기영;박진국;이두영;이범근;정연모
    • 한국정보과학회:학술대회논문집
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    • 한국정보과학회 2002년도 가을 학술발표논문집 Vol.29 No.2 (1)
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    • pp.700-702
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    • 2002
  • 본 논문은 16-비트 고정된 명령어 형식을 갖는 32-비트 EISC(Extendable Instruction Set Computer) 코어 구현에 대하여 기술하였다. EISC구조는 코드 밀도가 높은 확장 오퍼랜드(operand) 형식을 사용하여 메모리 크기를 줄일 수 있으므로 ASIC 구현시 저전력 시스템 및 소형화된 임베디드 시스템을 위한 프로세서 구현을 가능하게 한다. 설계된 프로세서는 AE32000 명령어 셋과 호환이 가능하도록 설계되었으며 5단 파이프라인을 적용하여 프로세서의 성능을 높였다. 또한 BTB(Branch Target Buffer)를 사용하여 분기 지연을 줄여 낮은 CPI(Clock Per Instruction)을 유지하게 하였다.

DAB 시스템에서의 패킷오율 모델링 (Packet Error Rate Model for DAB system)

  • 이현;조삼모;이봉호;이수인
    • 한국방송∙미디어공학회:학술대회논문집
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    • 한국방송공학회 2002년도 정기총회 및 학술대회
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    • pp.201-206
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    • 2002
  • 패킷 기반 통신 시스템에서는 비트오율 보다는 패킷오율이 시스템 파라미터 설계에 보다 중요한 역할을 한다. 패킷오율을 분석하기 위해서는 대부분의 접근이 패킷을 이루고 있는 비트열의 오류 발생 사건을 독립이라고 가정한다. 그러나 실제의 통신 시스템에서는 오류 발생 형태가 버스트 형태로 그룹을 이루고 있다[1]. 본 논문은 비터비 디코더를 포함하는 통신시스템에 있어서의 버스트의 확률 분포를 기반으로 한 PER 모델을 제안하고, Eureka-147 방식의 디지털 오디오 방송 시스템의 시뮬레이션을 통하여 얻은 비트열에 대한 패킷오율과 제안한 패킷오율 모델과의 비교를 통하여 제안한 모델을 검증하였다.

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다중 사용자 간섭이 존재하는 복호 후 전송 협력통신 시스템의 비트오류율 분석 (Exact Bit Error Probability of Opportunistic Decode-and-Forward Cooperative System with Multiple Interferers)

  • 김성일;허준
    • 한국방송∙미디어공학회:학술대회논문집
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    • 한국방송공학회 2011년도 추계학술대회
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    • pp.82-85
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    • 2011
  • 본 논문에서는 다중 사용자 간섭이 존재하는 복호 후 전송 협력통신 시스템의 비트오류율에 대해 기술한다. 최근 공간 다이버시티를 위한 협력통신 시스템에 관한 연구가 활발히 진행되고 있고 모바일 사용자의 수와 요구가 점점 증가하고 있는 추세이다. 한정된 자원 및 공간에서 모바일 사용자가 증가함에 따라 사용자 간의 간섭현상이 더욱 빈번하게 나타나게 되는데 이는 무선통신 시스템의 중요한 문제 중 하나이다. 따라서 릴레이 (Relay) 기반 협력통신 시스템에서도 일반적인 무선통신 시스템과 같이 다중 사용자 간섭을 고려하는 것이 필요하다고 볼 수 있다. 본 논문에서는 다중 릴레이 기반 복호 후 전송(Decode-and-Forward) 프로토콜에서 릴레이 및 목적노드에 다중 간섭이 존재하는 경우의 비트오류율에 대해 분석한다.

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다채널 디지털 오디오 신호처리기 구현 (An Implementation of the Multichannel Digital Audio Signal Processing System)

  • 이규하
    • 한국음향학회:학술대회논문집
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    • 한국음향학회 1998년도 학술발표대회 논문집 제17권 2호
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    • pp.39-42
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    • 1998
  • 본 논문에서는 방송용 오디오 기기가 갖는 다채널의 특성과 각 채널에 대한 다양한 신호처리 기능의 특성을 고려하여 다채널 디지털 오디오 신호 처리기의 구조를 제안하고 범용 DSP를 이용하여 실시간 병렬 처리 시스템을 구현하였다. 구현된 시스템은 32비트 부동수소점 DSP를 이용하였으며 스테레오 채널의 48KHz 표본화 주파수를 지원하고 20비트 해상도를 갖는 시스템이다. 다채널 디지털 오디오 신호 처리 시스템의 구조는 디지털 신호 처리 과정을 수행하는 디지털 오디오 데이터 처리 부분과 시스템을 제어하기 위한 제어 정보 처리 부분으로 제안하였다. 이러한 구조에 적합한 실시간 시스템을 구현하기 위해 전체 시스템은 4부분의 모듈로 구성된다.

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임베디드 병렬 프로세서를 위한 칼라미디어 명령어 구현 (Color Media Instructions for Embedded Parallel Processors)

  • 김철홍;김종면
    • 한국정보과학회논문지:시스템및이론
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    • 제35권7호
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    • pp.305-317
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    • 2008
  • 최근 모바일 컴퓨팅 환경의 변화로 멀티미디어 데이타의 고성능, 저전력 처리에 대한 수요가 증가하고, 프로세서에 있어서 멀티미디어 전용 가속기 기능의 중요성이 크게 부각되고 있다. 이에 본 논문은 고성능, 저전력 멀티미디어 처리를 위한 SIMD 병렬 프로세서용 칼라미디어 명령어를 제안한다. 기존의 범용 마이크로프로세서 전용 멀티미디어 명령어 (e.g., MMX, VIS, AltiVec)는 4개의 8 비트 픽셀을 32 비트 레지스터에 저장하고 처리하는 반면에, 제안하는 칼라미디어 명령어는 인간의 시각이 칼라에 덜 민감한 점을 고려하여 32비트 데이타패스 아키텍처에서 두 쌍 (6개의 픽셀)의 압축된 16비트 YCbCr (6비트 Y, 5비트 Cb와 Cr) 데이타를 32비트 레지스터에 저장하고 동시에 처리함으로써 YCbCr 데이타 처리에서 높은 병렬성과 효율성을 보여준다. 또한 칼라미디어 명령어는 데이타 포맷 사이즈를 줄임으로써 전체시스템의 비용을 절감할 뿐만 아니라 데이타 대역폭의 감소로 시스템 디자인을 간소화한다. SIMD 병렬 프로세서 아키텍처에서 모의 실험한 결과, 칼라미디어 명령어 기반 프로그램은 baseline 명령어 프로그램보다 평균 6.3배 성능향상을 보여준다. 반면, Intel의 대표적인 멀티미디어 명령어인 MMX 기반 프로그램은 동일한 SIMD 병렬 프로세서에서 baseline 명령어 프로그램보다 단지 3.7배 성능향상을 나타낸다. 또한, 칼라미디어 명령어는 MMX보다 시스템 면적 효율 (52% 증가 대비 13% 증가)과 시스템 전력 효율 (50% 증가 대비 11% 증가)에서 우수성을 보여준다. 칼라미디어 명령어는 이러한 성능과 효율을 단지 3%의 시스템 면적과 5%의 시스템 전력의 증가로 얻는 반면, MMX는 14%의 시스템 면적과 16%의 시스템 전력증가가 요구된다.

DVB-T2 기반의 UHDTV 방송을 위한 초고차 성상 변조방식의 비트 인터리버 설계 (Bit Interleaver Design of Ultra High-Order Modulations in DVB-T2 for UHDTV Broadcasting)

  • 강인웅;김영민;서재현;김흥묵;김형남
    • 한국통신학회논문지
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    • 제39A권4호
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    • pp.195-205
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    • 2014
  • UHDTV(ultra-high definition television)가 초고해상도 방송 서비스를 지향하는 차세대 방송 서비스로 논의되고 있다. 그러나 상용 방송 시스템으로 UHDTV의 요구 전송량을 온전히 충족시킬 수 없으므로, 초 고차 성상을 이용한 전송량 증대관련 연구가 진행되고 있다. 특히, 기존의 시스템 중에서 UHDTV 전송에 가장 적합한 DVB-T2(Digital video broadcasting-2nd generation terrestrial) 시스템에 초 고차 변조를 적용할 경우 오류 정정부호의 부호어와 성상의 Unequal error protection을 적절히 이어주는 비트 매퍼가 필요하다. DVB-T2 시스템의 비트 매퍼는 비트 인터리버와 비트-셀 역다중화기로 나누어져 있으며, 두 가지 블록에 대한 많은 연구가 진행되었다. 그러나 비트 인터리버 설계와 관련된 연구가 부족하여 UHDTV 시스템에 적용될 초 고차 성상의 비트 인터리버 설계 방법론에 대한 정립이 필요하다. 이에 따라 본 논문은 DVB-T2의 비트 인터리버의 설계 방법을 제안하고, 1024-QAM과 4096-QAM의 비트 인터리버를 제안된 설계 방법을 통하여 설계하였다.

오류 정정 부호가 결합된 채널 최적 양자화기를 이용한 DCT 영상 전송 방식의 설계 (On the Design of a DCT Transmission Method using Channel Optimized Quantizer Combined with Error Correcting Codes)

  • 김종락;박준성;김태정
    • 한국통신학회논문지
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    • 제18권11호
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    • pp.1626-1634
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    • 1993
  • 이 논문에서는 채널 오류에 강한 영상 전송 시스템을 설계하기 위하여 정보원 부호와 오류 정정 부호(error correcting code : ECC )를 결합시키는 부호화 기법을 제안한다. 정보원과 채널을 동시에 고려하는 부호화기법중의 하나는 채널 최적 양자화기(channel optimized quantizer :COQ)인데 이것은 양자화에 의한 잡음과 채널 비트 오류에 의한 잡음을 동시에 최소화시킨다. 이 논문은 COQ와 ECC를 결합하여 개선된 전송 시스템을 설계하는 문제를 다룬다. 특히 n비트의 COQ와 (n-1)/n의 길쌈 부호가 결합된 n-1 비트의 COQ의 성능을 계산하여, 이 결과로부터 할당 비트수와 채널 비트 오류율에 따라 ECC를 선택할 것인지 아닌지를 결정한다. 그리고, 이 결과를 DCT를 이용한 영상 전송 시스템에 적용하고 그 성능을 계산한다.

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터보코딩 및 고차변조를 적용하는 3GPP GERAN 진화 시스템: 비트 신뢰도 기반의 심볼 매핑 (3GPP GERAN Evolution System Employing High Order Modulation and Turbo Coding: Symbol Mapping Based on Priority)

  • 오형주;최병조;황승훈;최종수
    • 한국통신학회논문지
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    • 제33권6A호
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    • pp.607-613
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    • 2008
  • 본 논문에서는 터보코딩 및 고차변조를 적용하는 3GPP GERAN 진화 시스템 물리계층에 비트 신뢰도 기반의 심볼 매핑 방법(Symbol Mapping based on Priority: SMP)을 최초로 적용하여 그 성능을 살펴보고자 한다. SMP는 터보코딩에서 정보비트(systematic bits)의 중요성을 이용하여 정보비트를 신뢰도 높은 비트에 매핑시키는 기술로서 본 기술을 GERAN 진화 시스템에 적용시켰을 때, 링크 레벨 시뮬레이션을 통해 16QAM(DAS-8)과 32QAM(DAS-11)의 변조/코딩 방식에 대해서 성능이득이 있음을 확인할 수 있다.

다중 안테나 공간 다중화 릴레이 시스템을 위한 근사 최소 비트 오율 전력 할당 방법 (Approximate Minimum BER Power Allocation of MIMO Spatial Multiplexing Relay Systems)

  • 황규호;최수용
    • 한국통신학회논문지
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    • 제36권4A호
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    • pp.337-344
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    • 2011
  • 본 논문은 모든 노드가 다중 안테나를 갖는 다중 안테나 (MIMO, multiple-input and multiple-output) 공간 다중화 (SM, spatial multiplexing) 릴레이 시스템을 비트 오율 (BER, bit error rate) 관점에서 연구한다. 제한된 전력 자원을 효율적으로 이용하기 위해서는 각 노드와 안테나에서 최적화된 전력 할당 전략이 필요하다. 본 논문은 이런 관점에서 다중 안테나 공간 다중화 릴레이 시스템을 위한 비트 오율 최소화에 기반을 둔 전력 할당 알고리즘을 제안한다. 제안된 알고리즘은 평균 비트 오율을 직접 최소화하여 얻어지며, 노드 간 (inter-node) 전력 할당 알고리즘과 안테나 간 (inter-antenna) 전력 할당 알고리즘으로 구성된다. 비트 오율 성능에 있어서, 기존의 균등 전력 할당 (EPA, equal power allocation) 알고리즘보다 추가적인 전력 소비 없이도 월등한 성능을 보인다.

MPEG-2 AAC 복호화 시스템의 구조 제안 및 구현 (Design Optimization of MPEG-2 AAC Decoder)

  • 방경호;김준석;윤대희
    • 대한전자공학회:학술대회논문집
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    • 대한전자공학회 2001년도 제14회 신호처리 합동 학술대회 논문집
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    • pp.257-260
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    • 2001
  • 본 논문에서는 2 채널 MAIN 프로필 MPEG-2 AAC 복호화 시스템의 구조를 제안하고 구현하였다. 복호화 알고리듬의 구조적인 모듈화에 근거하여, 시스템 설계 과정에서 전체 시스템을 3 개의 하드웨어 모듈로 분할하였다. 전체 시스템은 허프만 복호화기, 예측기, 20 비트 고정소수점 DSP 코어로 이루어져 있다. 허프만 복호화기는 주어진 작업을 1 클럭 사이클 내에 수행할 수 있는 고속의 하드와이어드 모듈이고, 예측기는 높은 해상도를 가지고 다른 모듈들과 병렬처리가 가능한 구조를 가진 모듈이다. 구현된 시스템은 16.9 MIPS 로 2 채널의 MPEG-2 AAC 비트열을 고음질로 복호화할 수 있다.

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