• 제목/요약/키워드: 병렬 통신

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병렬 프로세서 기술 및 동향 (Technology and Trend of Parallel Processor)

  • 정무경;박성모;엄낙웅
    • 전자통신동향분석
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    • 제24권6호
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    • pp.86-93
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    • 2009
  • 프로세서는 더 이상 동작 주파수를 높이는 방법이 아닌 다수의 프로세서를 집적하는 멀티프로세서로 기술 발전이 이루어지고 있다. 최근 2, 4, 8개의 프로세서 코어를 넘어 64, 128개 이상의 프로세서를 집적한 대규모 데이터 처리 및 과학 연산용 고성능 프로세서들이 개발되고 있다. 본 문서는 이러한 병렬 프로세싱의 개념 및 병렬 프로세서의 기술을 정리하고 최근 동향과 함께 당면한 문제점들을 기술한다.

병렬화를 위한 자료 종속성 분석 기법 (Data Dependence Analysis for Parallelization)

  • 김진미;민옥기;우영춘;변석우
    • 전자통신동향분석
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    • 제12권5호통권47호
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    • pp.73-83
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    • 1997
  • 최적화 컴파일러 및 병렬 컴파일러는 종속성 분석을 통하여 프로그램의 문장 사이, 동작들 간에 가해지는 실행 순서 상의 제약 조건을 추출한다. 이러한 제약 조건은 계산의 의미를 보존하기 위한 필요 조건들이며, 컴파일러의 성능을 향상시키기 위한 프로그램의 변환은 이 제약 조건을 만족하는 범위에서 수행되어야 한다. 본 고에서는 컴파일러에서 최적화 및 병렬화할 프로그램의 부분과 적용될 변형 기법 등을 결정하기 위해 필요한 종속성 분석에 대한 내용을 다룬다.

단일 루프 강인 전압 제어기를 이용한 단상 UPS 인버터의 비통신선 방식 병렬 운전 (A Wireless Parallel Operation of Single-phase UPS Inverter using Single-loop Robust Voltage Controller)

  • 구대관;지준근;차귀수
    • 전력전자학회:학술대회논문집
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    • 전력전자학회 2011년도 추계학술대회
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    • pp.203-204
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    • 2011
  • 단일 루프 강인 전압 제어기를 이용한 단상 3kVA UPS 인버터의 비통신선 방식 병렬 운전 결과를 기술한다. 단상 UPS 인버터 2대로 병렬운전 실험 환경을 구축하였고, 주파수-전압 강하 방식의 수하 제어를 이용하여 저항 부하, 비선형 부하에 대한 전력분담을 실험을 통하여 확인하였다.

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M-VIA를 이용한 병렬 VOD서버 통신 모듈 설계 및 구현 (Design and Implementation of Communication Module for Parallel VOD Server using M-VIA)

  • 유찬곤;박의수;최현호;김형식;유관종
    • 한국정보과학회:학술대회논문집
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    • 한국정보과학회 2002년도 가을 학술발표논문집 Vol.29 No.2 (3)
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    • pp.526-528
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    • 2002
  • 병렬 VOD 서버는 효율적인 부하 분산을 위해 하나의 비디오 파일을 여러 노드에 나누어 저장하므로 VOD 서비스 제공을 위해서는 노드 간 멀티미디어 데이터 이동이 필수적이다. 그러므로 노드 간 데이터 이동을 지원하는 네트워크 대역폭이 전체 시스템 성능을 결정하는 요소가 된다. 본 논문에서는 사용자 수준 프로토콜 중 산업 표준 프로토콜인 VIA를 사용하여 병렬 VOD 서버를 위한 고속의 통신 모듈을 설계하고 구현한 결과를 제시한다.

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CAN 통신을 이용한 UPS의 병렬 제어 (Parallel Operation of UPS with PWM Synchronization using CAN)

  • 김경환;오성진;김태훈
    • 전력전자학회:학술대회논문집
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    • 전력전자학회 2004년도 전력전자학술대회 논문집(1)
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    • pp.380-383
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    • 2004
  • 본 논문에서는 CAN(Controller Area Network) 통신을 이용한 전 디지털 UPS시스템의 병렬제어에 대해 기술한다. UPS 주제어기인 DSP 내부에 실장된 CAN모듈을 이용하여 별도의 상위제어기가 없는 효과적이고 간단한 UPS의 병렬제어 시스템을 제시하며 특히 고조파 순환전류를 제거하기 위한 PWM 동기 방법을 제안하고 시험을 통해 제안한 방법의 타당성을 입증하였다.

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병렬 컴퓨터 시스템 성능 평가를 위한 컴퓨터 시뮬레이션 기술 동향 (Simulation Techniques for Parallel Computer System Performance Evaluation)

  • 정용화;박진원;윤석한
    • 전자통신동향분석
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    • 제13권5호통권53호
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    • pp.1-10
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    • 1998
  • 최근 들어 병렬 컴퓨터 시스템의 설계를 평가하기 위한 컴퓨터 시뮬레이션이 활발하게 연구되고 있다. 본 고는 컴퓨터 시뮬레이션 과정에 포함되는 여러 가지 작업 부하 생성 방법에 대해 살펴본다. 각 방법에 대한 정의, 특징을 살펴본 후 대표적인 구현 사례를 요약해본다. 먼저 분포 구동 시뮬레이션 방법과 이를 위하여 사용되는 시뮬레이션 언어에 대해 살펴본 후, 트레이스를 이용하는 추적 구동 시뮬레이션 방법과 병렬 컴퓨터 시스템용 트레이스를 생성하는 방법에 대해서 알아본다. 마지막으로 최근에 각광 받고있는 수행구동 시뮬레이션 방법과 프로그램 구동 시뮬레이션에 대하여 살펴본다.

리눅스 클러스터의 병렬 MPI 프로그램을 위한 동시 스케줄링 기법 (A Dynamic Co-scheduling Scheme for parallel MPI programs on Linux clusters)

  • 정평재;조현웅;이윤석
    • 한국정보과학회:학술대회논문집
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    • 한국정보과학회 2003년도 가을 학술발표논문집 Vol.30 No.2 (1)
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    • pp.460-462
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    • 2003
  • 본 연구에서는 리눅스 클러스터에서 효과적으로 병렬 MPI 프로그램을 실행시키기 위해, 메시지 전달 이벤트를 토대로 통신에 창설하는 프로세스들이 동시에 스케줄링되는 기법을 설계 구현하였다. 실제 병렬프로그램의 실행을 통해 측정한 결과에 따르면, 통신량이 높은 프로그램에서 33-56%의 실행 시간 감소효과를 보였다.

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병렬 처리 구조를 이용한 최적 정합 방식 CAM 설계에 관한 연구 (A Study on the CAM Designed by Adopting Best-Match Method using Parallel Processing Architecture)

  • 김상복;박노경;차균현
    • 한국통신학회논문지
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    • 제19권6호
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    • pp.1056-1063
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    • 1994
  • 본 논문에서는 연상 메모리 소자에 대한 데이터와의 병렬 처리 최적 정합 방식을 적용하여 계산 효율과 처리율을 높인 단일 PE 아키텍쳐를 이용하여 CAM을 설계하였다. 설계한 CAM은 크게 3개의 기능 블록(입력 MUX, 최적 정합 CAM, 제어부)으로 구성되어 있다. 데이터 처리는 병렬 입력 및 병렬 비교를 하여 고속으로 데이터를 처리하는 전.병렬 방식을 채택하였다. 이러한 특성을 갖는 CAM은 회로 및 논리 시뮬레이션을 통하여 ETRI 3 m-well 공정 설계 규칙을 사용하여 설계하였다. 본 논문에서 설계된 CAM의 최대 동작 주파수는 20MHz이다.

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부분병렬 알고리즘 기반의 LDPC 부호 구현 방안 (Design Methodology of LDPC Codes based on Partial Parallel Algorithm)

  • 정지원
    • 한국정보전자통신기술학회논문지
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    • 제4권4호
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    • pp.278-285
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    • 2011
  • 본 논문에서는 DVB-S2 표준안에서 권고되고 있는 irregular LDPC 부호의 다양한 부호화율에서 부호화 방식 및 복호화 방식에 대해 살펴보고 이에 대한 성능분석을 하였다. 또한 이의 구현에 있어서 효율적인 메모리 할당 및 이에 따른 구현 방법에 대해 연구하였다. LDPC 복호기를 구현하는 방안에는 직렬, 부분병렬, 완전병렬 방식이 있으며, 부분병렬방식이 하드웨어 복잡도와 복호속도를 절충하는 방안이다. 따라서 본 논문에서는 부분병렬 구조를 기반으로 하는 LDPC 복호기의 메모리 설계에서 효율적인 체크노드, 비트노드, LLR 메모리의 구조를 제안하고저 한다.

하드웨어 비디오 인코더를 위한 개선된 병렬 머지 방법 (Improved Parallel Merge Scheme for Hardware Video Encoder)

  • 김대연;임성창;강정원
    • 한국방송∙미디어공학회:학술대회논문집
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    • 한국방송∙미디어공학회 2018년도 하계학술대회
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    • pp.149-151
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    • 2018
  • H.265/HEVC(High Efficiency Video Coding)에서는 하드웨어 비디오 인코더의 처리율(Throughput)을 높이기 위하여 동일 CU(Coding Unit) 내 PU(Prediction Unit)들이 병렬로 머지 후보 리스트를 생성할 수 있는 병렬 머지 방법이 표준 기술로 사용되고 있다. 하지만 이 방법은 동일 CU 내의 PU 간의 의존성만 제거할 수 있고 코딩 순서상의 이전 CU 와의 의존성은 제거할 수 없다. 결국 이전 CU 의 모드 결정 과정이 완료된 후에 현재 CU 내의 PU 가 머지 후보 리스트를 생성할 수 있기 때문에 높은 처리율 향상을 기대할 수 없다. 또한 CU 내의 대부분의 PU 들이 가장 인접한 MV(Motion Vector)를 머지 후보로 사용하지 못하여 압축 효율에 대한 손실도 크다. 본 논문에서는 이전 CU 와의 의존성을 제거함으로써 높은 처리율을 갖으면서 압축 효율에 대한 손실을 최소화할 수 있는 개선된 병렬 머지 방법을 제안한다. 실험 결과, 제안된 방법은 기존 병렬 머지 방법 대비 동일 화질에서 평균 약 1.8%의 압축률이 향상되는 것으로 나타났다.

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