• Proceedings of the Korean Society of Precision Engineering Conference
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• 2008.11a
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• pp.595-596
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• 2008

• Proceedings of the Korean Society of Precision Engineering Conference
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• 2012.10a
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• pp.483-484
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• 2012

• Proceedings of the Korean Society of Precision Engineering Conference
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• 2012.10a
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• pp.485-486
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• 2012

• Proceedings of the Korean Society of Precision Engineering Conference
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• 2013.05a
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• pp.837-838
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• 2013

• Computational Structural Engineering
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• v.4 no.3
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• pp.23-26
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• 1991

본 고에서는 막구조의 설계, 시공, 유지관리에 대해 개략적으로 기술하였다. 막구조는 그 여러가지 특성이 아직 규명이 안된 부분이 많고 시공오차가 비교적 큰 편이므로 막 재료의 역학적, 재료적 특성에 대한 연구와 형상해석 모델의 공식화, 막재단의 컴퓨터화가 필요하며 초기장력 도입에 따른 시공과정의 해석이 더욱 필요하다. 따라서 설계, 형상해석, 재단에서 시공 및 유지관리에 이르는 일괄적인 System의 개발이 시급하다 하겠다.

• Proceedings of the Korean Society of Precision Engineering Conference
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• 2009.10a
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• pp.695-696
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• 2009

• The Optical Journal
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• s.126
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• pp.22-24
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• 2010

한국전광(주)(대표.채진석, www.keocvi.com)는 코팅전문업체로서 국내보다는 미국, 일본, 독일 등 세계에 먼저 이름을 알리며 고출력레이저광학소자의 가공 및 코팅에서만큼은 이미 세계 최고 대열에 들어섰다고 자부한다. 최근에는 방산, 항공우주, 반도체, 의료기기 등 전방위에 들어가는 고부가가치 광학소자 및 시스템 분야로 사업 영역을 확장시키며 광학부품업체에서 토털솔루션 제작업체로 변신을 추구하고 있는 가운데 부설연구소의 김기호 연구소장을 만나 최근의 연구개발 현황을 들어보았다.

• Polymer Science and Technology
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• v.23 no.1
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• pp.47-60
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• 2012

• Proceedings of the KSR Conference
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• 1998.11a
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• pp.111-118
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• 1998

This paper describes the development of the database system for tunnel management of Korea National Railways. In order to make the system both target independent and accessible by KNR network or modem, authors developed the system as a web-based application using java language and IBM DB2 database. The system includes the searching, reporting, graphical representation and statistical functions for tunnel data, maintenance records and checking records. Later, the system will be extended to include the process for tunnel state rating and maintenace prioritiy decision-making.

• Proceedings of the Korea Information Processing Society Conference
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• 2011.11a
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• pp.925-927
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• 2011

본 논문에서는 확장 이진 최대공약수 알고리듬 (Extended Binary GCD algorithm)을 기본으로 GF($2^m$) 상에서 유한체 나눗셈 연산을 위한 고속 알고리듬을 제안하고, 제안한 알고리듬을 기본으로 한 나눗셈 연산기의 FPGA 설계 구현에 관하여 기술한다. 제안한 알고리듬은 Verilog HDL 로 기술하였고, Xilinx FPGA virtex4-xc4vlx15 디바이스를 타겟으로 하였다.