본 논문은 Defected Ground Structure(DGS)를 DC block에 적용한 후 DC block의 부분인 λ/4-결합 선로의 간격과 길이의 변화를 EM 시뮬레이션과 실제 제작을 통하여 알라보았다. 그 결과 일반적인 DC block을 사용할때와 동일 출력 조건하에서 DGS 구조의 DC block의 λ/4-결합선로사이의 간격이 0.1 mm에서 0.46 mm로 0.36 mm만큼 늘어나고λ/4-결합 선로의 길이는 71.7 mm에서 13.32 mm로 4.5 mm만큼 줄어드는 것을 알 수 있었다. 또한 Blocking 캐패시터, 일반적인 DC block, DGS 구조의 DC block을 사용하는 세 종류의 전력증폭기를 제작한 후 특성을 확인해 보았다. 먼저 각 증폭기의 산란 파라미커 특성을 살펴본 결과 3.2$\pm$0.05 GHz의 주파수 대역에서 세 증폭기 모두 유사한 이득 특성과 산란 파라미터 특성을 갖음을 알수 있었다. 그리고 3.2 GHz의 CW 신호를 인가하여 주신호의 출력 전력이 25dBm 일 때 하모닉 특성을 스펙트럼 분석기로 분석한 결과 캐패시티를 사용시에는 주신호와 2차 하모닉 성분과의 차이가 -44.83dBc 일반적인 DC block과 DGS DC block 사용시에는 -66.84와 -64.33 dBc로서 일반적인 DC block 사용시와 DGS block 사용시에 하모닉 특성이 거의 일치함을 확인하였다.
대역통과용 표면 탄성파 필터 제작하기 위하여 Langasite 기판위에 빗살무의 변환기를 형성 시켜 모의실험을 수행하였으며, 전극재료로는 Al-Cu를 사용하였다. 모의실험을 바탕으로 입력단에는 IDT를 직렬형태로 연결시킨 block 형태로 하중을 가하는 전극 방법을 쓰고 출력 단은 withdrawal 형태로 하중을 가하는 방법을 써서 제작하였다. 이를 바탕으로 광대역의 SAW 필터 전극 설계 방식에 대한 적절한 위상조건도 얻고자 시도하였다. Langasite 기판위에 형성시킨 입출력 빗살무의 변환기 전극 수는 50쌍, 두께는 $5000\;{\AA}$으로 하였으며, 반사기 폭은 $3.6{\mu}m$으로 하였다. 그리고 hot전극과 반사기사이의 거리는 각각 $2.0{\mu}m\;2.4{\mu}m$로 제작하였고, hot전극에서부터 접지전극까지 간격은 $1.5{\mu}m$로 하였으며 전극 모양은 좌우 동일한 형상을 채택하였다. 제작한 필터의 주파수 특성은 중심주파수가 대략 190MHz정도, 대역폭은 7.8MHz 이하로 측정되었으며, matching 후 return-loss는 -18dB 이하이고, 리플 특성은 3dB 이하이며, 반사에 의한 잔향은 -25dB 이하로 측정되었다.
본 논문에서는 보다 편리한 튜닝을 위해 Evanescent-Mode Rectangle Waveguide(EMRWG)에 삽입된 새로운 작은 직경의 원통형 포스트 커패시터를 제안하였다. EMRWG급전을 위한 제안된 구조는 입력 및 출력 끝에서 도파관과 동일한 너비와 높이를 갖는 단일 리지 직사각형 도파관을 사용하였다. 삽입된 포스트 커패시터는 EMRWG의 넓은 벽체 하부 중앙에 형성된 원형 홈과 상부에 삽입된 동심원기둥 포스트로 구성된다. 먼저 제안된 구조에 대한 등가회로 모델을 제시하였고, EMRWG와 단일 리지 도파관이 결합될 때 이상적인 변압기의 접합 서셉턴스와 권선비는 각각 HFSS(3d fullwave 시뮬레이터, Ansoft Co.)를 사용하여 두 가지 경우에 대해 시뮬레이션하였다. 얻어진 매개변수와 EMRWG의 특성을 이용하여 삽입된 기둥의 서셉턴스 및 공진 특성을 분석하였다. 중심주파수 4.5GHz, 대역폭 170MHz의 2포스트 필터는 WR-90 도파관을 이용하여 설계하였으며, 등가회로 모델에 대한 계산과 HFSS와 CST를 이용한 시뮬레이션 결과가 서로 일치하였다.
본 연구에서는 실리콘 기판 상에 제작된 3D 결합구조를 가지는 코프레너 선로인 CWP3DCS(coplanar waveguide employing periodic 3D coupling structures) 구조에 대한 특성임피던스와 대역폭특성을 연구하였으며 이를 통해 완전집적형 해양무선통신 반도체 SoC(System on Chip)를 구현하기 위한 수동소자의 개발가능성을 검토하였다. CWP3DCS에 대한 특성임피던스와 대역폭특성을 추출하기 위해서 삽입손실에 대한 측정값을 반영한 measurement-based equation을 유도하였으며, 이 방법의 유효성을 검증하기 위해 전송상수 β와 특성임피던스에 대한 측정값과 measurement-based equation으로부터 추출된 계산값을 비교하였다. 비교 결과에 의하면 특성임피던스와 전송상수 β에 대한 계산값과 측정값의 최대오차는 각각 3.9%와 6.4%의 값을 보여주었다. 본 논문의 연구결과에 의하면, CWP3DCS 구조는 주기적 구조의 길이 LT = 30 ~ 150 ㎛의 범위에서 통과대역이 121 GHz인 광대역 특성을 보여주었으며, 특성임피던스 역시 주파수 의존성이 매우 적은 광대역 특성을 보여주었다. 그리고, 20 ㎛의 선로 폭으로도 20 Ω이하의 낮은 임피던스를 가지는 전송선로의 구현이 가능하였으며, 동일한 임피던스를 가지는 기존 전송선로의 선로 폭 3mm에 비해 선로 폭이 크게 감소하였다. 그리고, 주기적 구조의 길이 LT값을 조정함으로써 원하는 특성임피던스 값을 가지는 구조를 반도체 기판 상에 용이하게 구현할 수 있음을 알 수 있었다. 상기 결과로부터 CWP3DCS 구조는 완전집적형 무선통신 반도체 SoC용 정합 및 수동소자로써 유용하게 사용될 수 있음을 알 수 있었다. 본 논문은 3D 결합구조를 가지는 코프레너 선로인 CWP3DCS의 대역폭에 대한 최초의 연구이다.
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[게시일 2004년 10월 1일]
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