Many researchers have studied flash memory in order to replace hard disk storages. Many FTL algorithms have been proposed to overcome physical constraints of flash memory such as erase-before-write, wear leveling, and poor write performance. Therefore, these constraints should be considered for testing FTL algorithms and the performance evaluation of flash memory. As doing the experiments, we suffer from several problems with costs and settings in experimental configuration. When we, for example, replay the traces of Oracle to evaluate the I/O performance with flash memory, it is hard to extract exact traces of I/O operations in Oracle. Since there are only write operations in the log, it is impossible to gather read operations. In MySQL and SQLite, we can gather the read operations by changing I/O functions in the source codes. But it is not easy to search for the exact points about I/O and even if we can find out the points, we might get wrong results depending on how we modify source codes to get I/O traces. The FlaSim proposed in this paper removes the difficulties when we evaluate the performance of FTL algorithms and flash memory. Our Linux drivers emulate the flash memory as a hard disk. And we can easily obtain the usage statistics of flash memory such as the number of write, read, and erase operations. The FlaSim can be gracefully extended to support the additional modules implemented by novel algorithms and ideas. In this paper, we describe the structure of FTL emulator, development tools and operating methods. We expect this emulator to be helpful for many experiments and research with flash memory.
B2B e-business is an economic transaction formed between companies through various networks including internet. At present, e-business between companies partly applies information distribution between companies, but many enterprises expect that a corporate basic system will be gradually changed into XML basis if web service is earnestly materialized, so they are competing with each other in developing XML DBMS. Existing XML DBMS studies used XML DTD in order to represent the structure of XML document. Such XML DTD defines the expression of a simple type, so there are many difficulties in defining the structure of XML document. To cope with this, in this paper, the author will develop database schema generator utilizing relational database generally used in storing contents of data, on the basis of XML schema selected as a standard of W3C. Also, to store XML data, the author proposed the automatic conversion method of relational database schema that used XML schema.
In this paper, we designed the open service platform based on integrated type of individual customized service and intelligent information technology with individual's complex attributes and requests. First, the data collection phase is proceed quickly and accurately to repeat extraction, transformation and loading. The generated data from extraction-transformation-loading process module is stored in the distributed data system. The data analysis phase is generated a variety of patterns that used the analysis algorithm in the field. The data processing phase is used distributed parallel processing to improve performance. The data providing should operate independently on device-specific management platform. It provides a type of the Open API.
Journal of the Institute of Electronics Engineers of Korea SD
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v.45
no.2
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pp.135-139
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2008
In this paper, tunable SC(switched capacitor) 2nd order bandpass $\Sigma-\Delta$(Sigma-Delta) modulator with novel architecture that can adjust the IF band center frequency by one coefficient value is proposed for data conversion in the IF(Intermediate Frequency) band. Its architecture can optionally adjust all the 2nd order noise transfer function in comparison with the conventional architecture. In order to adjust the center frequency, the conventional architecture needs the two variable coefficient values, basic clock and eight clocks. On the other hand, the proposed architecture can adjust the center frequency by one variable coefficient value and basic clock only.
G3 팩스가 G1 팩스나 G2 팩스와 구별되는 점은 문서 이미지를 스캔하여 얻은 아날로그 신호(전압)를 디지털 신호로 바꿔주는 A/D 변환과 여기서 얻어진 디지털 신호를 전송을 위해 다시 아날로그 신호(주파수, 위상 진폭)로 바꿔주는 모듈레이션 과정이 중간에 신호를 압축하여 표현하는 코딩 단계가 있다는 것이다. 따라서 G1 팩스나 G2 팩스에 비해 s훨씬 적은 신호를 가지고 문서 이미지를 표현할 수 있으며, 결과적으로 전송속도가 빨라지는 것이 된다. 표준 A4용지는 수평 방향으로 1728개의 픽셀, 수직방향으로 1145라인의 픽셀로 구성된다. 따라서 층 1,978,560($1728{\times}1145$) 비트의 데이터가 A4용지 한 장에 포함될 수 있는 것이다. 팩스가 이런한 표준 A4용지를 스캔하게될 경우 수캔되는 매 라인에는 1728개의 검은색(글자 및 그림) 및 흰색 (여백)픽 셀들이 존재한다. G3 팩스는 서로 다른 Run Length에 비교적 짧은 특정 코드를 미리 할당해 놓고 실제 픽셀들 대신 이러한 코드들을 모듈레이션해서 전송한다. 따라서 전송속도는 단축된다.
Proceedings of the Korea Water Resources Association Conference
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2012.05a
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pp.980-980
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2012
기존 홍수시각화 기법은 홍수위 분석 결과를 지형자료 기초로 단순히 침수위를 표현하는 방식으로 홍수 분석결과를 시각적으로 표출하는 일차원적 기법으로 홍수상황 대응을 위한 의사결정을 지원하기에는 다소 부족한 실정이다. 이를 개선하기 위해서는 정밀지형 자료를 근간으로 하도내에서 유체의 흐름 특성을 사실적으로 시뮬레이션 할 수 있는 기술 개발이 필요하다. 홍수 시뮬레이션 기술은 고성능 컴퓨터를 활용하여 실좌표계를 기반으로 정밀 하천지형, 하도구성, 홍수시 유체흐름 표현 등에 필요한 데이터 필터링 및 융합처리, 하상생성 기법, 지형자료의 변환 및 가공 등의 처리 가능한 기법을 적용한다. 본 연구에서는 침수영향에 대해 정밀지형을 근간으로 홍수 시뮬레이션을 통해 의사결정을 지원할 수 있는 기반을 제공하고자 하였으며, 홍수시뮬레이터에는 하상지형 처리 및 생성 모듈, 홍수 시뮬레이션 모듈 등으로 구성된다. 또한, 하천 상황의 3차원 표현을 위한 지형 및 시뮬레이션 처리 기법 개발으로 랜더링 처리 기법, 유체 표현 기법을 개발하였다. 이에 따라, 본 연구에서 개발 적용된 홍수 시각화 기법은 홍수분석 결과에 대해 유체의 흐름, 유량, 유량의 전파 속도 등 유체 역학적인 흐름 특성을 사실적으로 표현하는 기법이다. 본 연구의 성과물 도출을 통해 물관리시스템에 반영하여 홍수관리에 활용할 수 있을 것으로 기대된다.
Journal of the Korean Institute of Intelligent Systems
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v.20
no.3
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pp.380-387
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2010
For the fault diagnosis of three-phase induction motors, we propose a diagnosis algorithm based on mutual information and linear discriminant analysis (LDA). The experimental unit consists of machinery module for induction motor drive and data acquisition module to obtain the fault signal. As the first step for diagnosis procedure, DFT is performed to transform the acquired current signal into frequency domain. And then, frequency components are selected according to discriminate order calculated by mutual information As the next step, feature extraction is performed by LDA, and then diagnosis is evaluated by k-NN classifier. The results to verify the usability of the proposed algorithm showed better performance than various conventional methods.
Journal of the Korea Institute of Information and Communication Engineering
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v.14
no.8
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pp.1901-1906
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2010
This classification of walking patterns is important and many kinds of applications. Therefore, we attempted to classify walking on level ground from slow walking to fast walking using a waist acceleration signal. A tri-axial accelerometer was fixed to the subject's waist and the three acceleration signals were recorded by bluetooth module at a sampling rate of 100 Hz eleven healthy. The data were analyzed using discrete wavelet transform. Walking patterns were classified using two parameters; One was the ratio between the power of wavelet coefficients which were corresponded to locomotion and total power in the anteroposterior direction (RPA). The other was the ratio between root mean square of wavelet coefficients at the anteroposterior direction and that at the vertical direction(RAV). Slow walking could be distinguished by the smallest value in RPA from other walking pattern. Fast walking could be discriminated from level walking using RAV. It was possible to classify the walking pattern using acceleration signal in healthy people.
Kim, Dong-Hyeok;Keum, Min-Ha;Oh, Se-Moon;Lee, Sang-Hoon;Islam, Mohammad Rakibul;Kim, Jin-Sang;Cho, Won-Kyung
Journal of the Institute of Electronics Engineers of Korea SD
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v.45
no.10
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pp.31-38
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2008
This paper describes sensor network system implementation for the IEEE 1451.2 standard which guarantees compatibilities between various wired sensors. The proposed system consists of the Network Capable Application Processor(NCAP) in the IEEE 1451.0, the Transducer Independent Interface(TII) in the IEEE 1451.2, the Transducer Electronic Data Sheet(TEDS) and sensors. The research goal of this study is to minimize and optimize system complexity for IC design. The NCAP is implemented using C language in personal computer environment. TII is used in the parallel port between PC and an FPGA application board. Transducer is implemented using Verilog on the FPGA application board. We verified the proposed system architecture based on the standards.
In this paper, we designed and fabricated a compact UHF receive module for efficient operation such as tactical and operation situation, target location information confirmation, target reset using Link-K(Korean joint tactical data link system). And the effect of target reset was analyzed by simulation. The designed module consists of UHF(ultra high frequency) receiver section, control section, and power distribution section. The UHF receiver section performs frequency down conversion, filtering and automatic gain control, etc. The control section demodulates frequency down-converted signals, extracts information, and performs external interworking. The power distribution section supplies external power, generates and supplies the power required by each section. The fabricated module was dimension of $105{\times}105{\times}80mm$ and weighed 1.10 kg and The receiving distance is more than 50 km.
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[게시일 2004년 10월 1일]
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