Realization of Ternary Arithmetic Circuits

三値演算回路의 實現

This paper describes a logical design of ternary arithmetic circuits based on T-gates. A new circuit of T-gate is proposed which is improved in the stability of operation, and a ternary adder, subtracter, multiplier and divider using the T-gates are realized. The realization of the circuits is based on the Mod-3, system and the Signed Ternary system using digit 0, 1, 2 and -1, 0, +1 as arithmetic states.

三値논리는 同一의 情報量을 表現하는데 二値에 비하여 적은수의 記號로 써 達成할 수 있고 演算速度가 빠르다는 특징을 갖고 있다. 그러나 현재로서는 回路素子가 三値論理에 適合한 것이 나와 있지 않고 二値論理만큼 工學的인 接近 이 이루어져 있지 않은 상태이지만 보다 고 속의 情報處理裝置를 構成하기 위해 서 이 分野의 硏究는 價値있는 일이라 하겠다. 三値論理에 對해서는 Post(1),, M hldorf(2) 이래 많은 硏究가 있었다.