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A Report on Power Estimation of SHA-3 Candidates H/W Implementation

SHA-3 후보들의 H/W 구현에 대한 전력 소모량 추정

  • Lee, Donggeon (Dept of Computer Science & Engineering, Pusan National University) ;
  • Chu, Sangho (Dept of Computer Science & Engineering, Pusan National University) ;
  • Kim, Seul-A (Dept of Computer Science & Engineering, Pusan National University) ;
  • Kim, Howon (Dept of Computer Science & Engineering, Pusan National University)
  • 이동건 (부산대학교 컴퓨터공학과) ;
  • 추상호 (부산대학교 컴퓨터공학과) ;
  • 김슬아 (부산대학교 컴퓨터공학과) ;
  • 김호원 (부산대학교 컴퓨터공학과)
  • Published : 2010.11.12

Abstract

2005년 중국의 Wang 등이 SHA-1의 충돌쌍 공격에 대한 취약성을 발표한 이후 미국의 NIST(National Institute of Standards and Technologies)에서는 새로운 표준 해쉬 함수에 대한 필요성을 제기하였으며, SHA-3로 사용될 새로운 해쉬 함수를 공모하게 되었다. 전세계에서 64개의 후보들이 제안되었으며, 1라운드가 끝난 2010년 현재 14개의 후보들에 대한 2 라운드 심사가 진행중이다. 본 논문에서는 ASIC(Application Specified Intergrated Circuit) 설계 과정에서 설계 대상의 전력 소모량을 추정하는 과정을 소개하고, 이를 이용해 SHA-3 후보들의 H/W 구현들에 대해서 전력 소모량을 추정하여 결과를 제시한다.

Keywords